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公开(公告)号：CN117040990A
公开(公告)日：2023-11-10
申请号：CN202310988110.2
申请日：2023-08-07
Applicant: 西安微电子技术研究所
IPC: H04L27/26
Abstract: 本发明公开了一种基于OFDM有线载波通信的子载波表的更新和使用方法，属于数据通信技术领域，本发明将可用子载波表初始化，接收链路接收数据时实时进行前向纠错解码解析，进行子载波异常判定；当判定子载波为异常子载波，更新可用子载波表；更新后BC节点向所有RT节点发送更新命令和更新后的可用子载波表，全部节点均完成更新，系统中所有节点均采用更新后的可用子载波表进行通信；重复上述步骤，实时检测数据。本发明通过借助子载波异常检测判定信噪比低的子载波，采用动态更新和维护OFDM选用子载波表，剔除信噪比低的子信道，充分利用信噪比高的子信道，消除异常频点导致的单位错，降低不可纠正的多位错，达到降低通信误码率的效果。
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公开(公告)号：CN113873184B
公开(公告)日：2023-10-17
申请号：CN202111277411.1
申请日：2021-10-29
Applicant: 西安微电子技术研究所
IPC: H04N25/76 , H04N25/772 , H04N17/00
Abstract: 本发明公开了一种图像传感器芯片级ADC修调系统，包括修调控制模块和修调预写入模块，修调控制模块连接修调预写入模块，修调控制模块用于输出控制信号给修调预写入模块，修调预写入模块的修调输出连接到ADC模块的控制端，与ADC模块的各待修正模块连接，用于输出修调控制信号，针对系统修调预写入、电容失配修调、功耗修调和误差修调，可有效弥补工艺偏差失配、工艺角偏离等因素引起的性能参数下降和功耗超差、提升ADC的关键动态和静态参数，具有很高的实用性。
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公开(公告)号：CN115118679B
公开(公告)日：2023-09-26
申请号：CN202210762475.9
申请日：2022-06-30
Applicant: 西安微电子技术研究所
IPC: H04L47/6275
Abstract: 本发明属于计算机通信及网络领域，具体涉及一种针对以太网交换器管理帧的快速转发系统。当交换器管理端口输入数据帧时，解析器首先通过opcode码进行快速识别，转发控制逻辑在收到管理帧标识信号后优先进行索引查询，不再需要和其它端口的输入数据参与轮询，从而能够快速产生转发结果；在输出端口，通过设置优先级最高的专用队列，使管理帧能够优先输出；这种方法避免了管理帧在输入端口、转发控制与输出端口的仲裁排队，大大缩短了管理帧的交换延迟，从而实现了对网络的及时管理，具有很高的工程应用价值。
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公开(公告)号：CN114003543B
公开(公告)日：2023-07-07
申请号：CN202111277454.X
申请日：2021-10-29
Applicant: 西安微电子技术研究所
IPC: G06F13/42
Abstract: 本发明属于通信领域，公开了一种高速串行总线时钟补偿方法及系统，包括包括以下步骤：获取高速串行总线各通道的写入数据数量和读出数据数量，并根据写入数据数量和读出数据数量生成各通道的补偿申请；获取高速串行总线各通道的当前写入数据和当前读出数据，并根据当前写入数据和当前读出数据生成各通道的状态信号；根据各通道的状态信号以及补偿申请，生成各通道的补偿使能信号，并根据各通道的补偿使能信号对各通道进行预设的补偿操作。对多通道的各个输入时钟无相位要求，具有灵活的使用性，可应用于多种高速总线协议之中，解决多种高速总线物理层的多通道互联问题，并通过状态信号控制各通道的补偿操作，有效的提高电路传输的可靠性与正确性。
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公开(公告)号：CN112487750B
公开(公告)日：2023-06-16
申请号：CN202011380470.7
申请日：2020-11-30
Applicant: 西安微电子技术研究所
Abstract: 本发明公开了一种基于存内计算的卷积加速计算系统及方法，在存储模式下，将卷积核和输入特征图数据按行串行加载进存内计算IP中，在存储模式下将卷积运算中的恒定参数卷积核与待处理的输入特征图加载到存储器中，然后切换至运算模式，通过有序控制存内计算IP串行完成操作数的乘法、部分和累加以及操作数的切换步骤，利用卷积加速控制结构将卷积运算的所有步骤按周期进行无缝衔接，采用硬件替代软件进行时序调度，避免复杂的软件指令引入的效率损失，从而有效发挥存内计算IP在实际大规模数据并行处理中的效能优势。本发明将卷积运算进行算力加速，以降低卷积运算的时间开销，为人工智能的实时性提供技术支撑。
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Patent Agency Ranking
公开(公告)号：CN116257476A
公开(公告)日：2023-06-13
申请号：CN202310146257.7
申请日：2023-02-21
Applicant: 西安微电子技术研究所
Abstract: 本发明涉及集成电路设计领域，公开了一种支持PCIe总线排序规则的处理方法、系统、终端及介质，通过某些条件下一个接收的事务层包的序列号维持不变、存储事务层包的缓存为空时接收的下一个事务层包的序列号回卷为最小值等方式使得多个事务层包可以使用同一个序列号，序列号在未达到最大值时及时回卷到了初始最小值，配合发明的事务层包读取方法在组成序列号的位数不变的情况下，在保证了缓存中事务层包读取调度遵循PCIe排序规则的前提下极大的延缓了序列号递增到最大值的时间，通过暂停事务层包的缓存写入和序列号生成直到缓存为空等方式解决了序列号设置为最大值后序列号回卷对缓存中事务层包读取调度时PCIe排序规则的破坏。
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公开(公告)号：CN115964169A
公开(公告)日：2023-04-14
申请号：CN202211643130.8
申请日：2022-12-20
Applicant: 西安微电子技术研究所
Abstract: 本发明公开了一种适用于神经网络加速器的内存回收结构及方法，集成电路设计领域，可以通过寄存器对神经网络加速器进行“任务态‑空闲态”模式切换，在空闲态时通过关闭加速器中模块时钟降低其整体功耗。可以在加速器处于空闲态时将其内部存储RAM阵列资源释放给智能异构芯片上其他单元，提高处理器整体工作效率。且本发明设计结构简单，只集成寄存器和控制单元在加速其内部，在释放存储资源的同时没有产生大多冗余的逻辑加大不必要的功耗，在成本上没有增加多余开销，芯片面积上也不会带来太大的消耗。且该结构可扩展性强，可以用于RAM阵列型缓存设计，同样，也适用于其他智能加速器结构。
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公开(公告)号：CN115865846A
公开(公告)日：2023-03-28
申请号：CN202211274566.4
申请日：2022-10-18
Applicant: 西安微电子技术研究所
IPC: H04L49/253 , H04L49/25
Abstract: 本发明公开了一种PCIe交换电路直通模式控制方法，属于集成电路设计领域。本发明在PCIe交换电路内部为每个端口设置入端交换控制寄存器和出端交换控制寄存器，分段控制输入端口和输出端口的交换方式，使得用户可以对从PCIe交换电路不同端口进入或输出的事务包进行差异化交换控制，提高了PCIe交换电路应用的灵活性从而提升了系统的整体交换性能。本发明通过对不同输出端口出端交换控制寄存器的不同设置，使从同一输入端口进入的交换事务面向不同输出端口采用不同的交换方式；另外，还可以通过对不同输入端口入端交换控制寄存器的不同设置使从不同端口输入、同一端口输出的交换事务采用不同的交换方式。
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公开(公告)号：CN113556290B
公开(公告)日：2022-09-13
申请号：CN202110801289.7
申请日：2021-07-15
Applicant: 西安微电子技术研究所
IPC: H04L47/31
Abstract: 本发明提供了基于帧特征符的FC帧冗余接收方法、系统、设备及介质，通过帧特征符的生成，能够很好地处理多协议传输问题。本发明支持传递FC‑AE‑ASM、FC‑AV、FC‑IP、FC‑AE‑1553等FC协议帧，具有一定通用性，可信度高，适用性广；在接收完成时即可进行帧冗余判断，根据判断的结果决定丢弃或者上传数据帧，而不需要过多的数据帧缓存空间，可以有效降低数据链路延迟，并且可以与多个已接收的帧进行比对判断，具有一定灵活性；通过维护已接收帧特征符表，当处理帧乱序传递时，能够有效识别已接收帧，不会因双通道传递帧的次序不一致导致冗余判断异常，本发明可以有效识别重复帧，当出现异常的重复帧发送时，可以自动滤除，抑制了广播风暴的传递。
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公开(公告)号：CN114970428A
公开(公告)日：2022-08-30
申请号：CN202210641212.2
申请日：2022-06-08
Applicant: 西安微电子技术研究所
IPC: G06F30/367 , G06F30/38
Abstract: 本发明公开了一种用于SoC(System on Chip)中Flexray总线控制器的验证系统及方法，属于集成电路验证技术领域，提供了一种用于SoC(System on Chip)中Flexray总线控制器的验证方法，该方法以多个片外Flexray总线节点及总线编解码模型完成包括待测Flexray总线控制器节点的组网、同步、解析以及数据比对的功能，通过使用相关模型及应用配置函数对SoC中待测Flexray总线控制器进行初始化及其传输数据进行配置。通过该验证方法可有效提升片上系统中Flexray节点的测试效率。
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