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公开(公告)号：CN113220627A
公开(公告)日：2021-08-06
申请号：CN202110444240.0
申请日：2021-04-23
Applicant: 西安微电子技术研究所
IPC: G06F15/78 , G06F15/173
Abstract: 本发明公开了一种二维片上网络路由节点结构，本发明在虫孔交换和虚通道技术基础上多路由节点结构进行改进，优化了RN内部交叉开关以及传输通路，降低了RN硬件资源及实现复杂度。本发明具有六个端口的二维NoC RN单元，相邻的二维NoC RN单元间具有RN之间传输通路，二维NoC RN单元包括两个交叉开关，两个交叉开关之间具有RN内部传输通路。该结构简单、规则、无死锁，有利于RN层次化和模块化设计。本发明中RN定义的端口、缓存大小、数据宽度可根据NoC资源及性能需求进行缩减，其中的路由算法、仲裁策略均不受该结构影响。同时，RN之间物理通道可支持单通道或双通道，具有良好的通用性。
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公开(公告)号：CN112948322A
公开(公告)日：2021-06-11
申请号：CN202110218606.2
申请日：2021-02-26
Applicant: 西安微电子技术研究所
IPC: G06F15/78 , G06F5/06 , G06F12/0866
Abstract: 本发明公开了一种基于弹性缓存的虚通道及实现方法，本发明能够实现片上异步互联结构中节点间数据的高效、灵活传输，一方面数据发送端与接收端采用源同步的方式能够有效降低节点间互联信号的数量，有利于后端版图实现；另一方面通过弹性缓存动态调整机制实现了双通道FIFO深度在1和N之间切换，极大地降低了缓存资源，提高了缓存空间利用率。本发明能够弥补传统虚通道机制在缓存资源高、后端实现困难方面存在的不足。
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公开(公告)号：CN113220627B
公开(公告)日：2023-05-30
申请号：CN202110444240.0
申请日：2021-04-23
Applicant: 西安微电子技术研究所
IPC: G06F15/78 , G06F15/173
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公开(公告)号：CN112948322B
公开(公告)日：2023-05-16
申请号：CN202110218606.2
申请日：2021-02-26
Applicant: 西安微电子技术研究所
IPC: G06F15/78 , G06F5/06 , G06F12/0866
Abstract: 本发明公开了一种基于弹性缓存的虚通道及实现方法，本发明能够实现片上异步互联结构中节点间数据的高效、灵活传输，一方面数据发送端与接收端采用源同步的方式能够有效降低节点间互联信号的数量，有利于后端版图实现；另一方面通过弹性缓存动态调整机制实现了双通道FIFO深度在1和N之间切换，极大地降低了缓存资源，提高了缓存空间利用率。本发明能够弥补传统虚通道机制在缓存资源高、后端实现困难方面存在的不足。
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公开(公告)号：CN112035389B
公开(公告)日：2022-08-23
申请号：CN202010888401.0
申请日：2020-08-28
Applicant: 西安微电子技术研究所
Abstract: 本发明公开了一种PLB‑AXI总线转换桥及其工作方法，PLB从接口单元实现对PLB访问协议接口的划分，用于处理PLB接口信号；协议转换控制单元，实现PLB协议到AXI协议的完整转换；AXI主接口单元，实现对AXI访问协议接口的划分，用于处理AXI接口信号；寄存器单元，实现对协议转换控制单元内部工作状态信息的寄存，送至DCR接口；异常处理单元，实现对协议转换控制单元内部工作异常信息的处理，送至异常/中断接口。采用两级流水的协议快速转换策略和规避多访问拥塞的缓存策略，实现将PLB总线发起的访问命令转化为从设备所在的AXI总线访问命令，实现两种高速总线的协议通信，提升系统内通信效率，解决嵌入系统、SoC系统内高速PLB总线到AXI总线访问的高效、高可靠转换问题。
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Patent Agency Ranking
公开(公告)号：CN113162906A
公开(公告)日：2021-07-23
申请号：CN202110218237.7
申请日：2021-02-26
Applicant: 西安微电子技术研究所
IPC: H04L29/06
Abstract: 本发明公开了一种NoC传输方法，本发明将包格式分为数据类包格式、请求类包格式和回复类包格式。任务传输协议将任务分为写传输和读传输。写传输协议又划分为带回复包写传输和不带回复包写传输。同时，定义了任务传输协议的包长度可配置。本发明既具有系统性、全面性，又有效提高了NoC传输效率，为不同应用场合下NoC传输协议定义提供有效的解决方案。
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公开(公告)号：CN112965689B
公开(公告)日：2023-05-09
申请号：CN202110217695.9
申请日：2021-02-26
Applicant: 西安微电子技术研究所
Abstract: 本发明公开了一种基于源同步的分布式异步FIFO数据交互方法及FIFO结构，包括以下步骤：发送端产生写操作并维护写指针，将写时钟、写使能及写数据信号通过源同步的方式输出到接收端；发送端根据源同步输入的读时钟、读使能信号维护读指针，并将读指针同步到写时钟域下，维护满/非满信号；接收端产生读操作并维护读指针，将读时钟、读使能信号通过源同步的方式输出到发送端；接收端根据源同步输入的写时钟、写使能及写数据信号维护写指针及写时钟域，并将写指针同步到读时钟域下，维护空/非空信号。本发明有效减少数据发送端和接收端之间数据互联线的数量，降低了物理实现难度，兼顾流量控制的高效数据传输，在有限资源开销的基础上提高能效比。
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公开(公告)号：CN113238984A
公开(公告)日：2021-08-10
申请号：CN202110218231.X
申请日：2021-02-26
Applicant: 西安微电子技术研究所
IPC: G06F15/78 , H04L12/715
Abstract: 本发明公开了一种三维片上网络结构及工作方法，本发明包括网络接口NI模块、RN模块和垂直接口VI模块；垂直接口模块实现网络接口与垂直方向以及垂直方向之间的数据传输。该结构将二维片上网络和层间通信结构进行分离，既可复用二维片上网络结构，又可支持不同的层间通信结构和不同的三维路由算法，具有良好的继承性和通用性，降低了硬件资源成本和设计复杂度。同时，垂直接口为独立模块，可根据要求进行灵活的版图布局布线，降低了三维片上网络物理实现的复杂度。
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公开(公告)号：CN112965689A
公开(公告)日：2021-06-15
申请号：CN202110217695.9
申请日：2021-02-26
Applicant: 西安微电子技术研究所
Abstract: 本发明公开了一种基于源同步的分布式异步FIFO数据交互方法及FIFO结构，包括以下步骤：发送端产生写操作并维护写指针，将写时钟、写使能及写数据信号通过源同步的方式输出到接收端；发送端根据源同步输入的读时钟、读使能信号维护读指针，并将读指针同步到写时钟域下，维护满/非满信号；接收端产生读操作并维护读指针，将读时钟、读使能信号通过源同步的方式输出到发送端；接收端根据源同步输入的写时钟、写使能及写数据信号维护写指针及写时钟域，并将写指针同步到读时钟域下，维护空/非空信号。本发明有效减少数据发送端和接收端之间数据互联线的数量，降低了物理实现难度，兼顾流量控制的高效数据传输，在有限资源开销的基础上提高能效比。
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公开(公告)号：CN109669788A
公开(公告)日：2019-04-23
申请号：CN201811504329.6
申请日：2018-12-10
Applicant: 西安微电子技术研究所
IPC: G06F9/54
Abstract: 本发明公开了一种面向直接内存访问互连通信的多核芯片的精简MPI的实现方法，通过在接收方和发送方同时建立一个分布式上下文数据结构和一个接收上下文数据结构作为支撑整个并行环境的控制结构和数据结构，消息发送方实际上并没有执行数据发送操作，只需对发送消息进行描述，设置好发送上下文，当接收方运行接收调用时，如果上下文匹配，则将发送方指定的内存地址中的消息读回本地内存空间，在应用层中能以极小的内存足迹实现并行程序的设计以及进程之间实现消息的传递，用于支持利用直接内存访问互连通信的多核芯片的并行程序设计，实现进程同步功能，可以用于直接内存访问互连通信的多核芯片的复杂并行程序设计。
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