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公开(公告)号：CN102651234A
公开(公告)日：2012-08-29
申请号：CN201210043857.2
申请日：2012-02-24
Applicant: 株式会社东芝
CPC classification number: G11C15/02 , G11C11/161 , G11C15/046 , H01L27/228
Abstract: 本发明涉及内容可寻址存储器。一个实施例提供一种内容可寻址存储器，包括：自旋MOSFET对，所述自旋MOSFET对包括：第一自旋MOSFET，第一自旋MOSFET的磁化状态根据存储数据而设置；和第二自旋MOSFET，第二自旋MOSFET的磁化状态根据存储数据而设置，第二自旋MOSFET与第一自旋MOSFET并联连接；第一布线，第一布线被构造为施加栅电压，以使得第一自旋MOSFET和第二自旋MOSFET中的任何一个根据搜索数据变为导电；和第二布线，第二布线被构造为将电流施加于第一自旋MOSFET和第二自旋MOSFET这二者。
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公开(公告)号：CN101140944B
公开(公告)日：2011-07-27
申请号：CN200710153622.8
申请日：2007-09-07
Applicant: 株式会社东芝
IPC: H01L27/22 , H01L29/66 , H01L29/772 , G11C11/15 , G11C11/16
CPC classification number: G01R33/093 , B82Y25/00 , G11C11/161 , G11C11/1673 , G11C11/1675 , H01L27/228 , H01L29/66984
Abstract: 一种自旋存储器，包括：磁阻元件(17)，其具有磁化方向被固定的第一铁磁层、磁化方向变化的第二铁磁层、以及在第一铁磁层和第二铁磁层之间的第一非磁性层；下电极(16)和上电极(18)，其延展方向相对第二铁磁层的难磁化轴的夹角在45度到90度之间，并且两者在长度方向上的一个端部之间夹着磁阻元件；被连接到下电极在长度方向上的另一个端部的开关元件(14)；以及被连接到上电极在长度方向上的另一个端部的位线(20)，其中，通过将自旋极化电子供给到第二铁磁层并将磁场从下电极和上电极施加到第二铁磁层上来进行写入。
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公开(公告)号：CN101378072A
公开(公告)日：2009-03-04
申请号：CN200810213097.9
申请日：2008-08-28
Applicant: 株式会社东芝
CPC classification number: H01L29/66984 , B82Y25/00 , H01F10/3268 , H01L43/08
Abstract: 本发明的一个方面的自旋FET包括源/漏区域(13，14)，源/漏区域(13，14)之间的沟道区域，和沟道区域之上的栅电极(16)。源/漏区域(13，14)中的每一个包括由低逸出功材料(13)和铁磁物质(14)组成的堆结构。低逸出功材料(13)是由非氧化Mg，K，Ca，Sc中的一种组成的非氧化物或包含50at％或更多的所述非氧化物的合金。
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公开(公告)号：CN100452233C
公开(公告)日：2009-01-14
申请号：CN200610002435.5
申请日：2006-01-27
Applicant: 株式会社东芝
CPC classification number: H01L27/228 , B82Y10/00 , G11C11/16 , H01L43/08
Abstract: 根据本发明的一种自旋注入磁随机存取存储器，包括磁电阻元件，该磁电阻元件具有其磁化方向固定的磁性固定层、其磁化方向可以通过注入自旋极化电子改变的磁性记录层、和提供在磁性固定层和磁性记录层之间的隧道势垒层；位线，该位线使自旋注入电流通过磁电阻元件，自旋注入电流用于产生自旋极化的电子；写入字线，辅助电流通过该写入字线，辅助电流用于沿着磁电阻元件的易磁化轴方向产生辅助磁场；以及驱动器/接收器，该驱动器/接收器确定自旋注入电流的方向和辅助电流的方向。
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公开(公告)号：CN119677140A
公开(公告)日：2025-03-21
申请号：CN202410217286.2
申请日：2024-02-28
Applicant: 株式会社东芝 , 东芝电子元件及存储装置株式会社
Abstract: 提供能够提高阈值电压的半导体装置。根据实施方式，半导体装置包括第1～3导电部、第1绝缘部以及半导体部。第2导电部在第1方向上与第1导电部分离。第3导电部在与第1方向交叉的第2方向上与第2导电部的一部分排列。第1绝缘部包括设置于第2导电部的一部分与第3导电部之间的第1绝缘区域。半导体部包括第1、2半导体区域，是第1导电类型。第1半导体区域设置于第1导电部与第2导电部之间。第2半导体区域设置于第2导电部的一部分与第1绝缘区域之间且与第2导电部肖特基接合。在第2导电部和第2半导体区域的界面，第1杂质偏析。在第1导电类型为n型的情况下，第1杂质包含从由硼、铟、铝以及铍构成的群选择的至少1种。
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公开(公告)号：CN113224152B
公开(公告)日：2024-09-27
申请号：CN202010939014.5
申请日：2020-09-09
Applicant: 株式会社东芝 , 东芝电子元件及存储装置株式会社
IPC: H01L29/739 , H01L29/06
Abstract: 本发明提供半导体装置，其能够降低二极管动作中的恢复损耗。半导体装置具备第1电极与第2电极之间的半导体部和第1及第2控制电极。第1控制电极配置于第1电极与半导体部之间的第1沟槽内，第2控制电极配置于第2电极与半导体部之间的第2沟槽内。半导体部包括第1导电类型的第1层、第2导电类型的第2层、第1导电类型的第3层、第2导电类型的第4层、第1导电类型的第5层及第1导电类型的第6层。第2层设置于第1层与第1电极之间，第3层设置于第2层与第1电极之间。第4层设置于第1层与第2电极之间，第5层设置于第4层与第2电极之间，第6层设置于第1层与第2电极之间。第2电极经由包括第6层的第1导电类型区域与第1层连接。
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公开(公告)号：CN113809178B
公开(公告)日：2024-07-12
申请号：CN202110197605.4
申请日：2021-02-22
Applicant: 株式会社东芝 , 东芝电子元件及存储装置株式会社
Abstract: 提供一种半导体装置，能够提高特性。根据实施方式，半导体装置包括半导体部件、第1、第2电极、栅电极、栅极端子、第1导电部件、第1端子和第1绝缘部件。半导体部件包括第1导电类型的第1半导体区域、第1导电类型的第2半导体区域和第2导电类型的第3半导体区域。栅极端子与栅电极电连接。第1导电部件与第1电极、第2电极以及栅电极电绝缘。第1端子与第1导电部件电连接。第1绝缘部件包括第3半导体区域与栅电极之间的第1绝缘区域以及栅电极与第1导电部件之间的第2绝缘区域。在与输入到栅极端子的第1信号不同的定时进行切换的第2信号能够被输入到第1端子。
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公开(公告)号：CN117591848A
公开(公告)日：2024-02-23
申请号：CN202310172613.2
申请日：2023-02-27
Applicant: 株式会社东芝
IPC: G06F18/211 , G06F18/27 , G06N5/01 , G06N20/10
Abstract: 本实施方式涉及的信息处理装置具备：回归模型生成部，组合多个变量，生成多个含有两个以上所述变量的组在内的项，并利用所述多个项生成回归模型，所述回归模型对特性变量或者表示含有所述特性变量的目标函数的输出的目标变量进行回归；子群生成部，根据所述回归模型中包含的所述多个项的系数，生成至少一个在至少一个所述项中包含的所述变量的组即子群；以及子空间搜索处理部，根据所述目标函数的优化标准，对每个被所述子群覆盖的子空间进行搜索，生成含有所述多个变量的值的第一设计值数据。
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公开(公告)号：CN117457605A
公开(公告)日：2024-01-26
申请号：CN202310135311.8
申请日：2023-02-20
Applicant: 株式会社东芝 , 东芝电子元件及存储装置株式会社
IPC: H01L23/48 , H01L23/535 , H01L25/18 , H01L25/07
Abstract: 提供半导体装置，能够提高特性。根据实施方式，半导体装置包含第一元件。第一元件包含第一～第三导电部件、第一半导体部件以及第三导电部件布线。第一导电部件包含第一导电部分与第二导电部分。第二导电部件包含第三导电部分与第四导电部分。从第一导电部分向第三导电部分的方向沿着第三方向。从第二导电部分向第四导电部分的方向沿着第一方向。第一半导体部件在第三方向上位于第一导电部分与第三导电部分之间，在第一方向上位于第二导电部分与第四导电部分之间。第三导电部件布线与第三导电部件电连接。第三导电部件布线的至少一部分通过第一半导体部件与第三导电部分之间的第一位置以及第一半导体部件与第一导电部分之间的第二位置中的某一个。
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公开(公告)号：CN106875969A
公开(公告)日：2017-06-20
申请号：CN201610811820.8
申请日：2016-09-09
Applicant: 株式会社东芝
IPC: G11C11/16
Abstract: 本发明涉及磁存储器，具备：导电层，具有第1端子及第2端子；多个磁阻元件，相互间隔地配置于所述第1端子与所述第2端子之间的所述导电层，各磁阻元件具有参照层、配置于所述参照层与所述导电层之间的存储层以及配置于所述存储层与所述参照层之间的非磁性层；以及电路，对所述多个磁阻元件的所述参照层施加第1电位，并且使第1写入电流在所述第1端子与第2端子之间流过，对所述多个磁阻元件中的应该写入数据的磁阻元件的所述参照层施加第2电位并且使与所述第1写入电流反向的第2写入电流在所述第1端子与第2端子之间流过。
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