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公开(公告)号:CN110676816A
公开(公告)日:2020-01-10
申请号:CN201910870856.7
申请日:2019-09-16
Applicant: 无锡江南计算技术研究所
IPC: H02H7/12
Abstract: 一种低压大电流的多相并联DC/DC电源保护电路,包括一控制芯片,以及N相并联设置的子电路;每相子电路包括相串联的保护电路和功率转换电路;所述保护电路,其内设置有保险丝和故障检测电路;所述故障检测电路,用于检测所述保险丝两端的电压V,并将电压V与额定下限电压值V0进行对比,并在电压V小于额定下限电压值V0时,输出故障报警信号;所述控制芯片,用于接收所述任一故障检测电路发出的故障报警信号并输出电路断开信号给所有所述功率转换电路以实现控制所有功率转换电路断开。本发明,通过多相联动的DC/DC电源保护电路,可以确保多相VRM电源的整体安全,有效提高多相VRM的可靠性。
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公开(公告)号:CN103377154B
公开(公告)日:2016-04-13
申请号:CN201210125461.2
申请日:2012-04-25
Applicant: 无锡江南计算技术研究所
Abstract: 一种存储器的访存控制装置及方法、处理器及北桥芯片。所述存储器的访存控制装置,包括:请求解析单元,用于将访存请求解析成操作命令序列,所述操作命令序列包括若干操作命令;仲裁单元,用于按仲裁条件对所述操作命令序列中的操作命令进行仲裁,以将操作命令发送至所述存储器。相对于现有技术,本发明技术方案通过请求解析单元并行地发送操作命令序列,并利用第一时序约束、第二时序约束和第三时序约束控制发送同一操作命令序列中的当前操作命令和与所述当前操作命令相邻的前一操作命令之间的时间间隔,不仅可以并行访问多个存储体,而且能够并行访问多个存储体组,实现了多维并行访存,显著缩短访存请求的平均处理时间,提高系统整体访存性能。
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公开(公告)号:CN103020007B
公开(公告)日:2015-08-12
申请号:CN201210574123.7
申请日:2012-12-26
Applicant: 无锡江南计算技术研究所
IPC: G06F15/76
Abstract: 本发明提供了一种运算节点板以及运算节点板布局方法。所述高性能运算节点板上集成了第一处理器和第二处理器,第一处理器和第二处理器的型号一致且互相独立;并且,运算节点板上没有集成其它处理器;其中,第一处理器和第二处理器分别通过多路电源模块以及配套电源控制逻辑芯片进行供电控制,且各自配备了多路存储器进行独立的数据存取操作;而且,第一处理器和第二处理器具有公共逻辑电路。第一处理器和第二处理器的位置相互错开布局,并且第一处理器和第二处理器与任何其它高器件或者热器件也相互错开布局。第一处理器的多路受控电源模块在第一处理器四周分散布局;第二处理器的多路受控电源模块在第二处理器四周分散布局。
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公开(公告)号:CN102546186A
公开(公告)日:2012-07-04
申请号:CN201010593851.3
申请日:2010-12-17
Applicant: 无锡江南计算技术研究所
Abstract: 本实施例公开了一种交换机及放置该交换机的网络机仓,其中交换机包括机柜、中板和多个插件板;每个插件板包括两个端口交换芯片、一个内连交换芯片、端口连接器、中板连接器和导轨;端口交换芯片的端口被划分为数量相同的外连端口和内连端口;外连端口与端口连接器连接;内连端口分别连接每个插件板中内连交换芯片;其中需要跨插件板连接的内连端口和内连交换芯片的端口分别与所述中板连接器连接;通过中板连接器实现不同插件板的内连端口和内连交换芯片的连接;机柜包括与插件板数量相同的导轨插槽,插件板通过将导轨沿导轨插槽的插入口拔插。本实施例提高了交换机插件板的集成度和减少了插件板的使用数量,有效地减小了交换机的体积。
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公开(公告)号:CN102087536A
公开(公告)日:2011-06-08
申请号:CN200910200118.8
申请日:2009-12-07
Applicant: 无锡江南计算技术研究所
IPC: G06F1/16
Abstract: 一种刀片装置,包括:至少两块处理器卡,每块处理器卡上包括至少一个CPU以及第一接口;接口装置,适于连接处理器卡,包括至少一对第二接口;所述处理器卡通过其第一接口与所述第二接口的连接实现连接至所述接口装置;其中,每对所述第二接口设置于所述接口装置同侧的同一表面,且两个所述第二接口之间的水平间距不超过与之相连接的任一块处理器卡的长度。本发明通过与所述接口装置相水平的方向上设置一对接口,用于连接两块在垂直方向上重叠的处理器卡,以及所述接口装置水平方向上的可扩展性,从而能够在同一刀片装置上安装高达4块或8块的处理器卡,实现刀片装置的高组装密度和高可维性。
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公开(公告)号:CN110677043A
公开(公告)日:2020-01-10
申请号:CN201910863470.3
申请日:2019-09-12
Applicant: 无锡江南计算技术研究所
Abstract: 本发明涉及电源控制技术领域,尤其涉及一种输出电压自适应调节的多相DCDC电源控制电路。包括CPU核心电源、处理器、自适应电压定位电路、数字环路补偿电路,CPU核心电源依据获取的处理器的检测电压与设定电压值的对比结果调节输出电压,数字环路补偿电路依据处理器的外部电压与设定电压值的对比结果补偿输出电压,自适应电压定位电路依据检测电路调节设定电压值。现有技术中,当核心电源对处理器的输出电流快速变化时,核心电源的相应速度不足,将导致输出电压波动过大。相较于现有技术,本发明通过CPU核心电源、自适应电压定位电路、数字环路补偿电路三者的配合使得当输出电流快速变化时,输出电压能够维持稳定。
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公开(公告)号:CN110602211A
公开(公告)日:2019-12-20
申请号:CN201910870364.8
申请日:2019-09-16
Applicant: 无锡江南计算技术研究所
Abstract: 一种带异步通知的乱序RDMA方法,包括步骤1:源方获取并记录RDMA消息的消息包信息,根据消息包信息从源方主存读取包数据,并将该包数据和对应的消息包信息封装成RDMA数据包,并发送给目标方;步骤2:在收到目标方返回响应包后,响应计数,收齐响应后,向目标方发送异步通知消息Send包;步骤3:在目标方将Send包写入接收队列并返回响应后,写完成事件。本发明,消息包支持乱序发射,减小对网络和路由方式的限制,使网络的构建更为灵活。使用源方计数的可靠性消息传输机制,保证消息可靠传输,简化硬件设计,节省硬件资源开销。由源方硬件自动发起异步通知消息通知目标方消息完成,实现消息完成事件的快速通知,降低消息延时。
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公开(公告)号:CN110597650A
公开(公告)日:2019-12-20
申请号:CN201910846463.2
申请日:2019-09-09
Applicant: 无锡江南计算技术研究所
Abstract: 一种计算机系统中基于自学习的并行故障定位方法及系统,属于高性能计算机维护技术领域。本发明的方法包括:查找故障点;并行对各个故障点的故障现象采用专家诊断模块进行诊断,若诊断有结果,则输出结果;否则采用智能诊断模块进行诊断,若诊断有结果,则输出诊断结果,并将故障现象及其诊断结果加入到专家诊断模块的故障库中。本发明的系统包括多个并行的分布式celery系统,分布式celery系统设有故障点查找模块,故障点查找模块连接有多个并行的单点故障诊断模块,单点故障诊断模块中包括专家诊断模块和智能诊断模块。本发明增强了高性能计算机系统的故障诊断维护能力,大大降低维护人员的工作难度。
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公开(公告)号:CN102571361B
公开(公告)日:2014-10-22
申请号:CN201010593559.1
申请日:2010-12-17
Applicant: 无锡江南计算技术研究所
IPC: H04L12/04
Abstract: 本实施例公开了插件板、具有该插件板的交换机及交换机设计方法;其中交换机包括中板和多个结构相同的插件板;每个插件板包括两个端口交换芯片、一个内连交换芯片、端口连接器和中板连接器;端口交换芯片的端口被划分为数量相同的外连端口和内连端口;外连端口与端口连接器连接;内连端口分别连接每个插件板中内连交换芯片;其中需要跨插件板连接的内连端口和交换芯片的端口分别与中板连接器连接;通过中板连接器与设有连接电路的中板插接,实现不同插件板的内连端口和内连交换芯片的连接。本实施例通过有效地提高了交换机插件板的集成度和减少了插件板的使用数量,从而使得交换机的组装密度加大,进而也就有效地减小了交换机的体积。
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公开(公告)号:CN102447590B
公开(公告)日:2014-09-03
申请号:CN201010508969.1
申请日:2010-10-13
Applicant: 无锡江南计算技术研究所
IPC: H04L12/26
Abstract: 本发明实施例公开了一种交换机的线路测试方法、装置和系统,本发明实施例利用待测交换机的端口组建测试环路、创建能够使测试数据包路由到测试环路中的各个端口的路由表,并将测试数据包一次性地发送至所述测试环路的一个端口缓冲区,实现了测试包能够在所述测试环路上的各个端口之间并发持续的流入流出,从而对交换机线路持续性高压力测试,且可多台待测交换机同时进行测试,克服了现有技术中点对点测试并行性差的缺点,提高了测试效率;由于本发明只需将测试数据包写入每个测试环路的一个端口缓冲区,则一台服务器即可完成多台交换机测试,从而节省了服务器的数量,符合技术节省的要求。
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