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Patent Agency Ranking
公开(公告)号：CN107452709A
公开(公告)日：2017-12-08
申请号：CN201710367949.9
申请日：2017-05-23
Applicant: 三星电子株式会社
IPC: H01L23/522
CPC classification number: H01L23/5227 , H01F27/2804 , H01F38/14 , H01F2027/2809 , H01F2038/143 , H01L23/481 , H01L23/5256 , H01L23/528 , H01L25/0657 , H01L2225/06524 , H01L2225/06541 , H02J50/12 , H04B5/0037 , H04B5/0075 , H05K1/0306 , H05K1/165 , H05K3/4629 , H05K2201/09709 , H05K2201/09845 , H05K2201/10098 , H05K2201/10159 , H05K2201/10181
Abstract: 一种三维(3D)电感器结构包括：第一半导体管芯，其包括第一导电图案以及与第一导电图案间隔开的第二导电图案；堆叠在第一半导体管芯上的第二半导体管芯，第二半导体管芯包括第三导电图案、与第三导电图案间隔开的第四导电图案、穿透第二半导体管芯并将第一导电图案与第三导电图案电连接的第一穿通衬底通路(TSV)、以及穿透第二半导体管芯并将第二导电图案与第四导电图案电连接的第二TSV；以及第一导电连接图案，其被包括在第一半导体管芯中并将第一导电图案的第一端与第二导电图案的第一端电连接，或者被包括在第二半导体管芯中并将第三导电图案的第一端与第四导电图案的第一端电连接。
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公开(公告)号：CN110176260A
公开(公告)日：2019-08-27
申请号：CN201910119977.8
申请日：2019-02-18
Applicant: 三星电子株式会社
Abstract: 一种存储器器件包括：形成在半导体管芯中的存储器单元阵列，该存储器单元阵列包括用于存储数据的多个存储器单元；以及形成在半导体管芯中的计算电路。计算电路基于广播数据和内部数据执行计算，并省略关于无效数据的计算，并且在跳跃计算模式下基于索引数据来执行关于有效数据的计算，其中，广播数据是从半导体管芯的外部提供的，内部数据是从存储器单元阵列读取的，并且索引数据指示内部数据是有效数据还是无效数据。基于索引数据通过跳跃计算模式省略关于无效数据的计算和读取操作降低了功耗。
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公开(公告)号：CN110162486B
公开(公告)日：2024-08-16
申请号：CN201910107835.X
申请日：2019-02-02
Applicant: 三星电子株式会社
IPC: G06F12/02
Abstract: 本申请提供一种存储器装置、一种存储器系统和一种高带宽存储器装置。存储器装置包括：第一通道，其包括第一单元阵列，并且通过第一路径与存储器控制器通信；第二通道，其包括第二单元阵列，并且通过第二路径与存储器控制器通信；以及分配控制电路，其被构造为监视第一通道和第二通道的存储器使用，以及当第一单元阵列的存储器使用超过阈值时将第二单元阵列的一部分的存储空间进一步分配给第一通道。通过第一路径执行对分配给第一通道的第二单元阵列的该部分的存储空间的访问。
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公开(公告)号：CN110176260B
公开(公告)日：2025-05-16
申请号：CN201910119977.8
申请日：2019-02-18
Applicant: 三星电子株式会社
Abstract: 一种存储器器件包括：形成在半导体管芯中的存储器单元阵列，该存储器单元阵列包括用于存储数据的多个存储器单元；以及形成在半导体管芯中的计算电路。计算电路基于广播数据和内部数据执行计算，并省略关于无效数据的计算，并且在跳跃计算模式下基于索引数据来执行关于有效数据的计算，其中，广播数据是从半导体管芯的外部提供的，内部数据是从存储器单元阵列读取的，并且索引数据指示内部数据是有效数据还是无效数据。基于索引数据通过跳跃计算模式省略关于无效数据的计算和读取操作降低了功耗。
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公开(公告)号：CN110162486A
公开(公告)日：2019-08-23
申请号：CN201910107835.X
申请日：2019-02-02
Applicant: 三星电子株式会社
IPC: G06F12/02
Abstract: 本申请提供一种存储器装置、一种存储器系统和一种高带宽存储器装置。存储器装置包括：第一通道，其包括第一单元阵列，并且通过第一路径与存储器控制器通信；第二通道，其包括第二单元阵列，并且通过第二路径与存储器控制器通信；以及分配控制电路，其被构造为监视第一通道和第二通道的存储器使用，以及当第一单元阵列的存储器使用超过阈值时将第二单元阵列的一部分的存储空间进一步分配给第一通道。通过第一路径执行对分配给第一通道的第二单元阵列的该部分的存储空间的访问。
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