功率半导体器件
    1.
    发明授权

    公开(公告)号:CN114220845B

    公开(公告)日:2025-04-18

    申请号:CN202111539843.5

    申请日:2021-12-15

    Abstract: 本申请提供一种功率半导体器件,包括晶圆,以及设置于所述晶圆表面的多个第一阴极梳条和门极;其中,所述晶圆表面划分为具有相同圆心的多个同心圆环区和多个同心扇形区,所述多个同心圆环区和所述多个同心扇形区交叠以限定出多个图形区,所述多个第一阴极梳条间隔设置于所述多个图形区内;设置于同一所述图形区内的各个所述第一阴极梳条与该图形区的径向对称轴平行,且沿其所在的所述圆环区的内环排布;各个所述图形区内所述第一阴极梳条的排布间距沿与所述门极的径向距离的增加的方向先减小后增大。图形区内的阴极梳条的间距随其与门极的径向距离变化进行变化设计,提升了阴极梳条动态开关均匀性,有利于提升大面积芯片的关断能力。

    功率半导体器件
    2.
    发明公开

    公开(公告)号:CN114220845A

    公开(公告)日:2022-03-22

    申请号:CN202111539843.5

    申请日:2021-12-15

    Abstract: 本申请提供一种功率半导体器件,包括晶圆,以及设置于所述晶圆表面的多个第一阴极梳条和门极;其中,所述晶圆表面划分为具有相同圆心的多个同心圆环区和多个同心扇形区,所述多个同心圆环区和所述多个同心扇形区交叠以限定出多个图形区,所述多个第一阴极梳条间隔设置于所述多个图形区内;设置于同一所述图形区内的各个所述第一阴极梳条与该图形区的径向对称轴平行,且沿其所在的所述圆环区的内环排布;各个所述图形区内所述第一阴极梳条的排布间距沿与所述门极的径向距离的增加的方向先减小后增大。图形区内的阴极梳条的间距随其与门极的径向距离变化进行变化设计,提升了阴极梳条动态开关均匀性,有利于提升大面积芯片的关断能力。

    门极换流晶闸管的元胞结构、制备方法及门极换流晶闸管

    公开(公告)号:CN111933704A

    公开(公告)日:2020-11-13

    申请号:CN202010575741.8

    申请日:2020-06-22

    Abstract: 本公开提供一种门极换流晶闸管的元胞结构、制备方法及门极换流晶闸管,所述元胞结构包括在元胞结构两侧,于所述衬底表面向下设置有侧部沟槽,以在所述衬底表面于所述元胞结构中心位置形成凸台;位于所述侧部沟槽和所述凸台下方的第二导电类型短基区;其中,所述短基区的底部于与所述凸台对应的位置处有凸起;位于所述短基区上方的第二导电类型第一基区;位于所述短基区下方的第二导电类型第二基区;其中,所述第二基区的底部于与所述凸台对应的位置处有凸起;位于所述第一基区表面内的第一导电类型发射区;其中,所述短基区的掺杂浓度高于所述第一基区和所述第二基区。可提高驱动控制电压值,从而提高换流速度、增大GCT芯片的关断能力。

    一种功率半导体器件及其制作方法

    公开(公告)号:CN111933686A

    公开(公告)日:2020-11-13

    申请号:CN202010609729.4

    申请日:2020-06-29

    Abstract: 本发明提供了一种功率半导体器件及其制作方法,解决了标准型GCT芯片在过电压阻断状态时容易在芯片台面终端处失效,导致器件失效呈开路状态的问题。包括功能区和电压击穿区,电压击穿区靠近功率半导体器件的中心位置,被功能区环绕,包括依次层叠设置的第二导电类型短路结构和凸形第二导电类型基区,第二导电类型短路结构贯穿功能区的第一导电类型透明发射阳极和第二导电类型缓冲层;凸形第二导电类型基区贯穿第一导电类型第一基区、第一导电类型第二基区和第二导电类型区,在第二导电类型基区向第一导电类型基区的延伸方向上形成凸起部。

    GCT元件封装结构
    5.
    发明公开

    公开(公告)号:CN115863288A

    公开(公告)日:2023-03-28

    申请号:CN202211513436.1

    申请日:2022-11-29

    Abstract: 本发明提供GCT元件封装结构,包括GCT芯片,其中,GCT芯片的阳极与阳极钼片连接,阳极钼片与阳极铜块连接,阳极铜块上引出阳极裙边,GCT芯片的阴极与阴极钼片连接,阴极钼片与阴极铜座连接,阴极铜座上引出阴极裙边,GCT芯片的门极与门极引出环连接,门极引出环与门极引出法兰连接,门极引出法兰包括门极裙边,门极裙边上设置有凹形皱褶结构,凹形皱褶结构方向朝向阴极裙边,阳极裙边与阴极裙边之间设置有绝缘瓷环,门极引出法兰将绝缘瓷环分隔成上下两部分。本发明涉及的GCT元件封装结构,在减少寄生电感的同时,无需引入新材料新工艺,不受限于绝缘瓷环下部分的设计厚度。

    一种门极换流晶闸管芯片及晶闸管

    公开(公告)号:CN117219665A

    公开(公告)日:2023-12-12

    申请号:CN202311224427.5

    申请日:2023-09-21

    Abstract: 本发明属于半导体器件技术领域,具体涉及一种门极换流晶闸管芯片及晶闸管,阴极金属层、位于阴极金属层两侧的门极金属层、与所述阴极金属层相对的阳极金属层、以及形成于阴极金属层与阳极金属层之间的半导体衬底;半导体衬底包括五层区结构或六层区结构,且每结构区具有不同的导电类型,将P基区分区设计形成“凹”形主结,提升阴极梳条下方的P基区的结深及浓度,降低该部分对应等效的npn晶体管的电流增益α21,可实现同时降低通态损耗及关断损耗。本发明尤其适用逆阻型GCT,可降低片厚,实现较好的阻断、通态与关断之间的折中设计。

    功率半导体器件封装结构
    7.
    发明公开

    公开(公告)号:CN115763450A

    公开(公告)日:2023-03-07

    申请号:CN202211524368.9

    申请日:2022-11-30

    Abstract: 本发明提供功率半导体器件封装结构,包括从上至下依次布置的管盖、晶闸管芯片、二极管芯片、GCT芯片和管座,其中管盖与管座之间设置有管壁,晶闸管芯片、二极管芯片和GCT芯片两侧均设置有钼片,位于晶闸管芯片上侧的钼片上设置有第一铜排,位于二极管芯片上侧的钼片上设置有第二铜排,位于GCT芯片上侧的钼片上设置有第三铜排,第一铜排和第三铜排的其中一端从管壁的同一侧伸出,晶闸管芯片上设置有门极针,与门极针连接的门极线和第二铜排的其中一端从管壁的另一侧伸出。本发明将功率半导体器件封装结构,将晶闸管芯片、二极管芯片和GCT芯片组合封装在一起,极大程度上减小了整个模块的体积。

    一种功率半导体器件及其制作方法

    公开(公告)号:CN111933686B

    公开(公告)日:2022-06-24

    申请号:CN202010609729.4

    申请日:2020-06-29

    Abstract: 本发明提供了一种功率半导体器件及其制作方法,解决了标准型GCT芯片在过电压阻断状态时容易在芯片台面终端处失效,导致器件失效呈开路状态的问题。包括功能区和电压击穿区,电压击穿区靠近功率半导体器件的中心位置,被功能区环绕,包括依次层叠设置的第二导电类型短路结构和凸形第二导电类型基区,第二导电类型短路结构贯穿功能区的第一导电类型透明发射阳极和第二导电类型缓冲层;凸形第二导电类型基区贯穿第一导电类型第一基区、第一导电类型第二基区和第二导电类型区,在第二导电类型基区向第一导电类型基区的延伸方向上形成凸起部。

    功率半导体器件门极驱动检测电路及其控制方法

    公开(公告)号:CN112363040A

    公开(公告)日:2021-02-12

    申请号:CN202011187514.4

    申请日:2020-10-29

    Abstract: 本申请提供的一种功率半导体器件门极驱动检测电路及其控制方法,该电路包括门阴极电压检测单元,用于检测所述功率半导体器件的门极和阴极之间的电压差;高压检测单元,用于检测所述功率半导体器件的阳极和阴极之间的电压差;逻辑单元,用于在接收到所述外部控制系统发出的外部控制信号时输出第一控制信号,以及接收所述第一检测信号和所述第二检测信号并分别对所述第一检测信号和所述第二检测信号对应的电压差进行判断;触发单元,用于根据所述逻辑单元输出的控制信号生成触发信号,以控制所述功率半导体器件导通。检测电路组成元件简洁、可靠,不仅降低了驱动电路的复杂程度,还节约成本,可广泛应用于功率半导体型器件的驱动电路中。

    一种逆阻型门极换流晶闸管及其制造方法

    公开(公告)号:CN111834451A

    公开(公告)日:2020-10-27

    申请号:CN201910332896.6

    申请日:2019-04-23

    Abstract: 本发明公开了一种逆阻型门极换流晶闸管及其制造方法。晶闸管的层状结构竖直方向自下而上依次包括:P+阳极发射区、P阳极区、N-基区、P基区、P+基区、半埋于所述P+基区顶部的多个N+发射区;其中,在从正上方俯视晶闸管的方向上,多个N+发射区在以晶闸管的芯片中心为圆心的多个同心圆内沿圆弧均匀排布;P+阳极发射区包括P1+阳极发射区和水平方向环绕P1+阳极发射区的P2+阳极发射区,所述P2+阳极发射区位于所述P+阳极发射区的在远离门极引出端位置的N+发射区下方的区域以及所述P+阳极发射区的在所述晶闸管边缘终端位置的区域。

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