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公开(公告)号：CN119364760A
公开(公告)日：2025-01-24
申请号：CN202410998996.3
申请日：2024-07-24
Applicant: 三星电子株式会社
IPC: H10B12/00
Abstract: 一种半导体装置包括：下电路图案、位线屏蔽结构、第一绝缘中间层、位线结构、第一接触插塞、沟道和电容器。下电路图案在衬底上。位线屏蔽结构在下电路图案上。第一绝缘中间层在延伸穿过位线屏蔽结构的开口中。位线结构在位线屏蔽结构上，并且在基本上垂直于衬底的上表面的竖直方向上与位线屏蔽结构至少部分地重叠。第一接触插塞延伸穿过第一绝缘中间层以接触位线结构，并且电连接到下电路图案。沟道在位线结构上。电容器在沟道上并且电连接至沟道。
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公开(公告)号：CN109768014B
公开(公告)日：2023-10-17
申请号：CN201811324290.X
申请日：2018-11-08
Applicant: 三星电子株式会社
IPC: H10B12/00
Abstract: 提供了一种存储器件及其制造方法。所述存储器件包括：位于由衬底上的器件隔离层限定的有源区域上的单元晶体管，使得每个单元晶体管具有掩埋单元栅极和与所述衬底邻近并相对于所述掩埋单元栅极至少部分位于所述衬底远侧的结部分；所述衬底上的绝缘图案，覆盖所述单元晶体管和所述器件隔离层；以及位于所述绝缘图案上并连接到所述结部分的位线结构。所述位线结构包括：位于所述图案上并具有热氧化物图案的缓冲图案、位于所述缓冲图案上的导线以及从所述导线穿过所述缓冲图案和所述绝缘图案延伸到所述结部分的接触。
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公开(公告)号：CN109768014A
公开(公告)日：2019-05-17
申请号：CN201811324290.X
申请日：2018-11-08
Applicant: 三星电子株式会社
IPC: H01L21/8242 , H01L27/108
CPC classification number: H01L27/10823 , H01L21/76895 , H01L23/535 , H01L27/10814 , H01L27/10852 , H01L27/10876 , H01L27/10885 , H01L27/10888
Abstract: 提供了一种存储器件及其制造方法。所述存储器件包括：位于由衬底上的器件隔离层限定的有源区域上的单元晶体管，使得每个单元晶体管具有掩埋单元栅极和与所述衬底邻近并相对于所述掩埋单元栅极至少部分位于所述衬底远侧的结部分；所述衬底上的绝缘图案，覆盖所述单元晶体管和所述器件隔离层；以及位于所述绝缘图案上并连接到所述结部分的位线结构。所述位线结构包括：位于所述图案上并具有热氧化物图案的缓冲图案、位于所述缓冲图案上的导线以及从所述导线穿过所述缓冲图案和所述绝缘图案延伸到所述结部分的接触。
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公开(公告)号：CN120018493A
公开(公告)日：2025-05-16
申请号：CN202411602570.8
申请日：2024-11-11
Applicant: 三星电子株式会社
IPC: H10B12/00
Abstract: 本公开提供了一种半导体器件。所述半导体器件包括：顺序排列的第一连接区域、第一存储块区域和第二连接区域；第一外围电路区域，所述第一外围电路区域与所述第一存储块区域垂直地交叠；第一存储单元，其位于所述第一存储块区域中；第一字线，其穿越所述第一存储块区域延伸到所述第一连接区域和所述第二连接区域中，并且电连接到所述第一存储单元；第一子字线驱动器，其位于所述第一外围电路区域中；以及第一字线信号路径，其电连接所述第一字线和所述第一子字线驱动器。所述第一字线信号路径包括在所述第一连接区域中耦接到所述第一字线的至少一个第一布线接触和在所述第二连接区域中耦接到所述第一字线的至少一个第二布线接触。
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公开(公告)号：CN1190908C
公开(公告)日：2005-02-23
申请号：CN99801499.0
申请日：1999-08-30
Applicant: 三星电子株式会社
CPC classification number: H04B1/708 , H04B1/7093 , H04B2201/70702
Abstract: 一种异步CDMA通信系统，发送和接收在主同步信道上的第一正交Gold码(OGS)及在与主同步信道逐个字符同步的辅助同步信道上的第二OGC，包括发射机和接收机，发射机包括产生PN序列的PN序列识别设备，PN序列的多个第二OGC中有一个由空号代替，接收机包括：第一OGC探测器，探测第一OGC并获得第一符号能量；第一同步器，接收第一符号能量，使码片、符号和时隙同步，输出第一同步信号；第二OGC探测器，收到第一同步信号时探测第二OGC，获得识别组单元的基站中的第二符号能量；跳频图发生器，比较第一和第二符号能量，决定第二OGC中是否有空号及空号顺序，产生第二OGC跳频图；第二同步器，基于跳频图进行帧同步，输出第二同步信号；PN序列发生器，基于第一、第二信号及跳频图产生PN序列。
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Patent Agency Ranking
公开(公告)号：CN119855143A
公开(公告)日：2025-04-18
申请号：CN202410935171.7
申请日：2024-07-12
Applicant: 三星电子株式会社
IPC: H10B12/00
Abstract: 一种半导体存储器装置包括：导线，在第一方向上延伸；沟道区，在导线上方在第一方向上彼此间隔开并且各自电连接到导线；后栅电极，在第三方向上与导线间隔开并且在从沟道区选择的第一沟道区和第二沟道区之间在第二方向上延伸；一对字线，在第一方向上彼此间隔开并且在从沟道区选择的第二沟道区和第三沟道区之间；以及外延直接接触插塞，在沟道区与导线之间在第三方向上延伸并且各自包括接触沟道区中的一个的接触面、至少部分地被导线围绕的突出接触部分、以及在接触面与突出接触部分之间的垂直接触部分。
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公开(公告)号：CN119855139A
公开(公告)日：2025-04-18
申请号：CN202410600298.3
申请日：2024-05-15
Applicant: 三星电子株式会社
IPC: H10B12/00 , H01L23/528
Abstract: 提供了半导体存储器装置，所述半导体存储器装置包括：导电线，在第一方向上延伸；第一沟道区和第二沟道区，连接到导电线；接触插塞，在竖直方向上与导电线分开，且第一沟道区和第二沟道区置于接触插塞与导电线之间；背栅电极，在第一沟道区与第二沟道区之间沿着垂直于第一方向的第二方向延伸；以及背栅极介电膜，覆盖背栅电极的表面，其中，背栅极介电膜包括竖直延伸部和水平延伸部，竖直延伸部布置在背栅电极与第一沟道区和第二沟道区中的每个之间以覆盖背栅电极的侧壁，水平延伸部一体地连接到竖直延伸部并在选自面对导电线的第一位置和面对接触插塞的第二位置中的一个位置处覆盖背栅电极。
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公开(公告)号：CN1322416A
公开(公告)日：2001-11-14
申请号：CN00802091.4
申请日：2000-09-29
Applicant: 三星电子株式会社
IPC: H04B7/208
CPC classification number: H04L27/2662 , H04L5/0016 , H04L5/0048 , H04L27/2656 , H04L27/2657 , H04L27/2675
Abstract: 一种OFDM/CDMA通信系统中的定时误差补偿系统,包括:模/数转换器,用于通过预定的抽样同步将从发送器接收到的OFDM信号转换为数字OFDM码元流,所述OFDM信号由其中以预定数个数据码元的间隔插入了导频码元的数据码元流组成;保护间隔去除器,用于采用规定的帧同步去除插在OFDM码元中保护间隔;以及快速傅里叶变换(FFT)设备,用于对去除了保护间隔的OFDM码元执行快速傅里叶变换并输出数据码元流;在定时误差补偿系统中,导频码元检测器接收数据码元流,并检测以预定间隔插在数据码元流中的导频码元。定时补偿器确定检测到的导频码元的线性相位差线,按照确定的线性相位差线生成定时误差估计信号,并将定时误差估计信号提供给模/数转换器以及保护间隔去除器,以确定抽样同步和帧同步。
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公开(公告)号：CN1307754A
公开(公告)日：2001-08-08
申请号：CN99801499.0
申请日：1999-08-30
Applicant: 三星电子株式会社
CPC classification number: H04B1/708 , H04B1/7093 , H04B2201/70702
Abstract: 一种在异步CDMA通信系统的接收机中的PN序列识别设备。接收机在主同步信道上接收第一OGC,在辅助同步信道上接收第二OGC,主同步信道和辅助同步信道逐个符号进行同步。在PN序列识别设备中,第一OGC探测器探测第一OGC,并获得第一符号能量。第一同步器接收第一符号能量,使码片、符号和时隙同步,并输出第一同步信号。第二OGC探测器在接收第一同步信号时,每当收到第一同步信号就探测第二OGC,并获得识别组单元的基站中的第二符号能量。跳频图发生器比较第一符号能量和第二符号能量,确定在第二OGC中是否有空号,如果有空号则决定空号顺序,并产生第二OGC的跳频图。第二同步器基于跳频图使帧同步,并输出第二同步信号。PN序列发生器接收第一和第二信号及跳频图,并产生PN序列。
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公开(公告)号：CN1277757A
公开(公告)日：2000-12-20
申请号：CN99801510.5
申请日：1999-09-02
Applicant: 三星电子株式会社
Inventor： 李贤奎
IPC: H03L7/00
CPC classification number: H04M3/00 , H03J7/02 , H03J2200/02 , H04L2027/0065 , H04L2027/0071 , H04W88/06
Abstract: 一种双模式终端中的控制接收频率的AFC(自动频率控制)设备和方法。当一个双模式终端采用一个或两个AFC电路时,使用测试增加频率可减少一个频率的PLL电路中获得跟踪同步所需的时间,该测试增加频率是另一频率的PLL电路的跟踪同步获取残余频率的整数倍,为了获得可靠同步第一频率转换到另一频率。由于采用两个AFC引起的有关输出动态范围的误差减少了,因此接收器的解调性能通过改变一个A/D时钟的量化比特而得到保证,该时钟基于频率区间内的残余误差的动态范围。为了得到具有许多残余频率误差的AFC电路,解调性能也可以通过运行ACPE电路得到保证。用这种方法,双模式终端的频率特性得到稳定化并且解调器的稳定性由于频率补偿而提高。结果,稳定的解调器性能就可确保。
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