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公开(公告)号：CN111416628A
公开(公告)日：2020-07-14
申请号：CN202010275449.4
申请日：2020-04-09
Applicant: 重庆邮电大学
IPC: H03M13/15
Abstract: 本发明涉及一种基于随机表征的BCH软判决信道码译码装置，属于信道编码领域，包括：随机测试图样生成模块用于生成随机测试图样；硬判决译码核心模块用于对随机测试图样向量进行尝试译码；误码纠正模块进行误码纠正，生成候选码字，并仅将包含循环冗余校验位的信息比特部分传递给提前跳出判决模块；提前跳出判决模块进行循环冗余校验，并将校验结果反馈回随机测试图样生成模块：若循环冗余校验不通过，则继续生成随机测试图样；若循环冗余校验通过，即表示当前分组译码成功，停止生成当前分组的随机测试图样，进入下一个分组。本发明显著提升了译码性能，有效降低了硬件实现的复杂度开销。
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公开(公告)号：CN115276864B
公开(公告)日：2024-06-04
申请号：CN202210621336.4
申请日：2022-06-01
Applicant: 重庆邮电大学
Abstract: 本发明涉及一种基于LoRa技术的DMB终端状态信息接收系统，属于无线信号技术领域。针对DMB广播系统只能单向完成数据信息的传输，无法反馈运行错误或播报信息错误的问题，提出一种基于LoRa的数字多媒体广播(Digital Multimedia Broadcasting)状态检测系统和一种基于轮询的LoRa自组网方式。其中，在节点终端和网关设备增加了LoRa射频模块，可以将DMB终端运行的信息传输至中控端，实现终端在无法正常工作时能及时反馈到后台，为DMB应用提供技术支持。
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公开(公告)号：CN117914324A
公开(公告)日：2024-04-19
申请号：CN202311591340.1
申请日：2023-11-27
Applicant: 重庆邮电大学
IPC: H03M3/00
Abstract: 本发明请求保护一种用于delta‑sigma调制器的离散型低功耗积分器，属于集成电路领域，包括第一反馈模块、第二反馈模块、积分放大器模块、信号输入模块，所述的积分器模块包含第一运放和第二运放，其输入端，分别与信号输入和第一、第二反馈模块相连。其第一、第二运放的输出也分别连接到积分器输出。后级量化器产生的结果对所述的第一反馈模块、第二反馈模块进行控制，其时钟输入CLK1,CLK2,CLK1S,CLK2S对信号输入模块和积分器模块进行控制。delta‑sigma ADC第一级积分器最为重要，其中运放要求最高，功耗最大。利用本发明的积分器可使整个调制器的功耗极大降低。
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公开(公告)号：CN117749181A
公开(公告)日：2024-03-22
申请号：CN202311792325.3
申请日：2023-12-25
Applicant: 重庆邮电大学
IPC: H03M1/10
Abstract: 本发明请求保护一种基于皮尔逊相关系数的时钟偏差数字校准系统及方法，应用于时域交织型模数转换器之中。引入皮尔逊相关系数，通过将两个通道的数字输出码提取出来作为样本，然后计算皮尔逊相关系数中的对应变量对其进行进一步处理可以得到由于时钟偏差的存在导致相关性系数变量的差值，通过这个差值可以求得其通道间时钟偏差的大小。然后，利用电压与微分的关系，将由于时钟偏差产生的误差电压去除，以达到消除时钟偏差对于ADC的动态性能的影响。该校准方法无需额外参考通道，对于输入信号无特定要求，一个校准周期就能将多个通道同时校准完成，控制逻辑简单，可以达到以较小的代价快速校准时钟偏差的目的。
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公开(公告)号：CN117423739A
公开(公告)日：2024-01-19
申请号：CN202311397316.4
申请日：2023-10-25
Applicant: 重庆邮电大学
IPC: H01L29/739 , H01L29/06 , H01L27/07
Abstract: 本发明涉及一种具有载流子存储层结构快速关断的分裂栅LIGBT器件，属于半导体功率器件领域。该LIGBT器件通过增加载流子存储结构使得大量空穴在阴极侧区域积累，从而降低器件的正向导通压降并降低器件的关断损耗，同时通过在器件中增加P型埋层以优化器件的体内电场分布，有效提升了器件的耐压特性。此外，器件中的dummy‑gate与阴极侧凸形P+、P型埋层形成PMOS结构，在关断时快速抽取体内空穴，进一步减少了器件在关断过程的关断时间与关断损耗。
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Patent Agency Ranking
公开(公告)号：CN117335798A
公开(公告)日：2024-01-02
申请号：CN202311172914.1
申请日：2023-09-12
Applicant: 重庆邮电大学
Abstract: 本发明请求保护一种基于反双曲正弦函数的流水线ADC变步长LMS校准系统，包括待校准的高速Pipeline ADC模块，低速系统时钟模块，低速高精度Sigma‑Delta ADC，可变步长的自适应滤波器，数字降频器和减法器。在传统LMS算法的基础上，引入反双曲正弦函数arcsinh x，改进的步长因子更新方式,根据误差的平方和输入信号的平方差异来更新步长因子E(n)。据此，建立步长与输入信号以及误差的数学模型为μ(n)＝ρ·arcsinh(β·E(n))，根据误差信号大小实时更新步长，在每次更新滤波器权值时，都会保存最小误差和对应的滤波器权值和输出结果。这样可以在算法运行结束后，得到最优的滤波器权值和相应的输出结果。该算法具有校准精度高，收敛速度快等优点。
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公开(公告)号：CN114448524B
公开(公告)日：2023-11-03
申请号：CN202111461226.8
申请日：2021-12-01
Applicant: 重庆邮电大学 , 中移物联网有限公司 , 重庆两江半导体研究院有限公司 , 重庆赛宝工业技术研究院有限公司
Abstract: 本发明涉及一种基于异构组合混沌映射的无线人体局域网加密方法，属于无线人体局域网加密领域，包括以下步骤：S1：计算心电信息参数心电信号R波幅度Ramp和QS波时间宽度TQS；S2：计算近体信道特性幅度A和相位P；S3：读取原始图像I(i,j)，形成原始数据矩阵T；S4：根据所述心电信息参数Ramp和TQS设置Logistics映射参数x0和μ，根据所述近体信道特性幅度A和相位P设置Kent映射参数y0和a；S5：根据一维混沌序列构造子混沌矩阵Sl和Sk；S6：结合子混沌矩阵Sl和Sk生成混沌加密矩阵Ec；S7：在原始数据矩阵T和混沌加密矩阵Ec中执行XOR运算，生成最终的加密信息E。
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公开(公告)号：CN116961598A
公开(公告)日：2023-10-27
申请号：CN202310969598.4
申请日：2023-08-02
Applicant: 重庆邮电大学
Abstract: 本发明涉及一种基于多模混合的带宽可重构的宽带高效率功率放大器，属于微波电路设计领域，包括输入匹配及稳定性模块、输入偏置模块、GaN晶体管、输出可重构匹配电路模块以及输出偏置模块；总输入端与输入匹配及稳定性模块连接；所述输入匹配及稳定性模块与输入偏置模块并联接入GaN功放晶体管的栅极端；所述GaN功放晶体管输出端与可重构输出匹配电路模块串联；所述可重构输出匹配电路模块与输出偏置模块并联接到输出端；所述输出可重构匹配电路模块基于模式组合理论，对GaN功放晶体管的输出端进行谐波控制及阻抗变换，从而实现电阻电抗性连续类F‑J‑逆F三种模式的功率放大器。
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公开(公告)号：CN116800269A
公开(公告)日：2023-09-22
申请号：CN202310724002.4
申请日：2023-06-16
Applicant: 重庆邮电大学
Abstract: 本发明请求保护一种用于环路展开型SAR ADC的比较器复用结构，属于模拟集成电路设计技术领域。与传统的SAR架构只使用一个比较器来进行N位转换不同，环路展开架构使用N个比较器进行N位转换。这里提出了一种基于环路展开型的新结构，每一级比较器产生的比较结果触发下一级量化，最后一级比较器量化完成后，比较结果又触发第一级比较器再进行量化，同一级比较器量化两次，直到复位信号到来。每一位比较结果存储在对应的寄存器中并直接反馈到该位DAC电容阵列。通过将比较器进行复用，减少了一半比较器的数量，进一步减少了多个比较器所带来的不同失调电压造成的非线性影响，并缩减了电路面积和功耗，减少电路的非线性度。
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公开(公告)号：CN116743176A
公开(公告)日：2023-09-12
申请号：CN202310746093.1
申请日：2023-06-21
Applicant: 重庆邮电大学
Abstract: 本发明请求保护一种用于SAR型ADC的辅助解码DAC结构，包括采样电路模块、第一级DAC电容阵列、第二级DAC电容阵列、比较器阵列模块、就绪时钟信号模块、数字逻辑控制模块、异步时钟模块以及寄存器模块。第一级DAC电容阵列通过环路展开结构先对输入模拟信号解码，具有复用结构的比较器产生比较结果寄存在寄存器中，并作用在第二级DAC电容阵列上。第二级DAC电容阵列采用桥接电容结构，其MSB段电容经第一级DAC电容阵列量化，进行电容开关切换。独立比较器开始LSB段的量化，两个DAC电容阵列生成的输出码存储在寄存器中，最终并行输出结果，完成整体转换。与传统的Pipeline‑SAR架构相比，降低了运放的设计难度，具有逻辑简单的特点。与传统环路展开SAR结构相比，具有精度高和功耗低的特点。
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