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公开(公告)号：CN108233921A
公开(公告)日：2018-06-29
申请号：CN201711146256.3
申请日：2017-11-17
Applicant: 台湾积体电路制造股份有限公司
Abstract: 一种锁相环(Phase‑Locked‑Loop，PLL)电路包括：参考锁相环电路，被配置成产生参考时钟信号；单一时钟树电路，耦合到所述参考锁相环电路，且被配置成分配所述参考时钟信号；以及多个指定锁相环电路，耦合到所述时钟树电路，其中所述指定锁相环电路分别被配置成经由所述单一时钟树电路接收所分配的所述参考时钟信号并基于所述参考时钟信号来提供各自的时钟信号。
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公开(公告)号：CN106053972A
公开(公告)日：2016-10-26
申请号：CN201510565931.0
申请日：2015-09-08
Applicant: 台湾积体电路制造股份有限公司
IPC: G01R29/26
Abstract: 本发明提供一种闪烁噪声测量电路，包括第一部分。第一部分包括串联连接的多个第一级。第一部分包括：第一反馈开关元件，被配置为将多个第一级的输出选择性地反馈至多个第一级的输入端。第一部分包括第一部分连接开关元件。闪烁噪声测量电路包括连接至第一部分的第二部分。第二部分包括串联连接的多个第二级，其中第一部分连接开关元件被配置为将多个第二级选择性地连接至多个第一级。第二部分包括：第二反馈开关元件，被配置为将多个第二级的输出选择性地反馈至多个第一级的输入端。本发明还提供了一种确定闪烁噪声的方法。
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公开(公告)号：CN102237026A
公开(公告)日：2011-11-09
申请号：CN201010280592.9
申请日：2010-09-10
Applicant: 台湾积体电路制造股份有限公司
IPC: G09G3/00 , G09G3/36 , G01R31/3187
CPC classification number: G09G3/3685 , G09G3/006 , G09G2310/027 , G09G2310/0291 , G09G2330/12
Abstract: 本发明涉及一种液晶显示器(LCD)来源驱动器的内建自测试(built-inself-test，BIST)电路及方法，所述电路包括：至少一数字模拟转换器(DAC)；和至少一缓冲器，其耦接到个别DAC，其中该缓冲器可重新配置为一比较器。一第一输入信号和一第二输入信号耦接到该比较器。该第一输入信号是一预定参考电压水平。第二输入信号是在一测试偏移范围内的一测试电压。
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公开(公告)号：CN117394842A
公开(公告)日：2024-01-12
申请号：CN202310931659.8
申请日：2023-07-27
Applicant: 台湾积体电路制造股份有限公司
IPC: H03K19/003 , G06F7/535
Abstract: 用于决定周期性输入信号的工作循环的系统、方法及电路。延迟元件基于数字控制字元来延迟周期性输入信号。数字电路用以:产生用于使周期性输入信号延迟第一时间量的第一数字控制字元，此第一时间量对应于周期性输入信号的周期；产生用于使周期性输入信号延迟第二时间量的第二数字控制字元，此第二时间量对应于周期性输入信号具有逻辑位准高值的一部分；以及产生用于使周期性输入信号延迟第三时间量的第三数字控制字元，此第三时间量对应于周期性输入信号具有逻辑位准低值的一部分。控制器基于第一、第二及第三数字控制字元来决定工作循环。
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公开(公告)号：CN110943736B
公开(公告)日：2023-12-01
申请号：CN201910887656.2
申请日：2019-09-19
Applicant: 台湾积体电路制造股份有限公司
Abstract: 本发明公开一种相位偏差产生器。在一些实施例中，相位偏差产生器包括：电荷泵，具有第一运行模式及第二运行模式，其中第一运行模式在第一时间周期期间提供第一电流路径，且第二运行模式在第一时间周期之后的第二时间周期期间提供第二电流路径；采样及保持电路，耦合到电容器，且被配置以在预定时间对电容器的电压电平进行采样且在第二时间周期之后的第三时间周期期间提供输出电压；以及压控延迟线，耦合到采样及保持电路，且具有M个延迟线级，所述M个延迟线级各自被配置以输出相对于前一或后一信号具有相位偏差偏移量的信号。
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Patent Agency Ranking
公开(公告)号：CN109428593B
公开(公告)日：2022-09-13
申请号：CN201810395009.5
申请日：2018-04-27
Applicant: 台湾积体电路制造股份有限公司
Abstract: 一种重新对准回路的电路、锁相电路、重新对准强度调整方法。具有追踪回路与重新对准回路的电路包含：相位频率侦测器模块、泵浦模块、可调重新对准模块与环式振荡器单元。相位频率侦测器模块用以比较第一输入信号与第二输入信号的相位差。泵浦模块用以将相位差转换为电荷，泵浦模块还包含低通滤波器。可调重新对准模块用以调整重新对准强度，可调重新对准模块从相位频率侦测器模块接收多个第一输入，可调重新对准模块传送多个第二输出至泵浦模块。环式振荡器单元从泵浦模块接收第一输入且从可调重新对准模块接收第二输入，且基于第一输入与第二输入来产生回授信号。
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公开(公告)号：CN114649330A
公开(公告)日：2022-06-21
申请号：CN202210191057.9
申请日：2022-02-25
Applicant: 台湾积体电路制造股份有限公司
IPC: H01L27/088 , H01L27/02 , H01L21/8238
Abstract: 半导体结构包括第一finfet单元和第二finfet单元。第一finfet单元的每个具有根据模拟电路设计规则的模拟鳍边界，并且第二finfet单元的每个具有根据数字电路设计规则的数字鳍边界。半导体结构还包括形成有第一finfet单元的第一电路、形成有第二finfet单元的第二电路以及形成有第一finfet单元中的一个或多个和第二finfet单元中的一个或多个的第三电路。本申请的实施例还涉及制造半导体结构的方法。
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公开(公告)号：CN113571514A
公开(公告)日：2021-10-29
申请号：CN202110467367.4
申请日：2021-04-28
Applicant: 台湾积体电路制造股份有限公司
Abstract: 一种IC结构包括电阻器电路和晶体管。电阻器电路包括：第一金属电阻器带，位于半导体衬底上方；以及第一金属线和第二金属线，在第一金属电阻器带上方的同一层级高度上延伸。第一金属电阻器带是伪栅极。第一金属线和第二金属线两者与第一金属电阻器带重叠并且电连接到第一金属电阻器带。晶体管包括金属栅极带，其与第一金属带处于相同层级高度，并与第一金属电阻器带平行地延伸。本申请的实施例提供了集成电路结构及其形成方法。
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公开(公告)号：CN113380703A
公开(公告)日：2021-09-10
申请号：CN202110592173.7
申请日：2021-05-28
Applicant: 台湾积体电路制造股份有限公司
IPC: H01L21/822 , H01L27/06
Abstract: 制造基于双架构兼容设计的半导体器件的方法包括：在晶体管(TR)层中形成晶体管组件；并执行制造附加组件的以下操作中的一种(A)埋入式电源轨(BPR)类型的架构，(B)非埋入式电源轨(非BPR)类型的架构。步骤(A)包括，在相应的sub‑TR层中形成各个非伪sub‑TR结构，以及在相应的supra‑TR层中形成各个伪supra‑TR结构，该伪结构是相应的第一伪像。步骤(B)包括，在相应的supra‑TR层中形成各个非伪supra‑TR结构，并形成各个伪supra‑TR结构，该伪结构是相应的第二伪像，第一和第二伪像由双架构兼容涉及产生，适合于适应BPR类型的架构。本申请的实施例还涉及半导体器件。
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公开(公告)号：CN113258927A
公开(公告)日：2021-08-13
申请号：CN202010460853.9
申请日：2020-05-27
Applicant: 台湾积体电路制造股份有限公司
Abstract: 本发明公开一种用于环路增益的自动检测及校准的装置。所述装置包括相位检测器、电荷泵电路、采样及保持电路、比较器及控制器。所述相位检测器检测参考信号与输入信号之间的时钟偏移。所述电荷泵电路将所述时钟偏移转变成电压。采样及保持电路在第一时间对所述电压进行采样，并保持所采样的所述电压直到第二时间。所述比较器(i)在所述第二时间基于所采样的所述电压及所述电压检测与所述输入信号相关联的环路增益并(ii)输出用于调整所述输入信号的环路增益信号。所述控制器耦合到相位检测器、比较器及采样及保持电路。所述控制器产生多个控制信号，用于自动控制相位检测器、比较器及采样及保持电路的操作。
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