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公开(公告)号：CN117112318A
公开(公告)日：2023-11-24
申请号：CN202311092830.7
申请日：2023-08-28
Applicant: 西安电子科技大学芜湖研究院
Abstract: 本发明公开了一种基于RISC‑V架构的双核容错系统，包括：第一处理器核、第二处理器核、指令紧耦合存储器、数据紧耦合存储器、多个总线矩阵模块、中断控制器、外部设备和总线，以及多个错误检查和纠正模块；第一处理器核和第二处理器核均与相同的总线矩阵模块连接，至少一个总线矩阵模块与指令紧耦合存储器连接，至少一个总线矩阵模块与数据紧耦合存储器连接，至少一个总线矩阵模块与总线连接，至少一个总线矩阵模块与中断控制器连接，中断控制器和外部设备均与总线连接，指令紧耦合存储器和数据紧耦合存储器均对应设置一个错误检查和纠正模块。本发明能够降低故障检测时间和故障恢复时间。
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公开(公告)号：CN116700788A
公开(公告)日：2023-09-05
申请号：CN202310035549.3
申请日：2023-01-10
Applicant: 西安电子科技大学芜湖研究院
Abstract: 本发明公开了一种基于RISC‑V的图像数据处理方法及系统，其中的方法包括如下步骤：生成RISC‑V处理器核；定义DMA控制模块中的reqreg请求配置寄存器以及comreg状态寄存器的地址；当读取到reqreg请求配置寄存器内具有写数据请求时，DMA写模块将待处理图像数据写入内存；当读取到comreg状态寄存器内具有传输结束指令时，待处理图像数据写入结束；自内存中读取待处理图像数据并进行处理。本发明中的方法，基于RISC‑V完成了图像数据处理，且数据传输及处理效率较高。
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公开(公告)号：CN115297341A
公开(公告)日：2022-11-04
申请号：CN202210844942.2
申请日：2022-07-18
Applicant: 西安电子科技大学芜湖研究院
IPC: H04N21/234 , H04N21/4402 , H04L1/00
Abstract: 本发明公开了一种视频数据传输方法、装置、电子设备及可读存储介质，其中，视频数据传输方法，包括如下步骤：获取第一待传输数据的数据类型；当第一待传输数据为视频像素数据或者视频控制数据时，将第一待传输数据转换为第一模式数据，并采用第一传输模式传输；当第一待传输数据为控制命令时，将第一待传输数据转换为第二模式数据，并采用第二传输模式传输；第一模式数据的位数大于第二模式数据的位数，第一传输模式使用的数据通道多于第二传输模式使用的数据通道。通过执行本发明中的方法，能够防止视频数据在后续传输过程中出现编码/校验的复杂性较高，数据传输的准确性较低的问题。
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公开(公告)号：CN114487565A
公开(公告)日：2022-05-13
申请号：CN202111673954.5
申请日：2021-12-31
Applicant: 西安电子科技大学芜湖研究院
Abstract: 本发明公开了一种峰值电压检测电路及峰值电压检测方法，其中的电路包括：NMOS管M1、NMOS管M2、NMOS管M6、PMOS管M3、PMOS管M4、PMOS管M7和PMOS管M8、尾电流源I1、下拉电流源I2和采样保持电容Ch，其中，所述NMOS管M1、NMOS管M2构成差分输入管，所述PMOS管M3的栅极与所述PMOS管M4的栅极相连接，所述PMOS管M7的栅极和所述PMOS管M8的栅极相连接；所述PMOS管M3的漏极与所述PMOS管M4的源极之间还连接有开关S5。本发明中的电路，能够实现线性放大的回波脉冲峰值电压采集并保持一定时间，用于灰度测量，从而可降低对ADC速度的要求；且能够减小电路失调导致的测量误差，实现精确测量。
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公开(公告)号：CN120070959A
公开(公告)日：2025-05-30
申请号：CN202510071361.3
申请日：2025-01-16
Applicant: 西安电子科技大学芜湖研究院 , 西安电子科技大学
IPC: G06V10/764 , G06V10/82 , G06V10/94 , G06N3/0464 , G06N3/082
Abstract: 本发明公开了一种点云图像分类的轻量化和硬件加速方法，包括：去除用于点云图像分类的PointNet网络中的T‑Net网络后进行训练，再进行全整数量化和层融合处理，将得到的网络部署在边缘设备上；本发明利用PointNet剪裁、全整数量化、层融合处理，减小了参数量和计算量，设计了边缘设备的缓存结构实现硬件缓存计算，并设计了乘加器阵列的维度以实现并行化计算点卷积，减少了硬件逻辑设计和缓存容量；本发明对PointNet网络的轻量化处理涵盖了模型压缩、参数精简及计算优化等多个方面，能大幅削减模型所需计算量与存储容量，提升处理速度，降低功耗，可在资源受限硬件平台上准确、快速实现点云图像分类。
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Patent Agency Ranking
公开(公告)号：CN114995092B
公开(公告)日：2024-02-23
申请号：CN202210681993.8
申请日：2022-06-15
Applicant: 西安电子科技大学芜湖研究院
IPC: G04F10/00
Abstract: 本发明公开了一种时间数字转换电路，包括：计数器单元，用于对定时信号进行脉冲计数，并输出定时信号之间的残差信息和第一计数器值；第一时间测量单元，包括第一延迟锁相环电路、同步电路和异步电路，同步电路用于基于第一延迟锁相环电路输出的相位信号对残差信息进行信号重定时，并输出同步信号和第二计数器值；异步电路用于将残差信息经一延迟链直接输出，得到异步信号；第二时间测量单元，用于对同步信号和异步信号进行插值定时，并输出同步信号和异步信号之间的第三计数器值；译码器，用于基于第一计数器值、第二计数器值和第三计数器值得到定时信号之间的时间差。本发明中的电路，能够能够得到更高分辨率的测时数据。
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公开(公告)号：CN117081527A
公开(公告)日：2023-11-17
申请号：CN202311225408.4
申请日：2023-09-21
Applicant: 西安电子科技大学芜湖研究院
Abstract: 本发明公开了一种高增益运算放大器及流水线模数转换器，其中高增益运算放大器包括：主运算放大模块，包括第一差分输入级、第二差分输入级、第一尾电流源、第二尾电流源、第一开关管、第二开关管、第一电流镜和第二电流镜，第一尾电流源和第二尾电流源的输出端分别与第一差分输入级和第二差分输入级相连接，第一尾电流源的输出端依次经第一开关管和第一电流镜后与第二尾电流源的输出端相连接，第二尾电流源的输出端依次经第二开关管和第二电流镜后与第一尾电流源的输出端相连接；第一辅助运算放大模块，与第一差分输入级的输出端相连接；第二辅助运算放大模块，与第二差分输入级的输出端相连接。本发明中的放大器，具有加高的增益和带宽。
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公开(公告)号：CN117075847A
公开(公告)日：2023-11-17
申请号：CN202310797925.2
申请日：2023-06-29
Applicant: 西安电子科技大学芜湖研究院
Abstract: 本发明公开了一种三角函数协处理器，包括：译码接口单元，其内具有自定义三角函数指令，用于在接收到主处理器传递的运算请求时，执行对应的三角函数指令，译码获取输入角度，还用于将协处理器的运算结果反馈至主处理器；角度压缩单元，用于将三角函数指令中的角度压缩映射至[0，π/4]区间内；角度编码单元，用于对映射后的角度进行二进制编码，再进行角度二极化重编码，得到旋转方向、旋转角度和模长校正因子；旋转迭代单元，用于进行旋转迭代，得到[0，π/4]区间范围内的运算结果；结果重映射单元，用于将[0，π/4]区间范围内的运算结果重映射至[0，2π]区间，并重映射后的运算结果发送至译码接口单元。本发明中的协处理器，运算效率高，资源消耗少。
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公开(公告)号：CN117036167A
公开(公告)日：2023-11-10
申请号：CN202310989767.0
申请日：2023-08-04
Applicant: 西安电子科技大学芜湖研究院
Abstract: 本发明公开了一种基于Cortex‑M3的结构光照明显微图像重建系统，包括：图像获取模块，用于根据上位机的命令从CXP相机处获取采集的图像数据，并将图像数据缓存至挂载在图像获取模块上的DDR中，通过DMA读取DDR中存储的图像数据并发送至数据生成模块；数据生成模块，用于根据每张图像的图像数据、n个预设方向参数和m个预设相位参数，生成n*m张不同方向且不同相位的图像的图像数据，并将n*m张图像的图像数据对应发送至p个图像数据处理模块；每个图像数据处理模块，用于对属于同一方向的q张图像的图像数据进行并行处理，得到q张图像对应的q种频率分量，并将q种频率分量发送至图像重建模块；图像重建模块，用于对n*m种频率分量进行频谱叠加得到一张重建图像。
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公开(公告)号：CN116248432A
公开(公告)日：2023-06-09
申请号：CN202310120598.7
申请日：2023-02-03
Applicant: 西安电子科技大学芜湖研究院
Abstract: 本发明公开了一种振铃抑制电路，包括：峰值检测电路，与控制总线相连接，用于检测并输出总线信号隐性区间的峰值电压；开关控制电路，其两个输入端中的一个与峰值检测电路的输出端相连接，另一个接入基准电压；开关控制电路用于在峰值电压高于基准电压时输出第一电平的开关控制信号；振铃抑制管，其栅极与开关控制电路相连接，且其导通电阻与传输总线信号的电缆的特性电阻相匹配；当开关控制电路输出第一电平的开关控制信号时，振铃抑制管导通，抑制振铃。本发明中的电路，对于振铃状态的响应较快，抑制效果较好。
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