公开(公告)号：CN101071815A

公开(公告)日：2007-11-14

申请号：CN200710102223.9

申请日：2007-04-27

Applicant: 株式会社瑞萨科技

Inventor： 石井泰之 ,  桥本孝司 ,  川岛祥之 ,  鸟羽功一 ,  町田悟 ,  片山弘造 ,  齐藤健太郎 ,  松井俊一

IPC: H01L27/115 ,  H01L29/423 ,  H01L21/8247 ,  H01L21/336 ,  H01L21/28

CPC classification number: H01L27/115 ,  H01L21/823462 ,  H01L27/0629 ,  H01L27/0922 ,  H01L27/105 ,  H01L27/11526 ,  H01L27/11546 ,  H01L27/11568 ,  H01L29/6653

Abstract: 一种半导体器件，其包括具有控制栅极和存储栅极的分离栅极型存储单元、低耐压MISFET和高耐压MISFET，其中可以抑制存储单元的阈值电压的变化。控制栅极的栅极绝缘膜比高耐压MISFET的栅极绝缘膜薄，控制栅极比低耐压MISFET的栅电极14厚，且存储栅极的厚度与存储栅极的栅长度的比大于1。控制栅极和栅电极15形成为包括电极材料膜8A和电极材料层8B的多层结构，且栅电极14为与控制栅极的电极材料膜8A同时形成的单层结构。

公开(公告)号：CN1716572A

公开(公告)日：2006-01-04

申请号：CN200510077445.0

申请日：2005-06-21

Applicant: 株式会社瑞萨科技

Inventor： 坂井健志 ,  石井泰之 ,  冈崎勉 ,  中道胜 ,  松井俊一 ,  新田恭也 ,  町田悟 ,  中川宗克 ,  塚田祐一

IPC: H01L21/8239 ,  H01L21/336 ,  H01L27/105 ,  H01L29/788

CPC classification number: H01L27/11568 ,  H01L21/823842 ,  H01L21/82385 ,  H01L21/823857 ,  H01L21/823864 ,  H01L27/105 ,  H01L27/1052 ,  H01L27/11573

Abstract: 本发明能够增强具有MONOS型晶体管的非易失性半导体存储器件的高性能。具有改进性能的该具有MONOS型晶体管的非易失性半导体存储器件，其中，MONOS型非易失性存储器的存储单元包括控制晶体管和存储晶体管，控制晶体管的控制栅包括n型多晶硅膜并且该控制栅形成在包括氧化硅膜的栅绝缘膜上方，存储晶体管的存储栅包括n型多晶硅膜并且该存储栅布置到控制栅的侧壁之一，该存储栅包括掺杂的多晶硅膜，其薄层电阻比控制栅的薄层电阻低，该控制栅包括通过将杂质离子植入到未掺杂硅膜中而形成的多晶硅膜。

公开(公告)号：CN1755934A

公开(公告)日：2006-04-05

申请号：CN200510082800.3

申请日：2005-07-07

Applicant: 株式会社瑞萨科技

Inventor： 伊藤文俊 ,  川岛祥之 ,  坂井健志 ,  石井泰之 ,  金丸恭弘 ,  桥本孝司 ,  水野真 ,  奥山幸祐 ,  真边由起子

IPC: H01L27/115 ,  G11C16/02

CPC classification number: H01L27/11568 ,  G11C16/0466 ,  H01L21/28282 ,  H01L27/115 ,  H01L29/42344 ,  H01L29/66833 ,  H01L29/792

Abstract: 提高了具有非易失性存储单元的半导体器件的集成度和重写次数。第一MONOS型非易失性存储元件和第二MONOS型非易失性存储元件一起安装在同一衬底上，其中第二MONOS型非易失性存储元件具有比第一MONOS型非易失性存储元件更大的栅极宽度，并且第一MONOS型非易失性存储元件用于存储几乎不重写的程序数据，以及第二MONOS型非易失性存储元件用于存储频繁重写的处理数据。

公开(公告)号：CN101673746A

公开(公告)日：2010-03-17

申请号：CN200910160027.6

申请日：2009-07-17

Applicant: 株式会社瑞萨科技

Inventor： 本间琢朗 ,  石井泰之 ,  舟山幸太

IPC: H01L27/115 ,  H01L21/8247 ,  H01L21/28

CPC classification number: H01L27/11573 ,  H01L27/11 ,  H01L27/1104

Abstract: 本发明是关於半导体装及其制造方法，本发明对于具有分裂栅结构的MONOS型非易失性存储单元的半导体装置能够不降低可靠度而实现高集成化。将存储用nMIS的存储栅电极MG的高度形成为相比选择用nMIS的选择栅电极CG的高度而高出20～100nm，由此使得形成在存储栅电极MG的单侧面(源极区域Srm侧的侧面)上的侧壁SW1的宽度，成为用以获得所期望的存储单元MC1的干扰特性所必要的大小。并且，让周边用第2nMIS(Q2)的栅电极G2的高度为选择用nMIS的选择栅电极CG的高度以下，由此使得形成在栅电极G2的侧面上的侧壁SW3的宽度较小，而可防止共用接触孔C2的内部因侧壁SW3而被埋入。

公开(公告)号：CN101051641A

公开(公告)日：2007-10-10

申请号：CN200710092267.8

申请日：2007-04-03

Applicant: 株式会社瑞萨科技

Inventor： 鸟羽功一 ,  石井泰之 ,  川岛祥之 ,  町田悟 ,  中川宗克 ,  齐藤健太郎 ,  松井俊一 ,  桥本孝司 ,  奥山幸祐

IPC: H01L27/115 ,  H01L29/78 ,  H01L29/40 ,  H01L29/423 ,  H01L29/49 ,  H01L21/8247 ,  H01L21/336 ,  H01L21/28

CPC classification number: H01L29/42324 ,  H01L21/28273 ,  H01L21/28282 ,  H01L27/115 ,  H01L27/11526 ,  H01L27/11531 ,  H01L29/66825 ,  H01L29/66833 ,  H01L29/7885

Abstract: 公开一种具有非易失存储器的半导体器件，其干扰缺陷能得到减少或防止。非易失存储器的存储单元具有存储栅电极，该存储栅电极通过用于电荷存储的绝缘膜而在半导体衬底的主表面上方形成。在存储栅电极的侧面上形成第一侧壁，并且在第一侧壁的侧面处形成第二侧壁。在存储单元中源极的n+型半导体区域的上表面上形成硅化层，其在存储栅电极MG侧上的端部分由第二侧壁限定。

公开(公告)号：CN101043037A

公开(公告)日：2007-09-26

申请号：CN200710006940.1

申请日：2007-01-31

Applicant: 株式会社瑞萨科技

Inventor： 町田悟 ,  石井泰之 ,  工藤敏生 ,  高桥雅人 ,  铃木征洋

IPC: H01L27/115 ,  H01L29/78 ,  H01L29/49 ,  H01L29/423 ,  H01L21/8247 ,  H01L21/336 ,  H01L21/28

CPC classification number: H01L27/11568 ,  H01L21/28282 ,  H01L27/105 ,  H01L27/11573 ,  H01L29/42344

Abstract: 一种存储单元，具有：控制栅电极，通过栅绝缘膜布置在半导体衬底的主表面上；ONO膜，沿控制栅电极的侧表面和半导体衬底的主表面布置；存储栅电极，通过ONO膜布置在控制栅电极的侧表面上和半导体衬底的主表面上。使控制栅电极和存储栅电极在其上部上方分别形成有硅化物膜和通过使硅化物膜的表面氧化而形成的绝缘膜。

公开(公告)号：CN100456452C

公开(公告)日：2009-01-28

申请号：CN200510077445.0

申请日：2005-06-21

Applicant: 株式会社瑞萨科技

Inventor： 坂井健志 ,  石井泰之 ,  冈崎勉 ,  中道胜 ,  松井俊一 ,  新田恭也 ,  町田悟 ,  中川宗克 ,  塚田祐一

IPC: H01L21/8239 ,  H01L21/336 ,  H01L27/105 ,  H01L29/788

CPC classification number: H01L27/11568 ,  H01L21/823842 ,  H01L21/82385 ,  H01L21/823857 ,  H01L21/823864 ,  H01L27/105 ,  H01L27/1052 ,  H01L27/11573

Abstract: 本发明能够增强具有MONOS型晶体管的非易失性半导体存储器件的高性能。具有改进性能的该具有MONOS型晶体管的非易失性半导体存储器件，其中，MONOS型非易失性存储器的存储单元包括控制晶体管和存储晶体管，控制晶体管的控制栅包括n型多晶硅膜并且该控制栅形成在包括氧化硅膜的栅绝缘膜上方，存储晶体管的存储栅包括n型多晶硅膜并且该存储栅布置到控制栅的侧壁之一，该存储栅包括掺杂的多晶硅膜，其薄层电阻比控制栅的薄层电阻低，该控制栅包括通过将杂质离子植入到未掺杂硅膜中而形成的多晶硅膜。

公开(公告)号：CN100447988C

公开(公告)日：2008-12-31

申请号：CN200410031907.0

申请日：2004-03-31

Applicant: 株式会社瑞萨科技

Inventor： 川嶋祥之 ,  伊藤文俊 ,  坂井健志 ,  石井泰之 ,  金丸恭弘 ,  桥本孝司 ,  水野真 ,  奥山幸祐

IPC: H01L21/8247 ,  H01L27/115 ,  H01L29/78

CPC classification number: H01L29/66825 ,  H01L21/28273 ,  H01L21/28282 ,  H01L29/42324 ,  H01L29/66833

Abstract: 本发明提供了一种具有改善电学特性的半导体器件，该器件具有使用分裂-栅型存储单元结构的非易失存储器并且使用氮化物薄膜作为电荷存储层。在半导体衬底的主表面中形成n型半导体区，然后在半导体区上方形成分裂-栅型存储单元的存储栅电极和电荷存储层。随后，在存储器栅电极的侧表面上形成侧壁，并且在半导体衬底的主表面上方形成光致抗蚀剂图案。光致抗蚀剂图案被用作蚀刻掩模，并且通过蚀刻除去半导体衬底主表面的一部分，从而形成凹槽。在形成凹槽的区域中，除去n型半导体区。然后，在用于形成凹槽的区域中形成用于形成选择存储单元的nMIS晶体管沟道的p型半导体区。

公开(公告)号：CN100552957C

公开(公告)日：2009-10-21

申请号：CN200510082800.3

申请日：2005-07-07

Applicant: 株式会社瑞萨科技

Inventor： 伊藤文俊 ,  川岛祥之 ,  坂井健志 ,  石井泰之 ,  金丸恭弘 ,  桥本孝司 ,  水野真 ,  奥山幸祐 ,  真边由起子

IPC: H01L27/115 ,  G11C16/02

CPC classification number: H01L27/11568 ,  G11C16/0466 ,  H01L21/28282 ,  H01L27/115 ,  H01L29/42344 ,  H01L29/66833 ,  H01L29/792

Abstract: 提高了具有非易失性存储单元的半导体器件的集成度和重写次数。第一MONOS型非易失性存储元件和第二MONOS型非易失性存储元件一起安装在同一衬底上，其中第二MONOS型非易失性存储元件具有比第一MONOS型非易失性存储元件更大的栅极宽度，并且第一MONOS型非易失性存储元件用于存储几乎不重写的程序数据，以及第二MONOS型非易失性存储元件用于存储频繁重写的处理数据。

公开(公告)号：CN101051652A

公开(公告)日：2007-10-10

申请号：CN200710092268.2

申请日：2007-04-03

Applicant: 株式会社瑞萨科技

Inventor： 鸟羽功一 ,  石井泰之 ,  川岛祥之 ,  町田悟 ,  中川宗克 ,  桥本孝司

IPC: H01L29/78 ,  H01L29/40 ,  H01L29/423 ,  H01L29/49 ,  H01L27/115 ,  H01L21/336 ,  H01L21/28 ,  H01L21/8247

CPC classification number: H01L29/7885 ,  H01L21/28282 ,  H01L27/115 ,  H01L27/11521 ,  H01L29/42324 ,  H01L29/42328

Abstract: 提供了一种半导体器件，其在半导体衬底上方具有彼此接近并构成非易失性存储器的控制栅电极和存储栅电极。存储栅电极的高度低于控制栅栅电极的高度。金属硅化物膜形成在控制栅电极的上表面上方，但不形成在存储栅电极的上表面上方。存储栅电极在其上表面上方具有由氧化硅制成的侧壁绝缘膜。该侧壁绝缘膜在用于在存储栅电极和控制栅电极的侧壁上方形成相应侧壁绝缘膜的同一步骤中形成。本发明使得可以提高具有非易失性存储器的半导体器件的产品成品率和性能。