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公开(公告)号：CN117788262A
公开(公告)日：2024-03-29
申请号：CN202311809249.2
申请日：2018-04-23
Applicant: 英特尔公司
Inventor： P·萨蒂 , N·斯里尼瓦萨 , 陈峰 , J·雷 , B·J·阿什博 , N·C·加洛泊凡博列斯 , E·努维塔蒂 , B·文布 , T-H·林 , K·辛哈 , R·巴瑞克 , S·S·巴格索克希 , J·E·高茨施里奇 , A·考克 , N·R·萨蒂什 , F·阿赫巴里 , D·金 , W·付 , T·T·施吕斯列尔 , J·B·马斯特罗纳尔德 , L·L·赫德 , J·H·费特 , J·S·波尔斯 , A·T·莱克 , K·瓦德亚纳桑 , D·伯克 , S·马余兰 , A·R·阿普
IPC: G06T1/20 , G06T1/40 , G06N3/044 , G06N3/0442 , G06N3/0464 , G06N3/084 , G06N3/088 , G06N3/0895 , G06N3/09
Abstract: 公开了一种用于促进计算优化的装置。该装置包括多个处理单元，该多个处理单元各自包括多个执行单元(EU)，其中，该多个EU包括第一EU类型和第二EU类型。
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公开(公告)号：CN108734648B
公开(公告)日：2024-03-01
申请号：CN201810382773.9
申请日：2018-04-23
Applicant: 英特尔公司
Inventor： A·R·阿普 , A·考克 , L·L·赫德 , D·金 , M·B·麦克弗森 , J·C·韦斯特 , 陈峰 , F·阿赫巴里 , N·斯里尼瓦萨 , N·R·萨蒂什 , J·雷 , P·T·唐 , M·S·斯特里克兰 , 陈晓明 , 姚安邦 , T·史佩斯曼
Abstract: 公开了一种用于促进计算优化的装置。该装置包括分类逻辑，该分类逻辑用于基于浮点线程操作的位深度将处理线程分类到数个线程组中。
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Patent Agency Ranking
公开(公告)号：CN117036147A
公开(公告)日：2023-11-10
申请号：CN202311057145.0
申请日：2018-04-23
Applicant: 英特尔公司
Inventor： A·R·阿普 , A·考克 , L·L·赫德 , D·金 , M·B·麦克弗森 , J·C·韦斯特 , 陈峰 , F·阿赫巴里 , N·斯里尼瓦萨 , N·R·萨蒂什 , J·雷 , P·T·唐 , M·S·斯特里克兰 , 陈晓明 , 姚安邦 , T·史佩斯曼
Abstract: 本申请公开了计算优化机制。公开了一种用于促进计算优化的装置。该装置包括分类逻辑，该分类逻辑用于基于浮点线程操作的位深度将处理线程分类到数个线程组中。
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公开(公告)号：CN111932434A
公开(公告)日：2020-11-13
申请号：CN202010801699.7
申请日：2018-04-23
Applicant: 英特尔公司
Inventor： A·R·阿普 , A·考克 , L·L·赫德 , D·金 , M·B·麦克弗森 , J·C·韦斯特 , 陈峰 , F·阿赫巴里 , N·斯里尼瓦萨 , N·R·萨蒂什 , J·雷 , P·T·唐 , M·S·斯特里克兰 , 陈晓明 , 姚安邦 , T·史佩斯曼
Abstract: 公开了一种用于促进计算优化的装置。该装置包括分类逻辑，该分类逻辑用于基于浮点线程操作的位深度将处理线程分类到数个线程组中。
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公开(公告)号：CN110288509A
公开(公告)日：2019-09-27
申请号：CN201910576830.1
申请日：2018-04-23
Applicant: 英特尔公司
Inventor： A·R·阿普 , A·考克 , L·L·赫德 , D·金 , M·B·麦克弗森 , J·C·韦斯特 , 陈峰 , F·阿赫巴里 , N·斯里尼瓦萨 , N·R·萨蒂什 , J·雷 , P·T·唐 , M·S·斯特里克兰 , 陈晓明 , 姚安邦 , T·史佩斯曼
Abstract: 公开了一种用于促进计算优化的装置。该装置包括分类逻辑，该分类逻辑用于基于浮点线程操作的位深度将处理线程分类到数个线程组中。
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公开(公告)号：CN108734645A
公开(公告)日：2018-11-02
申请号：CN201810368245.8
申请日：2018-04-23
Applicant: 英特尔公司
Inventor： N·斯里尼瓦萨 , J·雷 , N·C·加洛泊凡博列斯 , B·阿什博 , P·萨蒂 , 陈峰 , B·拉克舍玛南 , E·乌尔德-阿迈德-瓦尔 , 马立伟 , L·L·赫德 , A·R·阿普 , J·C·韦斯特 , S·S·巴格索克希 , J·E·高茨克里奇 , C·萨科斯维尔 , F·阿赫巴里 , D·金 , A·考克 , N·R·萨蒂什
Abstract: 本申请公开了神经网络优化机制。公开了一种用于促进神经网络(NN)优化的方法。所述设备包括优化逻辑，所述优化逻辑用于：将NN拓扑限定为具有一个或多个宏层；调节所述一个或多个宏层以便适配所述NN的输入和输出部件；并且基于所述一个或多个宏层训练所述NN。
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公开(公告)号：CN108629403A
公开(公告)日：2018-10-09
申请号：CN201810157027.X
申请日：2018-02-24
Applicant: 英特尔公司
IPC: G06N3/04
CPC classification number: G06N3/049 , G06N3/0454 , G06N3/0445
Abstract: 本公开提供了用于生成脉冲神经网络。生成脉冲神经网络可以包括：确定从多个输入神经元到多个输出神经元中的每个输出神经元的第一输入扇入大于阈值；基于确定所述第一输入扇入大于所述阈值而生成多个中间神经元；以及将所述多个中间神经元耦合至所述多个输入神经元和所述多个输出神经元，其中，所述多个中间神经元中的每一个都具有小于所述第一输入扇入的第二输入扇入，并且所述多个输出神经元中的每一个都具有小于所述第一输入扇入的第三输入扇入。
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