存储器件和包括在该存储器件中的感测器件的驱动方法

    公开(公告)号:CN119170065A

    公开(公告)日:2024-12-20

    申请号:CN202410804045.8

    申请日:2024-06-20

    Inventor: 尹炫喆 蔡瑛澈

    Abstract: 一种存储器件,包括:存储单元阵列,包括连接到位线的第一存储单元、以及连接到互补位线的第二存储单元;位线感测放大器,包括感测位线和感测互补位线;第一电荷传输晶体管,在位线和感测位线之间;第二电荷传输晶体管,在互补位线和感测互补位线之间;第一预充电晶体管,以第一预充电电压对位线和互补位线进行预充电;第二预充电晶体管,以第二预充电电压对感测位线和感测互补位线进行预充电;第一传输栅极晶体管,向第一电荷传输晶体管提供第一传输栅极电压;以及第二传输栅极晶体管,向第二电荷传输晶体管提供第二传输栅极电压。

    存储器设备
    2.
    发明公开
    存储器设备 审中-公开

    公开(公告)号:CN119479744A

    公开(公告)日:2025-02-18

    申请号:CN202411074637.5

    申请日:2024-08-07

    Abstract: 本公开涉及存储器设备。一种示例存储器设备包括包含被配置为存储数据的存储器单元阵列以及包含多个反熔丝位线、多个反熔丝字线、多个编程晶体管的反熔丝单元阵列的存储器单元区域,该多个编程晶体管电耦合到多个反熔丝位线中的第一反熔丝位线并且彼此并联耦合。该存储器设备包括外围电路区域,该外围电路区域包括被配置为输出存储在多个编程晶体管中的一次性可编程(OTP)数据的反熔丝感测放大器。

    包括电力选通开关的存储器件
    4.
    发明公开

    公开(公告)号:CN120071986A

    公开(公告)日:2025-05-30

    申请号:CN202411270333.6

    申请日:2024-09-11

    Abstract: 一种存储器件包括:核心外围电路结构,包括与内部电源电压线连接的第一接合金属焊盘;以及单元阵列结构,设置在核心外围电路结构上,并且包括与第一接合金属焊盘接触的第二接合金属焊盘。单元阵列结构包括:存储单元阵列;以及电力选通开关,连接在外部电源电压线与第一接合金属焊盘之间,并且电力选通开关位于单元阵列结构的与存储单元阵列不同的区域中并且选择性地向内部电源电压线提供外部电源电压。

    包括垂直单元晶体管的半导体存储器件

    公开(公告)号:CN120018492A

    公开(公告)日:2025-05-16

    申请号:CN202411582345.2

    申请日:2024-11-07

    Abstract: 一种半导体存储器件包括外围电路结构和单元阵列结构,单元阵列结构提供在外围电路结构上并包括多个单元阵列区和提供在多个单元阵列区之间的上外围区。单元阵列结构包括垂直单元晶体管、第一垂直外围晶体管和第二垂直外围晶体管。垂直单元晶体管、第一垂直外围晶体管和第二垂直外围晶体管中的每个具有沿与外围电路结构和单元阵列结构的布置方向平行的第三方向延伸的沟道。垂直单元晶体管设置在单元阵列区中并具有第一极性。第一垂直外围晶体管设置在上外围区中并具有第一极性。第二垂直外围晶体管设置在上外围区中并具有不同于第一极性的第二极性。

    半导体存储器装置及操作半导体存储器装置的方法

    公开(公告)号:CN109559779A

    公开(公告)日:2019-04-02

    申请号:CN201811109758.3

    申请日:2018-09-21

    Inventor: 金经纶 尹炫喆

    Abstract: 一种半导体存储器装置可包括存储单元阵列及存取控制电路。所述存储单元阵列可包括第一单元区及第二单元区。所述存取控制电路可响应于命令、存取地址及用于识别第一单元区及第二单元区的熔丝信息而以不同的方式存取所述第一单元区及所述第二单元区。所述命令及地址可从外部装置提供。也提供一种操作半导体存储器装置的方法。

    半导体器件
    8.
    发明公开
    半导体器件 审中-公开

    公开(公告)号:CN120018493A

    公开(公告)日:2025-05-16

    申请号:CN202411602570.8

    申请日:2024-11-11

    Abstract: 本公开提供了一种半导体器件。所述半导体器件包括:顺序排列的第一连接区域、第一存储块区域和第二连接区域;第一外围电路区域,所述第一外围电路区域与所述第一存储块区域垂直地交叠;第一存储单元,其位于所述第一存储块区域中;第一字线,其穿越所述第一存储块区域延伸到所述第一连接区域和所述第二连接区域中,并且电连接到所述第一存储单元;第一子字线驱动器,其位于所述第一外围电路区域中;以及第一字线信号路径,其电连接所述第一字线和所述第一子字线驱动器。所述第一字线信号路径包括在所述第一连接区域中耦接到所述第一字线的至少一个第一布线接触和在所述第二连接区域中耦接到所述第一字线的至少一个第二布线接触。

    感测放大器电路、存储器设备和存储器设备的感测方法

    公开(公告)号:CN117316207A

    公开(公告)日:2023-12-29

    申请号:CN202310265448.5

    申请日:2023-03-13

    Abstract: 在感测放大器电路中,第一晶体管电连接在第一位线和第一节点之间,第一反相器包括连接至第一节点的第一输入端子和第一输出端子,并且第二反相器包括连接至第二节点的第二输入端子和第二输出端子。第二晶体管电连接在第一输出端子和第二节点之间,并且第三晶体管电连接在第二输出端子和第一节点之间。预充电电路在第一时间段期间将第一电压传输至第一节点和第二节点,并在第二时间段期间将高于第一电压的第二电压传输至第一节点和第二节点。

    半导体存储器装置及操作半导体存储器装置的方法

    公开(公告)号:CN109559779B

    公开(公告)日:2023-10-10

    申请号:CN201811109758.3

    申请日:2018-09-21

    Inventor: 金经纶 尹炫喆

    Abstract: 一种半导体存储器装置可包括存储单元阵列及存取控制电路。所述存储单元阵列可包括第一单元区及第二单元区。所述存取控制电路可响应于命令、存取地址及用于识别第一单元区及第二单元区的熔丝信息而以不同的方式存取所述第一单元区及所述第二单元区。所述命令及地址可从外部装置提供。也提供一种操作半导体存储器装置的方法。

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