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公开(公告)号：CN117113908A
公开(公告)日：2023-11-24
申请号：CN202311345112.6
申请日：2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F30/367 , G06F30/373
Abstract: 本发明实施例提供一种验证方法、装置、电子设备及可读存储介质，涉及计算机技术领域，该方法包括：将软件设计下载到可编程逻辑芯片的处理系统中，将所述软件设计对应的硬件设计烧录到所述可编程逻辑芯片的可编程逻辑区域中；在所述可编程逻辑芯片中同步运行所述硬件设计和所述软件设计，并监测所述硬件设计的第一运行数据和所述软件设计的第二运行数据；在所述第一运行数据和所述第二运行数据不匹配的情况下，对所述可编程逻辑芯片进行硬件快照，以保存所述可编程逻辑芯片的状态信息；将所述状态信息导入到仿真软件中进行仿真，以对所述硬件设计进行调试。本发明实施例提升了验证效率，并且保证了仿真的自由度和调试效率。
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公开(公告)号：CN117093353A
公开(公告)日：2023-11-21
申请号：CN202311340376.2
申请日：2023-10-17
Applicant: 北京开源芯片研究院
Abstract: 本发明实施例提供一种中断控制方法、装置、电子设备及可读存储介质，应用于计算机技术领域，该方法包括：获取待测设计对基准测试程序的第一执行结果和软件模拟器对所述基准测试程序的第二执行结果；在满足中断条件的情况下，中断所述待测设计的运行；其中，所述中断条件包括以下至少一项：所述第一执行结果与所述第二执行结果不匹配；所述待测设计对应的硬件缓冲区已满；所述硬件缓冲区用于记录所述待测设计的运行数据；所述软件模拟器对应的软件缓冲区为空；所述软件缓冲区用于记录所述软件模拟器的运行数据。本发明实施例在硬件验证中可以对待测设计和软件模拟器的执行结果自动进行比较和检查，并自动触发中断，具备更好的调试能力。
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公开(公告)号：CN117077603A
公开(公告)日：2023-11-17
申请号：CN202311340379.6
申请日：2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F30/367 , G06F30/373
Abstract: 本发明实施例提供一种验证方法、芯片、系统、电子设备及可读存储介质，涉及计算机技术领域，该方法包括：硬件设计在运行过程中将第一运行数据写入硬件缓冲区，软件设计在运行过程中将第二运行数据写入软件缓冲区；验证模块从硬件缓冲区中读取所述第一运行数据，从软件缓冲区中读取所述第二运行数据，并对第一运行数据和第二运行数据进行比对，在第一运行数据和第二运行数据不匹配的情况下，中断硬件设计和软件设计的运行，并对可编程逻辑芯片进行硬件快照，以保存可编程逻辑芯片的状态信息，将所述状态信息导入到仿真软件中进行仿真，以对硬件设计进行调试。本发明实施例提升了验证效率，并保证了仿真的自由度和调试效率。
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公开(公告)号：CN116702663B
公开(公告)日：2023-10-27
申请号：CN202310937005.6
申请日：2023-07-27
Applicant: 北京开源芯片研究院
IPC: G06F30/327 , G06F30/331 , G06F30/3312 , G06F30/3323
Abstract: 本发明实施例提供一种电路综合方法、装置、电子设备及可读存储介质，该方法包括：对待综合的断言语句进行解析，识别所述断言语句对应的关键字和验证方式；将所述断言语句中的关键字例化为基础电路模块；根据所述验证方式确定所述基础电路模块对应的连接方式；按照所述连接方式对所述基础电路模块进行连接，得到所述断言语句对应的断言电路。本发明实施例可以将不可综合的断言语句转换为等效的可综合的断言电路，以便在硬件中实现基于断言的验证。
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公开(公告)号：CN118966105A
公开(公告)日：2024-11-15
申请号：CN202411441412.9
申请日：2024-10-15
Applicant: 北京开源芯片研究院
IPC: G06F30/3308 , G06F11/26
Abstract: 本发明实施例提供一种调试方法、装置、电子设备及可读存储介质，该方法包括：在模拟器运行过程中按照预设规则对所述模拟器的运行状态进行快照保存；在所述模拟器运行出错的情况下，将与所述模拟器的错误现场相匹配的历史快照保存至存储模块；从所述存储模块中获取所述历史快照，并将所述历史快照加载至所述模拟器中，以对所述模拟器进行调试与修复。本发明实施例可以在模拟器运行出错的情况下，将与模拟器的错误现场相匹配的历史快照存储至存储模块中进行持久化保存，后续在对模拟器进行调试时，可以直接从存储模块中获取历史快照，并将历史快照加载到模拟器中，以便模拟器快速的运行到错误现场，有利于提升模拟器的调试效率。
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Patent Agency Ranking
公开(公告)号：CN118133735A
公开(公告)日：2024-06-04
申请号：CN202410543745.6
申请日：2024-04-30
Applicant: 北京开源芯片研究院
Abstract: 本发明实施例提供一种验证方法、装置、电子设备及可读存储介质，该方法包括：对待测设计的芯片代码进行修改，以将待测设计的各个数据接口传输的数据接入所述待测设计的顶层模块；根据修改后的芯片代码，将待测设计烧录至可编程逻辑芯片的可编程逻辑区域；在验证平台中生成动态链接库；在待测设计每执行一条指令之后，采集待测设计的第一状态值，并调用动态链接库，以控制动态链接库执行一条指令并输出第二状态值；在第一状态值与第二状态值不匹配的情况下，确定待测设计运行出错。本发明实施例增加了待测设计的细节可见性，能够在待测设计运行出错时及时报错，保证了验证的有效性，有利于对待测设计及时进行调试和检查。
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公开(公告)号：CN117113908B
公开(公告)日：2024-02-02
申请号：CN202311345112.6
申请日：2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F30/367 , G06F30/373
Abstract: 本发明实施例提供一种验证方法、装置、电子设备及可读存储介质，涉及计算机技术领域，该方法包括：将软件设计下载到可编程逻辑芯片的处理系统中，将所述软件设计对应的硬件设计烧录到所述可编程逻辑芯片的可编程逻辑区域中；在所述可编程逻辑芯片中同步运行所述硬件设计和所述软件设计，并监测所述硬件设计的第一运行数据和所述软件设计的第二运行数据；在所述第一运行数据和所述第二运行数据不匹配的情况下，对所述可编程逻辑芯片进行硬件快照，以保存所述可编程逻辑芯片的状态信息；将所述状态信息导入到仿真软件中进行仿真，以对所述硬件设计进行调试。本发明实施例提升了验证效率，并且保证了仿真的自由度和调试效率。
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公开(公告)号：CN117093353B
公开(公告)日：2024-02-02
申请号：CN202311340376.2
申请日：2023-10-17
Applicant: 北京开源芯片研究院
Abstract: 本发明实施例提供一种中断控制方法、装置、电子设备及可读存储介质，应用于计算机技术领域，该方法包括：获取待测设计对基准测试程序的第一执行结果和软件模拟器对所述基准测试程序的第二执行结果；在满足中断条件的情况下，中断所述待测设计的运行；其中，所述中断条件包括以下至少一项：所述第一执行结果与所述第二执行结果不匹配；所述待测设计对应的硬件缓冲区已满；所述硬件缓冲区用于记录所述待测设计的运行数据；所述软件模拟器对应的软件缓冲区为空；所述软件缓冲区用于记录所述软件模拟器的运行数据。本发明实施例在硬件验证中可以对待测设计和软件模拟器的执行结果自动进行比较和检查，并自动触发中断，具备更好的调试能力。
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公开(公告)号：CN117113907B
公开(公告)日：2023-12-22
申请号：CN202311344674.9
申请日：2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F30/367 , G06F30/373
Abstract: 本发明实施例提供一种验证方法、装置、电子设备及可读存储介质，涉及计算机技术领域，该方法包括：将待测设计烧录到可编程逻辑芯片的可编程逻辑区域，将软件模拟器下载到所述可编程逻辑芯片的处理系统中；通过所述待测设计和所述软件模拟器分别执行基准测试程序；在满足快照条件的情况下，通过硬件快照对所述可编程逻辑芯片的状态信息进行保存；将所述状态信息导入仿真软件中进行仿真，以对所述待测设计进行调试。本发明实施例利用FPGA加速提升了验证效率，并利用仿真软件对待测设计进行更细粒度的调试，保证了仿真的自由度和调试效率。
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公开(公告)号：CN117112447B
公开(公告)日：2023-12-22
申请号：CN202311344665.X
申请日：2023-10-17
Applicant: 北京开源芯片研究院
IPC: G06F11/36 , G06F30/367
Abstract: 本发明实施例提供一种数据传输方法、装置、电子设备及可读存储介质，涉及计算机技术领域。该方法包括：利用仿真软件对待测设计进行调试；待测设计烧录在可编程逻辑芯片中，可编程逻辑芯片中还包括数据写入模块和大容量存储单元；在满足预设条件的情况下，停止仿真软件的运行，并获取目标数据；根据目标数据和目标数据在所述大容量存储单元中的存储地址，生成目标文件；在目标文件中，目标数据与存储地址一一对应；利用数据写入模块基于目标文件，将目标数据写入大容量存储单元。本发明实施例为仿真软件往可编程逻辑芯片的大容量存储单元写入目标数据提供了切实可行的实现方式，提高了仿真软件往可编程逻辑芯片写入数据的效率。
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