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公开(公告)号:CN101621488B
公开(公告)日:2012-11-21
申请号:CN200910056141.4
申请日:2009-08-07
Applicant: 复旦大学
IPC: H04L27/22
Abstract: 本发明属于数字通信传输同步技术领域,具体为DVB-S2系统接收机全模式物理层帧同步方法。本发明充分利用物理层帧结构的特点,通过在有导频模式下抽取导频信息后联合帧头90个符号抽取得到的信息,在无导频模式下利用帧头90个符号抽取得到的信息,分别进行差分相关处理后进入并行滑动峰值检测窗口,在每个窗口内进行峰值检测判决时引入双峰值检测方案并做出相应判决。本发明可加快帧同步捕获帧头的速度,明显提高系统工作在低信噪比及较大频偏时帧同步相关峰的性能,准确地给出帧同步及起始位置信息。另外也对差分相关处理时的乘法器用简单的控制交换单元代替,保证其具有较低的复杂度。
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公开(公告)号:CN101887397A
公开(公告)日:2010-11-17
申请号:CN201010191648.3
申请日:2010-06-03
Applicant: 复旦大学
Abstract: 本发明属于信息安全技术领域,具体为一种抗时间驱动缓存攻击的硬件改进结构。本发明维持处理器原数据缓存结构,只在其外围加入若干部件,包括:缓存缺失数实时检测模块、数据预取模块、多路选择器、伪缺失应激生成模块、两个与门和仲裁模块;使得其能抵抗针对AES的时间驱动的缓存攻击。本发明提出的cache改进方案在MIPS 4kc处理器上实现,并通过FPGA测试验证其能有效抵抗各种类型的时间驱动缓存攻击。本发明方案消耗很少的硬件代价,而AES加解密算法运行性能损失不到10%。
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公开(公告)号:CN101621488A
公开(公告)日:2010-01-06
申请号:CN200910056141.4
申请日:2009-08-07
Applicant: 复旦大学
IPC: H04L27/22
Abstract: 本发明属于数字通信传输同步技术领域,具体为DVB-S2系统接收机全模式物理层帧同步方法。本发明充分利用物理层帧结构的特点,通过在有导频模式下抽取导频信息后联合帧头90个符号抽取得到的信息,在无导频模式下利用帧头90个符号抽取得到的信息,分别进行差分相关处理后进入并行滑动峰值检测窗口,在每个窗口内进行峰值检测判决时引入双峰值检测方案并做出相应判决。本发明可加快帧同步捕获帧头的速度,明显提高系统工作在低信噪比及较大频偏时帧同步相关峰的性能,准确地给出帧同步及起始位置信息。另外也对差分相关处理时的乘法器用简单的控制交换单元代替,保证其具有较低的复杂度。
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公开(公告)号:CN101702709B
公开(公告)日:2013-04-10
申请号:CN200910198314.6
申请日:2009-11-05
Applicant: 复旦大学
Abstract: 本发明属于集成电路设计技术领域,具体为一种适用于MIPS处理器的AES加密单元。该AES加密单元由5个多路选择器、字节替换单元、异或单元、列混合单元和寄存器组成。该AES加密单元执行密钥长度为128位,内部的字节替换模块采用了有限域运算的方式实现,减小了芯片的面积。同时采用2级流水线结构,提高了加密速度,一次AES加/解密运算的时间为3.78ms,吞吐率达到33.9Mbps。
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公开(公告)号:CN101887397B
公开(公告)日:2011-12-28
申请号:CN201010191648.3
申请日:2010-06-03
Applicant: 复旦大学
Abstract: 本发明属于信息安全技术领域,具体为一种抗时间驱动缓存攻击的硬件改进结构。本发明维持处理器原数据缓存结构,只在其外围加入若干部件,包括:缓存缺失数实时检测模块、数据预取模块、多路选择器、伪缺失应激生成模块、两个与门和仲裁模块;使得其能抵抗针对AES的时间驱动的缓存攻击。本发明提出的cache改进方案在MIPS 4kc处理器上实现,并通过FPGA测试验证其能有效抵抗各种类型的时间驱动缓存攻击。本发明方案消耗很少的硬件代价,而AES加解密算法运行性能损失不到10%。
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公开(公告)号:CN101702709A
公开(公告)日:2010-05-05
申请号:CN200910198314.6
申请日:2009-11-05
Applicant: 复旦大学
Abstract: 本发明属于集成电路设计技术领域,具体为一种适用于MIPS处理器的AES加密单元。该AES加密单元由5个多路选择器、字节替换单元、异或单元、列混合单元和寄存器组成。该AES加密单元执行密钥长度为128位,内部的字节替换模块采用了有限域运算的方式实现,减小了芯片的面积。同时采用2级流水线结构,提高了加密速度,一次AES加/解密运算的时间为3.78ms,吞吐率达到33.9Mbps。
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