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公开(公告)号：CN110501990A
公开(公告)日：2019-11-26
申请号：CN201811159142.7
申请日：2018-09-30
Applicant: 国核自仪系统工程有限公司
IPC: G05B23/02
Abstract: 本发明公开了一种数字化仪控系统的控制电路，包括系统电源输入接口电路、控制器模块电源电路、电源低失效电路和I/O模块电源电路；系统电源输入接口电路用于控制器模块电源电路以及I/O模块电源电路供电；控制器模块电源电路用于产生控制器模块电源；电源低失效电路输出一开关控制信号至I/O模块电源电路的开关控制线；开关控制线用于控制I/O模块电源电路是否给外部的I/O模块供电；电源低失效电路用于在系统电源和/或控制器模块电源失效前使能开关控制信号；I/O模块电源电路用于在开关控制线使能时关闭对I/O模块供电。本发明能够增加核心模块的自我诊断能力并在系统故障条件下能够确保输入输出模块趋于确定的安全状态。
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公开(公告)号：CN110501990B
公开(公告)日：2024-03-12
申请号：CN201811159142.7
申请日：2018-09-30
Applicant: 国核自仪系统工程有限公司
IPC: G05B23/02
Abstract: 本发明公开了一种数字化仪控系统的控制电路，包括系统电源输入接口电路、控制器模块电源电路、电源低失效电路和I/O模块电源电路；系统电源输入接口电路用于控制器模块电源电路以及I/O模块电源电路供电；控制器模块电源电路用于产生控制器模块电源；电源低失效电路输出一开关控制信号至I/O模块电源电路的开关控制线；开关控制线用于控制I/O模块电源电路是否给外部的I/O模块供电；电源低失效电路用于在系统电源和/或控制器模块电源失效前使能开关控制信号；I/O模块电源电路用于在开关控制线使能时关闭对I/O模块供电。本发明能够增加核心模块的自我诊断能力并在系统故障条件下能够确保输入输出模块趋于确定的安全状态。
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公开(公告)号：CN110505263A
公开(公告)日：2019-11-26
申请号：CN201811300385.8
申请日：2018-10-30
Applicant: 国核自仪系统工程有限公司
Abstract: 本发明公开了一种基于点对点的通讯网络系统，包括背板、通讯模块、和多组序列；每组序列包括多个输入输出模块和一块可复用为输入输出模块的处理器模块；处理器模块、输入输出模块以及通讯模块均分别通过数据线与背板互联；每块处理器模块与所在序列中的每个输入输出模块以点对点通讯方式互联，每块处理器模块也与其它序列中的处理器模块以点对点通讯方式互联；被复用为输入输出模块的处理器模块为复合模块；每块处理器模块通过其它序列中的复合模块与复合模块所在的序列中的输入输出模块进行通信；通讯模块与每块处理器模块通过冗余的点对点通讯方式互联。本发明在兼顾通讯网络的灵活性及系统的可靠性的前提下，降低了系统的复杂程度与成本。
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Patent Agency Ranking
公开(公告)号：CN110502199B
公开(公告)日：2024-11-15
申请号：CN201811146238.X
申请日：2018-09-29
Applicant: 国核自仪系统工程有限公司
Abstract: 本发明公开了一种FPGA组件，所述FPGA组件包括：固态硬盘、DDR和控制单元；所述固态硬盘用于存储界面数据包；所述控制单元用于从所述固态硬盘读取所述界面数据包并写入所述DDR；所述控制单元还用于从所述DDR读取所述界面数据包并组成所述人机界面的显示帧。本发明的FPGA组件可用于实现界面显示，无需任何CPU、操作系统和软件支持，避免了黑客和病毒的入侵，安全性大大提高，且还具有电路简洁、无闲置电路、功耗低等优点。
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公开(公告)号：CN110502199A
公开(公告)日：2019-11-26
申请号：CN201811146238.X
申请日：2018-09-29
Applicant: 国核自仪系统工程有限公司
Abstract: 本发明公开了一种FPGA组件，所述FPGA组件包括：固态硬盘、DDR和控制单元；所述固态硬盘用于存储界面数据包；所述控制单元用于从所述固态硬盘读取所述界面数据包并写入所述DDR；所述控制单元还用于从所述DDR读取所述界面数据包并组成所述人机界面的显示帧。本发明的FPGA组件可用于实现界面显示，无需任何CPU、操作系统和软件支持，避免了黑客和病毒的入侵，安全性大大提高，且还具有电路简洁、无闲置电路、功耗低等优点。
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公开(公告)号：CN208971553U
公开(公告)日：2019-06-11
申请号：CN201821776097.5
申请日：2018-10-30
Applicant: 国核自仪系统工程有限公司
Abstract: 本实用新型公开了一种基于点对点的通讯网络系统，包括背板、通讯模块、和多组序列；每组序列包括多个输入输出模块和一块可复用为输入输出模块的处理器模块；处理器模块、输入输出模块以及通讯模块均分别通过数据线与背板互联；每块处理器模块与所在序列中的每个输入输出模块以点对点通讯方式互联，每块处理器模块也与其它序列中的处理器模块以点对点通讯方式互联；被复用为输入输出模块的处理器模块为复合模块；每块处理器模块通过其它序列中的复合模块与复合模块所在的序列中的输入输出模块进行通信；通讯模块与每块处理器模块通过冗余的点对点通讯方式互联。本实用新型兼顾通讯网络的灵活性及系统的可靠性，降低了系统的复杂程度与成本。(ESM)同样的发明创造已同日申请发明专利
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公开(公告)号：CN208861268U
公开(公告)日：2019-05-14
申请号：CN201821600539.0
申请日：2018-09-29
Applicant: 国核自仪系统工程有限公司
Abstract: 本实用新型公开了一种FPGA组件，所述FPGA组件包括：固态硬盘、DDR和控制单元；所述固态硬盘用于存储界面数据包；所述控制单元用于从所述固态硬盘获取所述界面数据包并写入所述DDR；所述控制单元还用于从所述DDR获取所述界面数据包并生成所述人机界面的显示帧。本实用新型的FPGA组件可用于实现界面显示，无需任何CPU、操作系统和软件支持，避免了黑客和病毒的入侵，安全性大大提高，且还具有电路简洁、无闲置电路、功耗低等优点。(ESM)同样的发明创造已同日申请发明专利
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公开(公告)号：CN208969500U
公开(公告)日：2019-06-11
申请号：CN201821623638.0
申请日：2018-09-30
Applicant: 国核自仪系统工程有限公司
IPC: G05B23/02
Abstract: 本实用新型提供了一种数字化仪控系统的控制电路，包括系统电源输入接口电路、控制器模块电源电路、电源低失效电路和I/O模块电源电路；系统电源输入接口电路用于控制器模块电源电路以及I/O模块电源电路供电；控制器模块电源电路用于产生控制器模块电源；电源低失效电路输出一开关控制信号至I/O模块电源电路的开关控制线；开关控制线用于控制I/O模块电源电路是否给外部的I/O模块供电；电源低失效电路用于在系统电源和/或控制器模块电源失效前使能开关控制信号；I/O模块电源电路用于在开关控制线使能时关闭对I/O模块供电。本实用新型能够增加核心模块的自我诊断能力并在系统故障条件下能够确保输入输出模块趋于确定的安全状态。(ESM)同样的发明创造已同日申请发明专利
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