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公开(公告)号：CN118695616A
公开(公告)日：2024-09-24
申请号：CN202310312057.4
申请日：2023-03-21
Applicant: 华为技术有限公司
IPC: H10B80/00 , H01L23/48 , H01L23/485 , H05K1/18
Abstract: 本申请实施例提供一种芯片堆叠结构、电子设备，涉及芯片制造技术领域，用于缓解芯片平面尺寸较大的问题。芯片堆叠结构中第三裸芯片、第二裸芯片以及第一裸芯片依次层叠设置于载板上。第一重布线层与第一裸芯片的第一接口元件构成第一接口电路，第二重布线层与第二裸芯片的第二接口元件构成第二接口电路。第一导通结构至少贯穿第二裸芯片和第三裸芯片，第二导通结构至少贯穿第三裸芯片。第一裸芯片的第一接口电路和第二裸芯片的第二接口电路分别通过绝缘的第一导通结构和第二导通结构与其余元器件电连接。
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公开(公告)号：CN101237404A
公开(公告)日：2008-08-06
申请号：CN200810007474.3
申请日：2008-03-11
Applicant: 华为技术有限公司
IPC: H04L12/56
Abstract: 本发明公开了一种报文转发方法和装置，涉及通信领域，为解决报文转发芯片内部的处理模块自身不能判断是否对接收到的数据报文进行处理，而使报文转发芯片设计复杂的问题而发明。本发明的技术方案为：报文转发方法，包括：接收数据报文，并获取该数据报文的处理标识；将所述处理标识与处理模块预先设置的处理标识进行比较，获得比较结果；根据所述比较结果对接收到的数据报文进行处理。本发明实施例提供的报文转发方法和装置，不仅可以应用在NP+ASIC转发芯片上，还可以应用在FPGA芯片，或者多核处理器上。
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公开(公告)号：CN114730592A
公开(公告)日：2022-07-08
申请号：CN202080079471.X
申请日：2020-01-22
Applicant: 华为技术有限公司
IPC: G11C11/406
Abstract: 本申请公开了一种存储器、控制器、刷新方法及存储系统，其中，控制器可以向存储器发送刷新指示信息，以向存储器指示待刷新的至少一个目标行。存储器进而可以根据刷新指示信息，刷新其内部的至少一个目标行。控制器可以通过刷新指示信息灵活控制存储器接下来刷新的行，从而有利于使刷新操作能够灵活适应不同的应用场景。
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公开(公告)号：CN101841437B
公开(公告)日：2012-04-18
申请号：CN201010131991.9
申请日：2010-03-23
Applicant: 华为技术有限公司
IPC: H04L12/26
Abstract: 本发明实施例提供了一种对设备进行测试的方法及装置。该方法主要包括：根据预先配置的测试数据包的配置信息在所述设备内部生成测试数据包，将所述测试数据包通过所述设备内部的业务通道进行传输；根据预先配置的测试数据包的验证信息，在所述设备内部对所述业务通道输出的测试数据包进行校验；将校验出错的测试数据包进行保存，统计出现错误的测试数据包的总数和/或错误类型信息，根据统计的信息得到所述设备的自测试结果。上述技术方案可以基于设备需要处理的各种协议的业务报文来生成相应的不同类型的测试数据包，对宿舍设备进行相应的自测试。无需昂贵的测试仪器，大大降低测试成本。
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Patent Agency Ranking
公开(公告)号：CN114731205B
公开(公告)日：2025-05-16
申请号：CN201980102220.6
申请日：2019-11-21
Applicant: 华为技术有限公司
IPC: H04J3/06
Abstract: 一种时钟同步方法及装置，用以解决时间同步不准确的问题。该方法包括：第一设备发送第一数据，在所述第一数据中打上时间戳，并确定所述时间戳对应的数据在所述第一数据中的位置，以及发送所述时间戳对应的数据的第一时间；确定所述位置的数据在格式转换过程中产生的传输延时；向所述第二设备发送第一消息，所述第一消息指示对所述第一时间补偿后的时间；在第三时间接收所述第二设备发送的第二消息；向所述第二设备发送包含所述第三时间的第三消息，以使所述第二设备进行时钟同步。该方法通过确定的传输延时预先进行补偿，有效解决了传输数据进行数据格式转换对时钟同步带来的影响，提高了时间同步的精确性。
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公开(公告)号：CN118629477A
公开(公告)日：2024-09-10
申请号：CN202310254396.1
申请日：2023-03-09
Applicant: 华为技术有限公司
Abstract: 一种熔丝更新电路、方法、存储器、电子设备及存储介质，用以实现熔丝更新的长久性。其中，熔丝更新电路包括测试锁存电路和模式切换电路，测试锁存电路在第二控制信号呈现为有效电平时输出第一信号，以使模式切换电路加载测试模式的配置信息，测试锁存电路在第二控制信号呈现为无效电平且第一控制信号呈现为有效电平时输出第二信号，以使模测试锁存电路加载熔丝信息。通过触发第二控制信号翻转为有效电平，能锁存测试模式的配置信息，使得即使退出测试模式也能够继续使用该配置信息，而通过触发第二控制信号翻转为无效电平，则还能支持不需要对熔丝更新进行长久性锁存的场景，如此，该熔丝更新电路能适用于不同的场景需求。
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公开(公告)号：CN114731205A
公开(公告)日：2022-07-08
申请号：CN201980102220.6
申请日：2019-11-21
Applicant: 华为技术有限公司
IPC: H04J3/06
Abstract: 一种时钟同步方法及装置，用以解决时间同步不准确的问题。该方法包括：第一设备发送第一数据，在所述第一数据中打上时间戳，并确定所述时间戳对应的数据在所述第一数据中的位置，以及发送所述时间戳对应的数据的第一时间；确定所述位置的数据在格式转换过程中产生的传输延时；向所述第二设备发送第一消息，所述第一消息指示对所述第一时间补偿后的时间；在第三时间接收所述第二设备发送的第二消息；向所述第二设备发送包含所述第三时间的第三消息，以使所述第二设备进行时钟同步。该方法通过确定的传输延时预先进行补偿，有效解决了传输数据进行数据格式转换对时钟同步带来的影响，提高了时间同步的精确性。
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公开(公告)号：CN101778043B
公开(公告)日：2012-07-25
申请号：CN201010001642.5
申请日：2010-01-19
Applicant: 华为技术有限公司
IPC: H04L12/56
Abstract: 本发明实施例提供了一种基于令牌桶算法的填充速率区间的划分方法和装置，该方法包括：得到在填充速率区间中当前令牌桶内令牌数为最小值时对应的小数位数据位宽M，以及令牌数为最大值时对应的整数位数据位宽N，M和N为正整数；选取所述数据位宽M和数据位宽N中较大的数据位宽；根据所述较大的数据位宽将所述填充速率区间划分成多个子区间，所述子区间中令牌桶内的令牌数对应的数据位宽为所述较大的数据位宽。本发明实施例通过对填充速率区间划分成若干子区间，使得在网络设备的包处理时间间隔较小，而填充速率范围较大时，只需要较小数据位宽的Memory即可实现流量控制的要求，减少了流量控制具体实现的电路资源，从而大幅降低了成本。
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公开(公告)号：CN101841437A
公开(公告)日：2010-09-22
申请号：CN201010131991.9
申请日：2010-03-23
Applicant: 华为技术有限公司
IPC: H04L12/26
Abstract: 本发明实施例提供了一种对设备进行测试的方法及装置。该方法主要包括：根据预先配置的测试数据包的配置信息在所述设备内部生成测试数据包，将所述测试数据包通过所述设备内部的业务通道进行传输；根据预先配置的测试数据包的验证信息，在所述设备内部对所述业务通道输出的测试数据包进行校验；将校验出错的测试数据包进行保存，统计出现错误的测试数据包的总数和/或错误类型信息，根据统计的信息得到所述设备的自测试结果。上述技术方案可以基于设备需要处理的各种协议的业务报文来生成相应的不同类型的测试数据包，对宿舍设备进行相应的自测试。无需昂贵的测试仪器，大大降低测试成本。
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