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公开(公告)号：CN112367310B
公开(公告)日：2022-11-18
申请号：CN202011167693.5
申请日：2020-10-28
Applicant: 北京计算机技术及应用研究所
IPC: H04L9/40 , H04L69/22 , H04L69/06 , G05B19/042
Abstract: 本发明涉及一种基于FPGA的SRIO总线加密传输装置，属于数据传输技术领域。本发明提出的一种基于FPGA的SRIO总线加密传输装置，该装置基于FPGA可编程逻辑设计实现，同时结合SRIO协议的特点，仅要求用户传输的有效数据载荷为256字节的整数倍，并内置加解密模块实现了高速数据的加密传输，并通过门铃包实现数据帧的同步。该装置能够满足用户数据在现有SRIO网络里的加密传输需求，极大提升了数据传输的安全性，从而满足特定领域的应用需求。
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公开(公告)号：CN110069442B
公开(公告)日：2022-10-14
申请号：CN201910333400.7
申请日：2019-04-24
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种基于ZYNQ系列FPGA的超高速数据采集装置及方法，涉及数据采集技术领域。本发明的装置基于RAID阵列控制实现NVMe固态盘阵列的自动化读写访问控制；基于多通道DDR3/DDR4控制器虚拟FIFO技术，极大提升了内存的访问带宽；通过全交换矩阵实现了采集和回放流程中的数据通路选择。该装置具有10GB/s以上的超高性能，可广泛应用于高清视频、雷达数据和AD采集等高性能应用场景。
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公开(公告)号：CN114915604A
公开(公告)日：2022-08-16
申请号：CN202210561007.5
申请日：2022-05-23
Applicant: 北京计算机技术及应用研究所
Inventor： 侯运通 , 张红磊 , 龚清生 , 聂煜桐 , 邓硕 , 沈月峰 , 王吕大 , 杨帆 , 孙大东 , 陕振 , 徐海旭 , 濮约刚 , 张明庆 , 贾振华 , 赵明亮 , 王艳 , 李正坤
IPC: H04L49/90 , H04L49/901
Abstract: 本发明涉及一种基于FPGA的降低网络链路层拥塞的系统与方法，属于流量控制技术领域。本发明的系统中，所设计的DDR3SRAM的外部缓存大大减少了终端的MAC控制器收到暂停帧的次数，减少了网络的拥塞行为，使终端中的MAC控制器发送行为更加流畅。
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公开(公告)号：CN110825674A
公开(公告)日：2020-02-21
申请号：CN201911041998.9
申请日：2019-10-30
Applicant: 北京计算机技术及应用研究所
IPC: G06F13/32
Abstract: 本发明涉及一种基于FPGA的PCIE DMA交互系统及交互方法，属于DMA技术领域。本发明采用一种新的方案，对现有CPU轮询寄存器(R2)的方式作了改进，实现了FPGA板卡与CPU之间的PCIE多通道DMA交互，有效降低了对CPU资源和PCIE带宽的占用，提高了PCIE传输效率。
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公开(公告)号：CN108021525B
公开(公告)日：2019-11-15
申请号：CN201610922857.8
申请日：2016-10-28
Applicant: 北京计算机技术及应用研究所
IPC: G06F13/42 , G06F11/20 , G06F15/173 , H04L12/40
Abstract: 本发明公开了一种基于PCIE总线多主互连的冗余交换系统，其中，包括：第一主板、第二主板、第三主板、第四主板、第一交换电路以及第二交换电路；第一主板、第二主板、第三主板以及第四主板分别连接第一交换电路以及第二交换电路；第一交换板包括：第一接口、第二接口、第三接口、第四接口以及第一分组交换器；第一主板、第二主板、第三主板、第四主板分别安装虚拟机；第一主板、第二主板、第三主板以及第四主板互为冗余，使得第一交换板以及第二交换板形成冗余结构。本发明的基于PCIE总线多主互连的冗余交换系统，避免了数据信号的多次转换，降低了网络延迟，增加了网络带宽，确保网络的高可用性。
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Patent Agency Ranking
公开(公告)号：CN111641481A
公开(公告)日：2020-09-08
申请号：CN202010449104.6
申请日：2020-05-25
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种基于XAUI接口总线的数据重传方法，涉及XAUI通讯技术领域。本发明通过对常用的XAUI通讯方式作了简单的改进，即实现了当数据传输出错时，发送方重新发送，使得真正数据正确接收，从而实现了XAUI总线的错误数据重传，解决了XAUI数据传输过程中，数据位出错或者丢失导致数据包出错或丢失的问题。
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公开(公告)号：CN111274335A
公开(公告)日：2020-06-12
申请号：CN201910674053.4
申请日：2019-07-25
Applicant: 北京计算机技术及应用研究所
IPC: G06F16/29
Abstract: 本发明涉及一种面向空间叠加分析的快速实现方法，涉及空间叠加优化技术领域。本发明的并行空间叠加分析方法，利用改进的面要素结构PLA，在设备端分别实现基于并行栅格索引技术的高精度并行空间过滤，并将候选集合以细粒度的方式映射到GPU线程阵列上实现并行要素精炼处理，充分发挥了GPU的众核优势，提高了空间叠加的分析效率；本发明提出的面向空间叠加分析的快速实现方法在处理密集数据的面面叠加分析上，算法的性能较CPU的实现能够提高一个数量级，可有效应用于实时性要求较高的场景中；由于本发明提出的面向空间叠加分析的快速实现方法在空间叠加分析效率上的优势，为网络地图服务模式下的空间分析的性能提升提供了很好的探索方向。
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公开(公告)号：CN110069442A
公开(公告)日：2019-07-30
申请号：CN201910333400.7
申请日：2019-04-24
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种基于ZYNQ系列FPGA的超高速数据采集装置及方法，涉及数据采集技术领域。本发明的装置基于RAID阵列控制实现NVMe固态盘阵列的自动化读写访问控制；基于多通道DDR3/DDR4控制器虚拟FIFO技术，极大提升了内存的访问带宽；通过全交换矩阵实现了采集和回放流程中的数据通路选择。该装置具有10GB/s以上的超高性能，可广泛应用于高清视频、雷达数据和AD采集等高性能应用场景。
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公开(公告)号：CN107784001A
公开(公告)日：2018-03-09
申请号：CN201610741535.3
申请日：2016-08-26
Applicant: 北京计算机技术及应用研究所
IPC: G06F17/30
CPC classification number: G06F17/30445 , G06F17/30241 , G06F17/30321
Abstract: 本发明涉及一种基于CUDA的并行空间查询方法，属于计算机技术领域。本发明所设计的并行空间查询方法较一般的使用树型索引的空间查询方法具有明显优势。本发明只要根据查询条件通过对栅格索引对应位置的并行提取，便能够确定查询结果集。本发明合并了原始方法的过滤和精炼两步，既避免了候选集在显存与主存中的频繁传输，也避免了精确匹配时大量的计算过程，极大提高了查询效率。
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公开(公告)号：CN114911642B
公开(公告)日：2024-04-19
申请号：CN202210453169.7
申请日：2022-04-27
Applicant: 北京计算机技术及应用研究所
IPC: G06F11/07
Abstract: 本发明涉及一种基于UEFI事件机制和看门狗的固件重启方法，属于计算机硬件领域。本发明利用UEFI事件提供的异步操作，在固件正常启动时间范围内定时清零看门狗计数器，以确定固件启动正常，未发生“假死”现象；当发生看门狗重启，但重启次数未超过设置阈值时，即“假死”现象出现次数正常，可以降低单板偶发问题造成的测试或使用不便；当发生看门狗重启且重启次数超过一定阈值，通过驱动蜂鸣器，警示工作人员检修主板，相关人员可以直观地了解主板情况。
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