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公开(公告)号:CN103036581B
公开(公告)日:2014-10-15
申请号:CN201210375094.1
申请日:2012-09-29
Applicant: 北京大学深圳研究生院 , 深圳集成电路设计产业化基地管理中心
IPC: H04B1/16
Abstract: 本发明公布了一种超再生接收机,包括天线、低噪声放大单元、注入锁定超再生单元、基带信号解调单元和数字控制逻辑单元,注入锁定超再生单元包括依次连接的注入锁定辅助模块和数字控制振荡模块,数字控制振荡模块包括数字控制谐振网络模块和正反馈支路模块;天线接收到的信号经低噪声放大单元放大后进入注入锁定超再生单元,基带信号解调单元对注入锁定超再生单元的输出信号进行解调,数字控制逻辑单元与正反馈支路模块的熄灭信号输入端连接,为正反馈支路模块提供熄灭信号。本发明的超再生接收机能实现频率自校准,具有结构简单、功耗低的优点。
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公开(公告)号:CN103036581A
公开(公告)日:2013-04-10
申请号:CN201210375094.1
申请日:2012-09-29
Applicant: 北京大学深圳研究生院 , 深圳集成电路设计产业化基地管理中心
IPC: H04B1/16
Abstract: 本申请公布了一种超再生接收机,包括天线、低噪声放大单元、注入锁定超再生单元、基带信号解调单元和数字控制逻辑单元,注入锁定超再生单元包括依次连接的注入锁定辅助模块和数字控制振荡模块,数字控制振荡模块包括数字控制谐振网络模块和正反馈支路模块;天线接收到的信号经低噪声放大单元放大后进入注入锁定超再生单元,基带信号解调单元对注入锁定超再生单元的输出信号进行解调,数字控制逻辑单元与正反馈支路模块的熄灭信号输入端连接,为正反馈支路模块提供熄灭信号。本申请的超再生接收机能实现频率自校准,具有结构简单、功耗低的优点。
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公开(公告)号:CN102075765B
公开(公告)日:2012-12-05
申请号:CN201010619799.4
申请日:2010-12-31
Applicant: 北京大学深圳研究生院
IPC: H04N7/46
Abstract: 本发明公开了一种色度插值器,包括依次相连的第一级部件、第二级部件和第三级部件,及用于控制所述第一级部件、第二级部件和第三级部件的控制部件;所述第一级部件包括用于实现加法操作操作的第一级运算单元,所述第二级部件包括用于实现加法操作的第二级运算单元,所述第三级部件包括用于实现移位和取整操作的移位取整单元;所述第一级部件、第二级部件、第三级部件和控制部件均由算子实现。本发明还公开了一种基于算子设计的色度插值器的实现方法,可以加快上述色度插值器的集成电路实现。
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公开(公告)号:CN102075762A
公开(公告)日:2011-05-25
申请号:CN201010619869.6
申请日:2010-12-31
Applicant: 北京大学深圳研究生院
IPC: H04N7/36
Abstract: 本发明公开了一种用于视频编码器的帧间预测器的实现方法,包括:将高级程序语言算法描述的视频编码器的帧间预测器的各个功能块映射成由算子单元构成的硬件逻辑描述;由所述算子单元构成的硬件逻辑描述生成帧间预测器硬件集成电路。通过上述可以加快帧间预测器的集成电路实现速度。本发明还公开了一种依据上述方法得到的帧间预测器。
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公开(公告)号:CN102075762B
公开(公告)日:2012-12-05
申请号:CN201010619869.6
申请日:2010-12-31
Applicant: 北京大学深圳研究生院
IPC: H04N7/36
Abstract: 本发明公开了一种用于视频编码器的帧间预测器的实现方法,包括:将高级程序语言算法描述的视频编码器的帧间预测器的各个功能块映射成由算子单元构成的硬件逻辑描述;由所述算子单元构成的硬件逻辑描述生成帧间预测器硬件集成电路。通过上述可以加快帧间预测器的集成电路实现速度。本发明还公开了一种依据上述方法得到的帧间预测器。
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公开(公告)号:CN102075765A
公开(公告)日:2011-05-25
申请号:CN201010619799.4
申请日:2010-12-31
Applicant: 北京大学深圳研究生院
IPC: H04N7/46
Abstract: 本发明公开了一种色度插值器,包括依次相连的第一级部件、第二级部件和第三级部件,及用于控制所述第一级部件、第二级部件和第三级部件的控制部件;所述第一级部件包括用于实现加法操作操作的第一级运算单元,所述第二级部件包括用于实现加法操作的第二级运算单元,所述第三级部件包括用于实现移位和取整操作的移位取整单元;所述第一级部件、第二级部件、第三级部件和控制部件均由算子实现。本发明还公开了一种基于算子设计的色度插值器的实现方法,可以加快上述色度插值器的集成电路实现。
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