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公开(公告)号：CN119668811A
公开(公告)日：2025-03-21
申请号：CN202411809599.3
申请日：2024-12-10
Applicant: 哈尔滨工业大学
Abstract: 本发明公开了一种NPU分时复用的实时推理系统和调度方法，属于边缘智能计算技术领域，解决了现有技术中传统的边缘智能计算服务设备和推理调度方法难以保证多推理任务推理实时性的问题；本发明在预处理阶段通过准备态预分割器对智能推理模型进行转换，即：结合单位粒度将智能推理模型划分为不同粒度的分块，并获取模型及其分块的运行属性信息；在执行阶段通过运行时规划器接收远程过程调用的任务请求，再通过非线性优化确定最优调度粒度，并根据低切分的NPU实时调度算法生成相应任务调度序列，通过运行时执行器根据作业序列获取任务需要的模型分块并进行执行。本发明有效提高了多任务场景下边缘智能推理计算任务分时复用NPU资源的实时性。
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公开(公告)号：CN118915908B
公开(公告)日：2025-02-11
申请号：CN202410943642.9
申请日：2024-07-15
Applicant: 哈尔滨工业大学
Abstract: 一种运动中的手势数据处理方法、电子设备及存储介质，属于用户交互技术领域。为解决运动状态下的手势进行精准的数据处理，本发明包括使用智能数据手套，采集运动过程中的三轴加速度计数据、运动过程中的三轴陀螺仪数据；对采集的运动过程中的三轴加速度计数据、运动过程中的三轴陀螺仪数据进行对比分析，提取用于运动中的手势识别数据；构建基于手臂运动状态检测的手臂状态分割算法模块，将用于运动中的手势识别数据输入到基于手臂运动状态检测的手臂状态分割算法模块中得到过滤后的动态手势数据；然后将过滤后的动态手势数据输入到基于线段拟合模型比较的动态手势分割算法模块进行手势分割，然后进行数据降噪，得到处理后的运动中的手势数据。
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公开(公告)号：CN118349368B
公开(公告)日：2024-11-08
申请号：CN202410595970.4
申请日：2024-05-14
Applicant: 哈尔滨工业大学
Abstract: 一种面向实时性的虚拟化平台可中断互斥锁的构建方法、电子设备及存储介质，属于实时虚拟化技术领域。为解决现有实时虚拟化技术所忽略的BQL锁等待延迟问题，本发明定义数据结构；基于定义的数据结构，构建锁仲裁机制，采用由所有线程共享的HItex的锁变量lvar对同时发起持锁请求的多个线程进行仲裁；基于得到的无法立刻持有锁的线程，构建锁等待机制，所述锁等待机制在内核态中实现；对得到的线程对锁的等待队列中的vCPU线程，构建可中断等待机制。本发明能够大幅降低最坏情况下的中断延迟及尾延迟，将中断延迟的分布控制在较低水平。HItex能够经受长时间高负载的测试，证明了其能够满足硬实时应用需求。
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公开(公告)号：CN117541629B
公开(公告)日：2024-06-11
申请号：CN202311654007.0
申请日：2023-12-05
Applicant: 哈尔滨工业大学
Abstract: 基于可穿戴头盔的红外图像和可见光图像配准融合方法，属于图像融合技术领域。为解决红外图像和可见光图像精确配准的技术问题。本发明将红外图像、可见光图像分别输入到SHM网络进行人像抠图，得到红外人像图像、可见光人像图像；基于红外人像图像相比于可见光人像图像的缩放因子调整红外人像图像；对调整比例的红外人像图像、可见光人像图像进行像素点配准；对变换后的红外图像；裁剪后的可见光图像进行图像融合，得到融合图像填充到裁剪后的原图像，得到基于可穿戴头盔的红外图像和可见光图像配准融合图像。本发明使用SHM网络提取人像区域，通过定量比较和定性分析，该方法比现有先进的配准和融合方法取得更好的效果。
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公开(公告)号：CN117112627B
公开(公告)日：2024-04-02
申请号：CN202311141724.3
申请日：2023-09-05
Applicant: 哈尔滨工业大学
IPC: G06F16/2455 , G06F11/34 , G06F18/27 , G06F9/455
Abstract: 一种基于计算时延模拟的流拓扑参数优化系统及优化方法，属于流数据处理技术领域。为解决利于较少的资源实现大规模流拓扑的参数调优的问题，本发明评测系统通过Flink客户端连接真实集群中的作业管理器，作业管理器分别连接任务管理器、真实集群的性能指标采集器，真实集群的性能指标采集器连接统计器，统计器连接评测系统；评测系统通过Docker控制器构建模拟集群，Flink客户端连接模拟集群的作业管理器容器，作业管理器容器分别连接模拟集群的性能指标采集器、任务管理器容器，模拟集群的性能指标采集器连接参数优化器，参数优化器分别连接评测系统、Flink客户端。本发明在流拓扑可配置参数的调优过程中有效节省了计算资源。
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Patent Agency Ranking
公开(公告)号：CN117292404A
公开(公告)日：2023-12-26
申请号：CN202311327282.1
申请日：2023-10-13
Applicant: 哈尔滨工业大学
IPC: G06V40/10 , G06V10/764 , G06V10/774 , G06V10/80 , G06V10/26
Abstract: 一种高精度手势数据识别方法、电子设备及存储介质，属于人工智能技术领域。为提高基于数据手套的手势识别的准确率，本发明采集新目标手势数据，构建新目标手势数据集，获取源域手势数据，构建源域手势数据集；基于mPUL算法和TSC算法构建无用手势过滤模型；将新目标手势数据，利用构建的无用手势过滤模型进行手势过滤，得到目标域手势数据，构建目标域手势数据集；构建基于迁移学习的跨域手势识别模型；将采集的源域手势数据集、目标域手势数据集输入到构建的基于迁移学习的跨域手势识别模型，进行从源域到目标域的手势识别，得到高精度手势数据识别结果。本发明手势识别准确率高。
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公开(公告)号：CN116935724A
公开(公告)日：2023-10-24
申请号：CN202310766026.6
申请日：2023-06-27
Applicant: 哈尔滨工业大学
IPC: G09B23/18 , G06F30/343
Abstract: 用于处理器设计实验课程的FPGA硬件设计验证方法，属于FPGA硬件设计验证技术领域。为提高处理器设计实验过程中分析推断设计错误的原因的速度。本发明对处理器设计实验课程的FPGA硬件设计构建实验方案验证信号；建立待检测FPGA硬件设计实验；进行仿真分析验证，设计测试用例判断仿真分析验证结果是否正确，判断仿真分析验证的结果为错误则输出待检测FPGA硬件设计实验错误提示，判断仿真分析验证的结果为正确则输出正确提示；构建板上分析验证系统，将建立的待检测FPGA硬件设计实验、设计的测试用例输入到板上分析验证系统进行板上分析验证，得到板上分析验证实验结果在FPGA开发板进行显示。
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公开(公告)号：CN116841987A
公开(公告)日：2023-10-03
申请号：CN202310830704.0
申请日：2023-07-07
Applicant: 哈尔滨工业大学
IPC: G06F16/21 , G06F16/2455 , G06F16/25 , G06F9/50 , G06F9/54
Abstract: 多嵌入式数据库缓冲区大小协调优化方法及系统，涉及数据库技术领域，针对现有技术中对嵌入式数据库优化时，往往是逐个进行优化，这一过程在同一个系统中重复执行多次，不但浪费时间且使每一个数据库的缓存大幅增长，导致其他程序运行时，由于内存不足，使得其他程序无法运行的问题，本申请针对嵌入式数据库轻量级的特点，对所有的嵌入式数据库进行统一的优化而不是每个数据库分别优化，提升了优化效率，避免了逐个优化导致的时间浪费。并且本申请通过缩小子函数，将缓冲区按排序恢复到默认大小，以此帮助系统渡过内存使用的高峰期，进而解决了数据库的缓存大幅增长，导致其他程序运行时，由于内存不足，使得其他程序无法运行的问题。
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公开(公告)号：CN104102512B
公开(公告)日：2017-04-26
申请号：CN201410340191.6
申请日：2014-07-17
Applicant: 哈尔滨工业大学
Abstract: 基于外部中断的嵌入式平台IO设备动态识别系统及该系统的IO设备动态识别方法，涉及嵌入式平台的IO设备动态识别技术。它为了解决现有嵌入式平台的IO设备动态识别技术通用性不高的问题。当有IO设备插入对应的接口子板上时，接口子板产生相应的识别信号，该识别信号发送至识别模块后，识别模块产生相应的中断信号，处理器根据该中断信号判断IO设备的种类，并加载相应的驱动程序，使主机系统能够与IO设备进行通信。本发明不需要对设备增加电子数据表格、不需要添加识别所用的存储器件、不需要定制设备，更不需要改造设备的接口物理结构，且能够识别多种IO设备，提高了系统的通用性。本发明适用于嵌入式平台的IO设备动态识别。
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公开(公告)号：CN104778148A
公开(公告)日：2015-07-15
申请号：CN201510158428.3
申请日：2015-04-03
Applicant: 哈尔滨工业大学
IPC: G06F15/76
Abstract: 基于FPGA的动态可重构嵌入式数据协处理平台及采用该平台实现的数据处理方法，涉及嵌入式领域。本发明是为了解决现有的常见的具有硬件加速功能的嵌入式系统无法通过硬件加速处理新增的计算密集型任务，具有通用性差和扩展性差问题。本发明所述根据主处理器热点计算任务从存储单元中选择FPGA内核配置文件，将该文件发送到配置控制单元，配置控制单元收到配置文件后控制时序来完成FPGA动态配置，由主处理单元中的数据收发进程检测到FPGA配置为指定的内核后，将待处理数据发送给FPGA处理单元进行数据处理，并取回FPGA处理后的数据。它可用在嵌入式处理器中。
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