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公开(公告)号：CN101315810A
公开(公告)日：2008-12-03
申请号：CN200810047681.1
申请日：2008-05-12
Applicant: 华中科技大学
IPC: G11C11/413
Abstract: 本发明公开了一种静态随机访问存储器单元，包括锁存电路、位选择电路和单掷开关电路，单掷开关电路的两端分别接锁存电路的第一数据存储节点和第二数据存储节点。与现有的技术相比，本发明的安全自擦除链路可以等效为一个“单掷开关”，它不会影响SRAM的正常工作，只有当SRAM突然掉电的情况下，“单掷开关”才会闭合，在SRAM锁存单元的数据保存节点之间形成一条低阻通路，迫使锁存单元成为一个等势体，完成信息自擦除。这种存储器单元可以有效地保护用户信息，防止SRAM存储的敏感数据和私密信息被窃取和人为攻击，从根本上解决了SRAM的信息残留问题，拓宽了SRAM在领域的应用。
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公开(公告)号：CN119728072A
公开(公告)日：2025-03-28
申请号：CN202410940552.4
申请日：2024-07-15
Abstract: 本发明公开了一种应用于后量子密码算法的抗侧信道攻击的模乘掩码电路，其特征在于，包括：随机数生成单元、模乘单元和控制逻辑单元；随机数生成模块用于生成伪随机数；模乘单元用于将第一输入数据与伪随机数进行模乘运算得到第一初加工数据，第二输入数据与伪随机数的逆元素进行模乘运算得到第二初加工数据；再将第一初加工数据与第二初加工数据进行模乘运算得到最终输出数据；控制逻辑单元用于控制随机数生成单元和模乘单元运行。本发明实施例通过引入伪随机数来增加计算过程的随机性，提高对模板攻击等侧信道攻击的抵抗能力，极大地提高系统的安全性和抗攻击性能，有效的保护了系统免受侧信道攻击。
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公开(公告)号：CN119543934A
公开(公告)日：2025-02-28
申请号：CN202411560138.7
申请日：2024-11-04
Applicant: 华中科技大学
Abstract: 本发明公开了一种基于空时平均与相位插值技术的小数多模分频器电路，包括：三阶噪声整形调制模块、动态元素匹配与相位选择模块、相位切换分频器模块和流水线型相位插值模块；三阶噪声整形调制模块用于将输入分频比进行时间平均，生成瞬时分频比；动态元素匹配与相位选择模块用于将瞬时分频比进行空间平均并产生分频器控制字与相位插值器控制字；相位切换分频器模块用于根据分频器控制字产生对应分频比的时钟信号；流水线型相位插值模块用于根据时钟信号进行相位插值产生精确相位的最终时钟信号。本发明实施例利用各模块的相互配合，实现空时平均技术和相位插值技术的融合，改善了空时平均技术的局限性。
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公开(公告)号：CN113922777B
公开(公告)日：2024-11-19
申请号：CN202111025129.4
申请日：2021-09-02
Applicant: 华中科技大学
IPC: H03G3/30
Abstract: 本发明公开了一种基于E类功率放大器的功率控制电路，属于射频集成电路领域，包括：数字控制模块，产生与目标功率值对应的数字控制比特并输出；数模转换模块，输入连接数字控制模块的输出，将数字控制比特转换为相应的直流偏置电压并通过第一输出端口输出；功率放大模块，输入侧设置偏置电路，偏置电路的偏置节点连接第一输出端口，外部的方波信号在偏置电路的作用下输入到功率放大模块，方波信号为非理想方波信号，直流偏置电压改变方波信号的直流偏置以调节实际输入到功率放大模块的信号的占空比，从而调节功率放大模块的输出功率。利用实际电路中传输的方波信号的非理想特性，通过控制输入信号直流偏置实现占空比调节，简化电路设计复杂度。
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公开(公告)号：CN118869193A
公开(公告)日：2024-10-29
申请号：CN202411070608.1
申请日：2024-08-06
Applicant: 华中科技大学
Abstract: 本发明公开了一种基于RISC‑V扩展指令集的后量子密码处理器包括：锁相环电路模块、指令集构建处理模块和密码处理模块；所述锁相环电路模块用于为所述指令集构建处理模块、密码处理模块提供高频时钟信号；所述指令集构建处理模块用于生成指令集和所述密码处理模块输出的密钥数据，并将所述指令集传输至所述密码处理模块内；所述密码处理模块用于对所述指令集进行解码，根据所述指令集内容进行工作，并将生成的密钥数据传输至所述指令集构建处理模块。本发明实施例通过指令集构建处理模块和密码处理模块相配合，使本发明实施例能够应用在多样化、具有不同安全需求的系统中。
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Patent Agency Ranking
公开(公告)号：CN118337366B
公开(公告)日：2024-10-29
申请号：CN202410581633.X
申请日：2024-05-11
Applicant: 华中科技大学
Abstract: 本发明公开了一种应用于后量子密码算法的抗侧信道攻击的乱序NTT电路，包括：控制单元、运算单元和存储单元；存储单元用于存储输入数据和输出数据，并将输入数据和蝶形单元地址传输至运算单元；控制单元用于接收随机数，根据随机数控制存储单元调整运算单元中的蝶形单元的运行顺序；并用于控制存储单元将输入数据传输至运算单元；运算单元用于对输入数据进行数论变换运算，并将输出数据传输至存储单元中，再将存储单元中的输出数据作为下一轮数论变换运算的输入数据进行下一轮数论变换运算，直至所有轮数论变换运算结束。本发明实施例利用随机数的随机性来改变蝶形单元运行顺序，从而实现对侧信道攻击的抵挡，带来安全性能提升。
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公开(公告)号：CN118233094B
公开(公告)日：2024-09-20
申请号：CN202410459219.1
申请日：2024-04-17
Applicant: 华中科技大学
Abstract: 本发明公开了一种适用于后量子密码算法Dilithium的模乘运算电路，包括：用于对输入的一对初始数据进行拆分相乘相加，获得三个中间数据的分项相乘单元，用于对所述三个中间数据进行拆分左移并相加减，获得初步加工数据的分项相加单元，用于对所述初步加工数据拆分左移并相加减，获得二次加工数据；所述二次加工数据与第一预设常数相减，并与二次加工数据比较判断，获得最终输出数据的模归约单元。本发明所述的适用于后量子密码算法Dilithium的模乘运算电路通过将一个高位数据一分为二，能够有效减小乘法运算次数，实现对23×23位乘法运算的高效运算，减少逻辑延迟时间，并且具有更小的面积。
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公开(公告)号：CN114154640B
公开(公告)日：2024-08-23
申请号：CN202111410431.1
申请日：2021-11-25
Applicant: 华中科技大学
Abstract: 本发明实施例涉及信息安全技术领域，并公开了一种用于实现后量子密码Saber算法的处理器，该处理器由硬件实现，并且包括：存储模块，用于存储数据和指令，其中处理器使用自定义的精简指令集，且存储模块中存储的指令为指令集中的指令；功能模块，用于执行后量子密码Saber算法涉及的操作，且功能模块包括以下子模块：第三代安全散列算法SHA3子模块、二进制采样子模块、多项式乘法器、加解密子模块、验证子模块和数据位宽转换子模块；以及控制模块，用于根据存储模块中存储的指令，控制功能模块中的各子模块执行对应的操作，以实现后量子密码Saber算法中的密钥生成、密钥封装和密钥解封中的至少一个。本发明实施例，能够在实现高效性的同时，节约资源开销。
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公开(公告)号：CN114827505B
公开(公告)日：2024-05-14
申请号：CN202210022043.4
申请日：2022-01-10
Applicant: 华中科技大学
Abstract: 一种应用于图像传感器的两步式逐次逼近式模数转换器，包括：采样模块、放大模块、数模转换模块和开关模块；采样模块通过开关模块与放大模块连接，放大模块与数模转换模块连接；开关模块具有第一工作状态、第二工作状态和第三工作状态，开关模块包括多个开关电路，多个开关电路被选择性地导通，以选择性切换开关模块处于第一工作状态、第二工作状态或第三工作状态。本发明仅用单个DAC即实现了一种两步式模数转换器，仅使用N位电容性数模转换器得到了2N位的模数转换器精度，显著降低了模数转换器的面积和功耗。尤其对于图像传感器列级读出电路这种需要较高精度同时面积严格受限的应用中，本发明具有显著优势。
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公开(公告)号：CN113762480B
公开(公告)日：2024-03-19
申请号：CN202111065987.1
申请日：2021-09-10
Applicant: 华中科技大学
IPC: G06N3/0464 , G06N3/06 , G06N5/04 , G06F7/50 , G06F7/523
Abstract: 本发明公开了一种基于一维卷积神经网络的时间序列处理加速器，属于人工智能与集成电路设计领域，包括：输入处理模块，包括N行寄存器组，第一行寄存器组中寄存器的个数为N，各行寄存器组中寄存器的个数逐行减一；在全局控制模块的协同控制下，各推理数据依次经寄存器reg1N输入，在第一行寄存器组中横向流动后通过寄存器reg11输出，第一行寄存器组中的数据在各行寄存器组中纵向流动后通过寄存器regnn输出，n＝2,3,…,N；卷积运算阵列对输入处理模块输出的数据进行卷积运算及激活，池化处理模块对激活结果进行池化后输出，全连接处理模块对激活结果进行全连接加法运算后输出。实现推理数据复用，降低推理数据的搬移量，提高网络运算效率及可配置性。
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