一种带有单端电路补偿结构的低噪声放大器

    公开(公告)号:CN102332867B

    公开(公告)日:2014-08-06

    申请号:CN201110206157.6

    申请日:2011-07-22

    Applicant: 复旦大学

    Abstract: 本发明属于射频集成电路技术领域,具体为一种带有单端电路补偿结构的低噪声放大器。本发明包括输入匹配级、放大级、负载级、反馈级和单端电路补偿级;本发明在单端电路接地点处提供一个反相信号,该反相信号与单端电路提供的信号在芯片内接地处形成一个交流信号虚地点,以最大限度消除片外非理想因素对片内单端电路的影响。本发明结构简单,实用性强,可以很好的解决片内单端电路对于片外电源和地非理想因素的敏感问题。

    一种X波段5位有源本振移相器

    公开(公告)号:CN103746670A

    公开(公告)日:2014-04-23

    申请号:CN201410014004.5

    申请日:2014-01-13

    Applicant: 复旦大学

    Inventor: 李巍 陈昌铭 李宁

    Abstract: 本发明属于集成电路技术领域,涉及一种应用于X波段(8~12GHz)相控阵接收机中移相器的设计。它由一个变压器式巴伦、一个多相滤波器、四个子移相器和一个合成电路组成,如图1。其中四个子移相器的移相精度为3位,即子移相器以45°为移相步进值在0~360°范围内总共实现8种移相状态,如图3。由这四个移相器及其余电路组成的X波段移相器的移相精度为5位,即该移相器以11.25°为移相步进值在0~360°范围内总共实现32种移相状态。首先单端输入信号VIN经过一个变压器式巴伦得到差分信号VIN+和VIN-,它们经过一个多相滤波器后得到一组正交差分信号VIN_I+、VIN_I-、VIN_Q+和VIN_Q-,它们是子移相器的输入,四个子移相器的输出信号经过合成电路合成之后就得到输出信号VOUT+和VOUT-。

    一种时间偏差选择电路
    13.
    发明公开

    公开(公告)号:CN103580696A

    公开(公告)日:2014-02-12

    申请号:CN201210277401.2

    申请日:2012-08-06

    Applicant: 复旦大学

    Inventor: 李巍 纪伟伟

    Abstract: 本发明属于时间测量技术领域,具体涉及一种时间偏差选择电路,该电路为应用于由两级时间数字转换器构成的时间测量电路。本发明时间偏差选择电路由选择信号发生器,延时模块和选通模块组成,选通模块采用两个完全相同的多选一线性选择器组成,其中一个选择器(MUX)为有效的选择器,另一选择器为伪选择器(D-MUX)。选择器(MUX)和伪选择器(D-MUX)输入同为合并输入{D ,STOP}的延时输出{A ,B},以最小程度的引入传输延时的偏差。本发明时间偏差选择电路的结构简单、合理,可以实现有效的偏差选择,既实现了正确的偏差选通,又避免了引入过多的时间偏差,尤其是非线性偏差,有效克服了两级结构的TDC时间测量的技术难点。

    应用于超宽带系统的单端输入差分输出的射频前端电路

    公开(公告)号:CN101902242B

    公开(公告)日:2013-10-16

    申请号:CN201010225539.9

    申请日:2010-07-14

    Applicant: 复旦大学

    Abstract: 本发明属于射频无线接收机集成电路技术领域,具体为一种应用于超宽带系统的单端输入差分输出的射频前端电路。它由低噪声放大器(LNA)和正交混频器(Mixer)组成。其中低噪声放大器采用单端输入差分输出结构,由两级构成,以适用于超宽带系统所要求的较大的输入信号范围;正交混频器由I、Q两路构成,且两路公用输入放大管,同时该混频器采用电流注入技术,并且将电流注入管作为输入放大管的一部分以提高混频器性能。LNA和Mixer之间通过一个单位增益缓冲器连接,以减小Mixer较大的输入电容对LNA负载的影响。本发明结构简单,增益可变,功耗低,使用频带宽,且芯片面积小,减少片外元件的使用,便于实现单芯片集成。

    一种可实现宽频率范围调谐的片上可变电感

    公开(公告)号:CN103325793A

    公开(公告)日:2013-09-25

    申请号:CN201310200688.3

    申请日:2013-05-27

    Applicant: 复旦大学

    Inventor: 李巍 朱宁

    Abstract: 本发明属于集成电路技术领域,具体为一种用标准集成电路工艺设计,可实现宽频率范围调谐的片上可变电感。该可变电感基于互感的基本原理,由五个电感L1~L5组成,每一个电感由最高层的金属互连线实现。采用晶体管M1~M3作为开关,控制电感L2~L5中电流的通断,从而改变主线圈L1中的等效电感值。线圈L3和L4作为同一个电感使用,采用相同的晶体管M2控制,以保持可变电感的对称性。通过对可变电感的性能仿真、原理分析,以及电路实验论证,说明本发明提出的可变电感具有品质因素高的特点。

    基于相位旋转的训练序列的I/Q失配估计和补偿方法

    公开(公告)号:CN101562591B

    公开(公告)日:2013-07-31

    申请号:CN200910051012.6

    申请日:2009-05-12

    Applicant: 复旦大学

    Abstract: 本发明属于超宽带无线通信技术领域,具体为一种基于相位旋转的训练序列的I/Q失配估计和补偿方法。本发明针对原有ECMA-368训练序列附加一定的相位旋转,生成四个彼此关联的新训练序列,通过四个训练序列中能量较大部分作为估计信息,使得原有ECMA-368训练序列可以用于频域的I/Q失配估计,而且提高了用于估计I/Q失配参数信息的信噪比,使得I/Q失配补偿算法获得完整的分集增益,从而显著提高多带正交频分复用超宽带系统的误码率性能。

    一种基于并行分层译码算法的LDPC码译码器

    公开(公告)号:CN102347775B

    公开(公告)日:2013-07-10

    申请号:CN201110262178.X

    申请日:2011-09-06

    Applicant: 复旦大学

    Abstract: 本发明属于集成电路设计技术领域,具体涉及一种基于并行分层译码算法的LDPC码译码器。该译码器设计基于并行分层译码算法,且输入的待译码数据存储于寄存器链中;所述译码器使用两条寄存器链形成乒乓结构,即当其中一条寄存器链接收新的待译码数据并同时输出已经完成译码的数据时,另一条寄存器链含有待译码数据的寄存器链被划分为M条子链,并进行译码操作,M等于LDPC校验矩阵所含子矩阵列数;每条子链对应校验矩阵中一列子矩阵,并存储此列子矩阵对应的待译码数据。本发明通过使用寄存器链,避免在芯片设计中使用过多存储单元,从而进一步降低基于并行分层译码算法的译码器芯片面积,并保持较高的译码速率。

    0~10MHz程控宽带运算放大器

    公开(公告)号:CN102882480A

    公开(公告)日:2013-01-16

    申请号:CN201210241933.0

    申请日:2012-07-13

    Applicant: 复旦大学

    Abstract: 本发明属于自动控制技术领域,具体为一种0~10MHz程控宽带放大器。该程控宽带放大器采用多级级联的方式,整条多级放大链路由前级、中级、程控放大电路、D/A转换器、单片机、反相器、末级功率放大电路、二极管峰值检波电路组成,其中,程控放大电路放置在前级与中级放大电路之间;二极管峰值检波电路连接于中级放大电路之后;单片机连接于二极管峰值检波电路与D/A转换器之间,反相器连接于D/A转换器与程控放大电路之间;本发明能够对从直流信号到10MHz带宽内的交流小信号进行0~60dB稳定放大及增益可控调节,并且由末级功率放大实现对50Ω负载的驱动,可广泛适用于自动控制仪表、医疗电子仪器、电子测量仪器等。

    一种实现混合基FFT末级重排序的映射迭代算法

    公开(公告)号:CN102708092A

    公开(公告)日:2012-10-03

    申请号:CN201210157944.0

    申请日:2012-05-21

    Applicant: 复旦大学

    Abstract: 本发明属数字集成电路与系统技术领域,具体涉及实现混合基FFT末级重排序的映射迭代算法。FFT的末级重排序模块是保证采用DIF-FFT情况下实现队列顺序输出的必要环节。以往对于这一问题的处理普遍采用bit-reversal算法,但其受限于输入点数必须满足,不具备一般性。本发明针对这一情况提出了基于映射迭代的算法,实现了对于任意输入点数为非2的整数次幂时序列的自然顺序输出,对于任意输入点数满足是非零自然数的混合基的方式分解的FFT给出统一的重排序算法。

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