设计集成电路的方法与使用该方法的计算机系统

    公开(公告)号:CN101887469A

    公开(公告)日:2010-11-17

    申请号:CN200910253458.7

    申请日:2009-12-16

    Abstract: 本发明提供设计集成电路(IC)的方法及使用该方法的计算机系统,包括:进行IC设计的布局(placing),其中IC设计包括第一元件、第二元件,以及路径耦接第一和第二元件;进行IC设计的布线(routing);取得关于一路径的电阻数据和电容值数据的至少一个;取得关于路径的时序数据;使用电阻数据、电容值数据与时序数据的至少一个,用以决定路径的关键尺寸变化;以及修正IC设计,其中修正的步骤包括进行路径的关键尺寸变化。本发明能够降低20%的功率需求,并且增加5-10%的执行效能。另一潜在优点是提供一种额外的因素予IC设计者,使IC设计者通过该因素调整IC以符合设定时序需求和/或保持时序需求。

    消除微影制程中线末端变短效应的方法及其所使用的罩幕组

    公开(公告)号:CN1450409A

    公开(公告)日:2003-10-22

    申请号:CN02106272.2

    申请日:2002-04-08

    Abstract: 本发明提供一种消除微影制程中线末端变短效应的方法,其步骤为:(1)曝光此感光层于第一罩幕下,其中将感光层所欲形成的图案上的每一条线或开口的末端往外延伸一第一延长部分所形成的图案,即为第一罩幕的图案;(2)曝光此感光层于第二罩幕下,其中第二罩幕的图案包含至少一开口,且当第一、第二罩幕重叠时,第一罩幕上的任一个第一延长部分以及此第一延长部分往外延伸的一第二延长部分刚好与第二罩幕的图案上的一个开口重叠,而第二罩幕的图案上的所有开口刚好只将第一罩幕上的所有第一延长部分以及第二延长部分覆盖住。所述第一延长部分以及第二延长部分的长度大于或等于感光层上的欲形成图案上的线或开口的末端因为光学近接效应所缩短的量。

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