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公开(公告)号：CN118101430A
公开(公告)日：2024-05-28
申请号：CN202410011847.3
申请日：2024-01-04
Applicant: 北京全路通信信号研究设计院集团有限公司
IPC: H04L41/0654 , H04L41/0681 , H04L41/0686 , H04L67/561 , H04L69/22
Abstract: 本发明公开了一种通信延迟的处理方法及系统，所述方法应用于通信延迟的处理系统，系统包括源发送设备、通信转发设备和目的接收设备，方法包括：通过所述源发送设备发送数据包；通过所述通信转发设备接收所述数据包，并发送所述数据包对应的数据信息至所述目的接收设备，所述数据信息包括所述数据包和第一中间延迟数据，所述第一中间延迟数据用于表示所述源发送设备至所述通信转发设备的通信延迟；通过所述目的接收设备基于接收的数据信息确定所述数据包的目标延迟数据。该方法通过通信转发设备将包含数据包和第一中间延迟数据的数据信息发送至目的接收设备，丰富了通信延迟的处理方法，保证了系统的安全性。
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公开(公告)号：CN116714646B
公开(公告)日：2023-10-31
申请号：CN202310982014.7
申请日：2023-08-07
Applicant: 北京全路通信信号研究设计院集团有限公司
IPC: B61L27/60
Abstract: 本发明公开了一种线路测试序列生成方法、装置、设备和介质。该方法包括：获取待测线路的待测内容；根据所述待测内容，选择基准公里标和所述基准公里标对应的里程系方向，建立所述待测线路关联的里程坐标系；根据建立的里程坐标系，对所述待测线路的公里标进行位置次序排序，生成公里标链表；将所述待测内容与所述公里标链表中对应的公里标建立映射关系，生成所述待测内容的测试序列，所述测试序列用于基于所述测试内容对所述待测线路进行列控系统数据测试，以得到待测内容的实测数据。本发明实施例的技术方案适用于多里程系的复杂场景，能够增加线路测试序列生成方法的灵活性和适应性，提高线路测试序列生成的效率和准确性。
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公开(公告)号：CN116886564A
公开(公告)日：2023-10-13
申请号：CN202310981733.7
申请日：2023-08-04
Applicant: 北京全路通信信号研究设计院集团有限公司
IPC: H04L43/0823 , G08G1/01
Abstract: 本发明公开了一种故障检测方法、装置、电子设备和存储介质，涉及轨道交通领域。其中，方法包括：在当前通信周期，按照目标故障对应的检测机制，对部署于云平台的ATS系统进行检测，得到所述目标故障对应的检测字段；将所述检测字段发送到联锁设备中，使得联锁设备根据所述检测字段，确定所述ATS系统在所述当前通信周期内是否发生目标故障。本发明方案在ATS系统中增加了检测机制，进而将检测到的字段发送到联锁设备中，利用联锁设备本身高安全性的特点，对ATS系统的状态进行第三方的监督，可及时发现ATS系统中存在的目标故障，有效保证了ATS系统安全功能的实现。
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公开(公告)号：CN114461703B
公开(公告)日：2022-08-09
申请号：CN202210382747.2
申请日：2022-04-13
Applicant: 北京全路通信信号研究设计院集团有限公司
IPC: G06F16/2458 , G06F7/58 , G06Q50/26
Abstract: 本发明公开了一种多通道数据处理方法、装置、电子设备和存储介质。包括：将组合式故障安全架构中各通道对应功能模块独立产生的不一致数据发给所述组合式故障安全架构中其他每个通道；将所述各通道对应功能模块独立产生的不一致数据和收到的所述组合式故障安全架构中其他每个通道对应功能模块独立产生的不一致数据，按照预设的数据处理方法，在所述组合式故障安全架构中的每个通道独立处理，得到各通道独立处理后的新数据；根据所述各通道独立处理后的新数据，确定各通道的后续输入数据。能够提高组合式故障安全技术对通道异常的识别能力和适用性，发挥组合式故障安全技术的作用，提高了安全性，保障了通道的独立性。
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公开(公告)号：CN114826600A
公开(公告)日：2022-07-29
申请号：CN202210176358.4
申请日：2022-02-25
Applicant: 北京全路通信信号研究设计院集团有限公司
Abstract: 本申请实施例公开了一种关键指令确认方法、装置、介质及电子设备。所述方法包括：响应于关键指令确认请求，基于关键指令确认请求中的指令确认矩阵获取用户确认数据；利用第一私钥对指令确认序列进行加密处理，将得到的加密结果确定为第一数字签名；根据用户确认数据和第一数字签名生成指令确认反馈，并将指令确认反馈发送至第二设备，以供第二设备对所述指令确认反馈中的第一数字签名和用户确认数据进行验证，根据验证结果确定是否执行关键指令；其中，第一设备的安全完整性等级低于第二设备。执行本申请实施例保证了关键指令确认的准确性，降低了关键命令下发错误的可能性，可以为关键指令的安全执行提供了保证。
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Patent Agency Ranking
公开(公告)号：CN114461703A
公开(公告)日：2022-05-10
申请号：CN202210382747.2
申请日：2022-04-13
Applicant: 北京全路通信信号研究设计院集团有限公司
IPC: G06F16/2458 , G06F7/58 , G06Q50/26
Abstract: 本发明公开了一种多通道数据处理方法、装置、电子设备和存储介质。包括：将组合式故障安全架构中各通道对应功能模块独立产生的不一致数据发给所述组合式故障安全架构中其他每个通道；将所述各通道对应功能模块独立产生的不一致数据和收到的所述组合式故障安全架构中其他每个通道对应功能模块独立产生的不一致数据，按照预设的数据处理方法，在所述组合式故障安全架构中的每个通道独立处理，得到各通道独立处理后的新数据；根据所述各通道独立处理后的新数据，确定各通道的后续输入数据。能够提高组合式故障安全技术对通道异常的识别能力和适用性，发挥组合式故障安全技术的作用，提高了安全性，保障了通道的独立性。
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公开(公告)号：CN117119145A
公开(公告)日：2023-11-24
申请号：CN202310869081.8
申请日：2023-07-14
Applicant: 北京全路通信信号研究设计院集团有限公司
IPC: H04N7/18
Abstract: 本发明涉及一种DMI图像信息获取和传输方法、系统、设备和介质，所述DMI图像信息获取和传输方法包括以下步骤：基于显存抓取获取DMI图像数据；构建基于大小周期的数据传输规则，基于所述数据传输规则对所述DMI图像数据进行传输。本发明采用自动抓取和传输，相对于测试人员人眼观察记录，本方法关键信息无遗漏，测试效率更高质量更好；基于大小周期的数据传输规则、基于传输“增量块”结构的数据传输协议、识别增量与发送并行的DMI增量数据处理方式等方法相互组合和支持，使得DMI设备在存在内存小、CPU型号限制、内核指令集少、以太网通信速率低、运算能力低、DMI图像更新周期短等限制的前提下，仍满足DMI实时复显需求。
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公开(公告)号：CN115981879B
公开(公告)日：2023-05-23
申请号：CN202310251376.9
申请日：2023-03-16
Applicant: 北京全路通信信号研究设计院集团有限公司
IPC: G06F9/52
Abstract: 本发明公开了一种冗余结构的数据同步方法、装置、设备及存储介质。该方法包括：根据组成目标进程的模块，确定运行所述目标进程的周期中的数据同步点和所述数据同步点的同步条件；在运行所述目标进程的过程中，若满足目标数据同步点的目标同步条件，则向备系发送所述目标数据同步点对应的同步数据和同步点信息。本发明实施例可以提高冗余结构下的系统可用性和安全性。
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公开(公告)号：CN115168189A
公开(公告)日：2022-10-11
申请号：CN202210718245.2
申请日：2022-06-21
Applicant: 北京全路通信信号研究设计院集团有限公司
IPC: G06F11/36
Abstract: 本发明涉及一种基于虚拟串口的DMI软件自动控制方法及系统，所述控制方法包括虚拟按键控制，虚拟按键控制包括：通过虚拟按键完成信息采集，并将采集到的信息传递至控制软件；控制软件接收虚拟按键发送的信息并对信息进行处理和计算；控制软件通过虚拟串口组对DMI软件进行控制。所述控制系统包括虚拟按键控制模块，虚拟按键控制模块包括：虚拟采集单元、信息处理单元和控制单元。本发明不需要测试人员通过手动的方式操作DMI人机界面，一方面能够提高测试效率，为自动测试的实现创造了有利条件，另一方面，测试人员在PC机上进行控制，能够避免测试人员直接控制DMI软件时受到辐射影响身体健康的情况出现，确保测试人员的安全。
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公开(公告)号：CN115098399A
公开(公告)日：2022-09-23
申请号：CN202210844754.X
申请日：2022-07-18
Applicant: 北京全路通信信号研究设计院集团有限公司
Abstract: 本发明属于软件开发领域，特别涉及一种用于数据同步应用程序开发的测试方法及模型，用于解决双系统同步测试成本过高和数据校验不易发现错误的问题。本发明对于需要进行数据同步的应用，单系工作时，设置同步数据自测试模式，模拟双系同步工作的机制，实现同步数据的自发自收处理，从而仅单系就可发现同步数据设计不充分，降低了成本。本发明处于同步数据自测试模式时，周期开始就将所有的全局变量进行初始化操作，以模拟程序刚投入时的状态，如果同步数据不充分，由于清除了所有全局变量，程序会表现异常，从而保证了同步数据的充分性，并减少对同步测试的依赖。
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