用以改进CIS中ADC范围的列斜坡缓冲器设计

    公开(公告)号:CN119450253A

    公开(公告)日:2025-02-14

    申请号:CN202410660613.1

    申请日:2024-05-27

    Abstract: 本申请涉及一种用以改进CIS中ADC范围的列斜坡缓冲器设计。一种成像系统包括像素阵列及耦合到所述像素阵列的读出电路系统。所述读出电路系统包含斜坡产生器及多个列单元胞元,每一列单元胞元包括列斜坡缓冲器及列比较器,且每一列斜坡缓冲器包括经耦合以接收来自所述斜坡产生器的斜坡信号的输入节点、具有耦合到所述输入节点的栅极端子及耦合到电力线的漏极端子的晶体管、耦合于所述晶体管的源极端子与所述列比较器之间的输出节点以及耦合于所述输入节点与所述晶体管之间的交流AC耦合单元。所述AC耦合单元包括耦合于所述输入节点与所述晶体管的所述栅极端子之间的电容器,以及耦合于所述输入节点与所述晶体管的所述栅极端子之间的复位开关。

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