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公开(公告)号：CN109872753A
公开(公告)日：2019-06-11
申请号：CN201811341923.8
申请日：2018-11-12
Applicant: 瑞萨电子株式会社
IPC: G11C16/10
Abstract: 降低了半导体器件的功耗。根据实施例的半导体器件包括：多个电路；总线电路，包括临时存储电路之间的通信数据的多个缓冲器、以及对电路与缓冲器之间的访问进行仲裁的多个仲裁电路；存储单元，存储基于电路之间的通信期间的缓冲器的使用状态的信息，以及存储配置信息，该配置信息包括电路中未用于通信的未使用电路的指定；以及控制电路，控制总线电路，以便基于配置信息来停止缓冲器中未用于通信的未使用缓冲器的使用，以及停止仲裁电路中与未使用电路相对应的仲裁电路中的至少部分配置。
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