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公开(公告)号：CN112073058B
公开(公告)日：2022-08-12
申请号：CN202010856429.6
申请日：2020-08-24
Applicant: 烽火通信科技股份有限公司
IPC: H03L7/08
Abstract: 本发明公开了一种基于FPGA的时钟数据恢复电路和方法，时钟数据恢复电路包括：依次连接的延时模块、采样模块、判别模块和时钟调整模块；延时模块接收待恢复的数据信号，用于对待恢复的数据信号进行延迟，得到两路经过延迟的数据信号；采样模块用于分别对两路经过延迟的数据信号进行采样，得到两路采样数据，将两路采样数据进行交替间插拼接，得到一组目标采样数据，判别模块用于获取本组目标采样数据的跳变沿位置与上一组目标采样数据的跳变沿位置的变化情况，根据跳变沿位置的变化情况确定时钟调整标志；时钟调整模块用于根据时钟调整标志调整下一个时钟周期，生成恢复时钟信号。在本发明中，在保证时钟恢复精度的情况，节约了全局时钟资源。
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公开(公告)号：CN109981205A
公开(公告)日：2019-07-05
申请号：CN201910133627.7
申请日：2019-02-22
Applicant: 烽火通信科技股份有限公司
Abstract: 本发明公开了一种1PPS+TOD信号的传输方法及系统，涉及时间同步信号传输领域。该方法的步骤包括：发送端识别到1PPS信号的上升沿后，生成1PPS指示信号，在TOD信号接收完成后生成帧定位信号；发送端将帧定位信号、1PPS指示信号和TOD信号复用在一根信号线进行传输；接收端收到帧定位信号后，检测1PPS指示信号，根据检测到的1PPS指示信号恢复1PPS信号；检测到1PPS指示信号后获取TOD信号。本发明能够在降低背板互连线的资源占用率的同时，提高1PPS+TOD信号的时间同步精度。
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公开(公告)号：CN102665151A
公开(公告)日：2012-09-12
申请号：CN201210122143.0
申请日：2012-04-24
Applicant: 烽火通信科技股份有限公司
Abstract: 本发明涉及一种分组传送网中SDH业务DCC开销的处理方法及装置，包括外接SDRAM，且该装置采用基于SDRAM的三级缓存结构，第一级缓存存在于以太网到多路HDLC解复用模块中，第二级缓存为SDRAM，第三级缓存存在于HDLC发送处理模块中，第一和第三级缓存辅助第二级缓存完成多路并行DCC开销数据的存贮转发功能，完成背板侧以太网时钟速率和线路侧开销时钟速率的适配功能；第二级缓存SDRAM的空间分配依据需要处理的DCC开销路数均匀分配。本发明所述的处理方法及装置，通过外接SDRAM缓解DCC开销处理对RAM资源的需求，可进行多路DCC开销处理，且设计了基于SDRAM的三级缓存结构，它可以有效解决多路DCC开销数据的并行传输需求。
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公开(公告)号：CN101394310A
公开(公告)日：2009-03-25
申请号：CN200810225516.0
申请日：2008-11-04
Applicant: 烽火通信科技股份有限公司
Abstract: 本发明涉及一种基于带内方式构建管理通信网和信令通信网的装置和方法。采用STM－N帧结构中的DCC字节和其他预留的开销字节作为DCN的物理通道传送管理平面信息和控制平面信息；其中，管理平面的数据通信网(MCN)的物理通道可以是DCCR(RSOH中的D1～D3字节)或DCCM(MSOH中的D4～D12字节)，控制平面的数据通信网(SCN)的物理通道可以是DCCM或STM－N帧结构中其他预留的开销字节。它相对于只采用ECC通道来实现自动交换光网络(ASON)的带内DCN的方法，扩展了ASON DCN的带宽，从而可以提高ASON DCN的网络性能。
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公开(公告)号：CN112953669A
公开(公告)日：2021-06-11
申请号：CN201911267245.X
申请日：2019-12-11
Applicant: 烽火通信科技股份有限公司
IPC: H04J3/06
Abstract: 本发明公开了一种提高时间戳精度的方法及系统，涉及时间同步领域，该方法包括将秒脉冲信号或OTN业务处理芯片输出的帧定位标识信号发送至FPGA的LVDS SERDES接口；通过LVDS SERDES接口得到帧定位标识信号的上升沿位置，同时生成一个实时时间采样指示信号，并取当前的实时时间作为初始时间戳T；基于实时时间采样指示信号对应的非零采样值，生成采样误差补偿值△t1；基于统计结果得到当前的过采样状态，且不同的过采样状态对应不同的过采样误差补偿值△t2，则最终的时间戳等于初始时间戳T、采样误差补偿值△t1和过采样误差补偿值△t2三者之和。本发明实施简单，对FPGA器件的时序要求较低。
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Patent Agency Ranking
公开(公告)号：CN111800212A
公开(公告)日：2020-10-20
申请号：CN202010536368.5
申请日：2020-06-12
Applicant: 烽火通信科技股份有限公司
Abstract: 本发明实施例提供了一种时间戳抖动补偿方法及装置，方法包括：基于1588时钟，对第一系统时钟域的时间戳采样标识信号进行时钟同步，得到1588时钟域的时间戳采样标识信号；基于系统时钟，对所述1588时钟域的时间戳采样标识信号进行时钟同步，得到第二系统时钟域的时间戳采样标识信号；根据所述第一系统时钟域的时间戳采样标识信号和第二系统时钟域的时间戳采样标识信号之间的间隔周期，进行时间戳延时补偿。本发明实施例提供的一种时间戳抖动补偿方法及装置，通过放大系统时钟域的时间戳采样标识信号同步导致的误差，然后进行鉴别补偿的方式，对时间戳的抖动进行了有效补偿。
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公开(公告)号：CN109981205B
公开(公告)日：2020-07-28
申请号：CN201910133627.7
申请日：2019-02-22
Applicant: 烽火通信科技股份有限公司
Abstract: 本发明公开了一种1PPS+TOD信号的传输方法及系统，涉及时间同步信号传输领域。该方法的步骤包括：发送端识别到1PPS信号的上升沿后，生成1PPS指示信号，在TOD信号接收完成后生成帧定位信号；发送端将帧定位信号、1PPS指示信号和TOD信号复用在一根信号线进行传输；接收端收到帧定位信号后，检测1PPS指示信号，根据检测到的1PPS指示信号恢复1PPS信号；检测到1PPS指示信号后获取TOD信号。本发明能够在降低背板互连线的资源占用率的同时，提高1PPS+TOD信号的时间同步精度。
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公开(公告)号：CN105939243A
公开(公告)日：2016-09-14
申请号：CN201610231798.X
申请日：2016-04-14
Applicant: 烽火通信科技股份有限公司
CPC classification number: H04L12/4633 , H04J3/065 , H04L12/4645 , H04L12/467
Abstract: 本发明公开了一种多端口PTP报文的处理系统，涉及通信领域。该系统包括CPU接口模块、实时时间生成模块、发送标志和序列号生成模块、Sync帧发送模块、Delay_Req帧发送模块、Delay_Resp帧发送模块、Announce帧发送模块、Sync帧接收模块、Delay_Req帧接收模块、Delay_Resp帧接收模块、Announce帧接收模块、复用模块、解复用模块、帧监控模块。本发明能有效降低通信网络设备开发成本，能提供灵活的PTP报文的处理方案。
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公开(公告)号：CN119519879A
公开(公告)日：2025-02-25
申请号：CN202411723326.7
申请日：2024-11-28
Applicant: 烽火通信科技股份有限公司
IPC: H04J3/06
Abstract: 本公开属于时间同步技术领域，特别涉及一种时间同步装置、方法、电子设备及存储介质。所述装置包括第一支路，所述第一支路由输入接口模块、时延修正模块和输出接口模块组成，所述输入接口模块、时延修正模块和输出接口模块依次连接；第二支路，所述第二支路包括平均路径时延服务模块，所述平均路径时延服务模块的一端连接输入接口模块，所述平均路径时延服务模块的另一端连接输出接口模块。本公开能够有效解决传统同步方案跟踪过程慢，同步振荡，甚至无法收敛等问题，提升系统同步响应速度和稳定性。
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公开(公告)号：CN114172493B
公开(公告)日：2024-11-26
申请号：CN202111421100.8
申请日：2021-11-26
Applicant: 烽火通信科技股份有限公司
Abstract: 本发明公开了一种频率锁定的判断方法及电路，涉及电子电路技术领域，所述判断方法包括：步骤S10，根据参考时钟信号和待测时钟信号分别生成计数信号和分频时钟信号；步骤S20，根据参考时钟信号、计数信号和分频时钟信号生成具有相位差的两个再生时钟信号；步骤S30，根据参考时钟信号分别对两个再生时钟信号进行计数；步骤S40，根据计数结果判断待测时钟信号是否锁定参考时钟信号。本发明根据计数信号和分频时钟信号生成具有相位差的两个再生时钟信号，再根据参考时钟信号分别对两个再生时钟信号进行计数，最后根据计数结果判断待测时钟信号是否锁定参考时钟信号，规避参考时钟信号采样待测时钟信号的分频时钟信号存在亚稳态而导致计数异常的问题。
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