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公开(公告)号：CN103926471B
公开(公告)日：2017-01-25
申请号：CN201410169430.6
申请日：2014-04-25
Applicant: 浙江大学
IPC: G01R29/00
Abstract: 本发明提供的眼开监视器装置在实现信号眼图测试时，使用两个与信号频率相同的眼开测量时钟对所设置的相位点上的眼图打开大小进行测试；设置阈值大小以及在半个周期内对测量时钟相位进行设置；判断所设置的阈值大小在测量时钟处是否在眼图内部，满足在眼图内部的最大阈值便是该时钟相位点处的眼图打开大小；将每个相位点上的眼图打开大小结果保存到寄存器中，在测试完所有相位点后将寄存器的值依序排列，得到了信号眼图的水平与垂直打开大小值。与现有技术相比，本发明提出的眼开监视器电路装置具有无需进行初始时钟与数据的同步操作，测试过程设置与测试结果记录由数字控制
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公开(公告)号：CN107135078B
公开(公告)日：2019-12-20
申请号：CN201710411353.4
申请日：2017-06-05
Applicant: 浙江大学
Abstract: 本发明公开了一种PBKDF2密码算法加速装置，包括由FPGA与通用CPU组成的CPU+FPGA异构系统。本发明还同时提供了一种PBKDF2密码算法加速方法，该方法包含以下步骤：1)、初始化：将预计算部分和在执行PBKDF2算法循环体之前的部分在CPU中进行计算，并将计算结果通过总线接口传输至FPGA；2)、循环：将PBKDF2算法中计算密集的循环体部分放置在FPGA上，利用优化手段提升FPGA上的加速效果以及资源利用效率，并将计算结果通过总线接口传输至CPU；3)、校验：读取FPGA加速计算后得到的结果数据，并执行运算结果汇总以及校验值计算判定。
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公开(公告)号：CN104579574B
公开(公告)日：2017-11-24
申请号：CN201510033143.7
申请日：2015-01-22
Applicant: 浙江大学
IPC: H04L1/00
Abstract: 本发明公开了一种应用于高速背板芯片间电互连系统的网格编码调制方法，该方法涉及应用于高速背板芯片间电互连系统的网格编码调制技术，该方法通过信道编码和信号调制的协同设计，可以在既不增加信道频带宽度，也不降低有效信息传输速率的情况下获得编码增益，提高芯片间串行单链路的性能。该系统发送端包括数据并转串、网格编码调制、前向反馈均衡器，其中网格编码调制采取卷积编码和四电平脉冲幅度调制相结合的手段；接收端包括连续时间线性均衡器、判决反馈均衡器、时钟数据恢复、软判决维特比译码、数据串转并，其中判决反馈均衡器滤波器的系数更新基于软判决维特比译码后的纠错信号。
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Patent Agency Ranking
公开(公告)号：CN104660227A
公开(公告)日：2015-05-27
申请号：CN201510100171.6
申请日：2015-03-07
Applicant: 浙江大学
IPC: H03K7/02
Abstract: 本发明公开了一种适用于多电平脉冲幅度调制的自适应连续时间线性均衡器，包括连续时间线性均衡器等；连续时间线性均衡器接收来自于信道的受干扰信号Vin，并根据控制信号Vctrl的电压大小控制其高频增益对输出的信号进行高频补偿，之后输出信号Veq；多电平接收器接收输出信号Veq，并经过判决及译码后输出两比特的数字信号MSB与LSB；参考电平发生器利用两比特数字信号MSB与LSB再生标准参考信号Vref；反馈信号发生器通过对输出信号Veq和输出信号Vref进行大小比对后输出反馈信号Vfb；积分型电荷泵对反馈信号Vfb进行积分后获得控制信号Vctrl。
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公开(公告)号：CN107135078A
公开(公告)日：2017-09-05
申请号：CN201710411353.4
申请日：2017-06-05
Applicant: 浙江大学
Abstract: 本发明公开了一种PBKDF2密码算法加速装置，包括由FPGA与通用CPU组成的CPU+FPGA异构系统。本发明还同时提供了一种PBKDF2密码算法加速方法，该方法包含以下步骤：1)、初始化：将预计算部分和在执行PBKDF2算法循环体之前的部分在CPU中进行计算，并将计算结果通过总线接口传输至FPGA；2)、循环：将PBKDF2算法中计算密集的循环体部分放置在FPGA上，利用优化手段提升FPGA上的加速效果以及资源利用效率，并将计算结果通过总线接口传输至CPU；3)、校验：读取FPGA加速计算后得到的结果数据，并执行运算结果汇总以及校验值计算判定。
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公开(公告)号：CN104660227B
公开(公告)日：2017-04-19
申请号：CN201510100171.6
申请日：2015-03-07
Applicant: 浙江大学
IPC: H03K7/02
Abstract: 本发明公开了一种适用于多电平脉冲幅度调制的自适应连续时间线性均衡器，包括连续时间线性均衡器等；连续时间线性均衡器接收来自于信道的受干扰信号Vin，并根据控制信号Vctrl的电压大小控制其高频增益对输出的信号进行高频补偿，之后输出输出信号Veq；多电平接收器接收输出信号Veq，并经过判决及译码后输出两比特的数字信号MSB与LSB；参考电平发生器利用两比特数字信号MSB与LSB再生标准参考信号Vref；反馈信号发生器通过对输出信号Veq和输出信号Vref进行大小比对后输出反馈信号Vfb；积分型电荷泵对反馈信号Vfb进行积分后获得控制信号Vctrl。
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公开(公告)号：CN104579574A
公开(公告)日：2015-04-29
申请号：CN201510033143.7
申请日：2015-01-22
Applicant: 浙江大学
IPC: H04L1/00
Abstract: 本发明公开了一种应用于高速背板芯片间电互连系统的网格编码调制方法，该方法涉及应用于高速背板芯片间电互连系统的网格编码调制技术，该方法通过信道编码和信号调制的协同设计，可以在既不增加信道频带宽度，也不降低有效信息传输速率的情况下获得编码增益，提高芯片间串行单链路的性能。该系统发送端包括数据并转串、网格编码调制、前向反馈均衡器，其中网格编码调制采取卷积编码和四电平脉冲幅度调制相结合的手段；接收端包括连续时间线性均衡器、判决反馈均衡器、时钟数据恢复、软判决维特比译码、数据串转并，其中判决反馈均衡器滤波器的系数更新基于软判决维特比译码后的纠错信号。
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公开(公告)号：CN103926471A
公开(公告)日：2014-07-16
申请号：CN201410169430.6
申请日：2014-04-25
Applicant: 浙江大学
IPC: G01R29/00
Abstract: 本发明提供的眼开监视器装置在实现信号眼图测试时，使用两个与信号频率相同的眼开测量时钟对所设置的相位点上的眼图打开大小进行测试；设置阈值大小以及在半个周期内对测量时钟相位进行设置；判断所设置的阈值大小在测量时钟处是否在眼图内部，满足在眼图内部的最大阈值便是该时钟相位点处的眼图打开大小；将每个相位点上的眼图打开大小结果保存到寄存器中，在测试完所有相位点后将寄存器的值依序排列，得到了信号眼图的水平与垂直打开大小值。与现有技术相比，本发明提出的眼开监视器电路装置具有无需进行初始时钟与数据的同步操作，测试过程设置与测试结果记录由数字控制模块自动完成，可获得一个周期内信号眼图打开大小信息的特点。
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