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发明公开
一种基于双口RAM的CPCI总线与控制电路通信接口无效

公开(公告)号：CN113626362A

公开(公告)日：2021-11-09

申请号：CN202110766372.5

申请日：2021-07-07

Applicant: 北京控制与电子技术研究所

Inventor： 王一平 , 陈磊 , 王晓东 , 孙明熙 , 王胜男

IPC: G06F13/40 , G06F13/42

Abstract: 本发明公开了一种基于双口RAM的CPCI总线与控制电路通信接口，包括：CPCI总线桥接芯片、上位机处理器、下位机处理器、双口RAM模块、上位机控制模块、下位机应答模块和下位机执行模块；上位机控制模块向双口RAM模块下行命令存储区写入控制命令，然后读取双口RAM模块上行命令应答存储区与上行数据存储区的数据，根据读取的结果继续向双口RAM模块下行命令存储区写入控制命令，依次循环执行；下位机应答模块的工作过程与上位机控制模块相似。上位机控制模块、下位机应答模块与下位机执行模块按照通信规则在双口RAM模块规定存储区进行数据读写通信。本发明避免了读写冲突，减轻通信负担，实现快速实时数据交换。

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