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公开(公告)号：CN113806248B
公开(公告)日：2025-04-08
申请号：CN202110575180.6
申请日：2021-05-25
Applicant: 三星电子株式会社
IPC: G06F12/0877 , G06F12/02 , G11C11/4096 , G11C29/08
Abstract: 一种存储器模块，包括：第一存储器器件；第二存储器器件；以及，处理缓存器电路，其被连接到第一存储器器件和第二存储器器件(彼此独立)以及主机。提供了一种处理缓存器电路，其包括处理电路和缓存器。处理电路基于从主机接收的处理命令，处理从主机接收的数据、存储在第一存储器器件中的数据、或存储在第二存储器器件中的数据中的至少一项。缓存器被配置为存储由处理电路处理的数据。处理缓存器电路被配置为，按照DDR SDRAM标准与主机通信。
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公开(公告)号：CN113626264A
公开(公告)日：2021-11-09
申请号：CN202110286953.9
申请日：2021-03-17
Applicant: 三星电子株式会社
IPC: G06F11/22 , G06F9/4401
Abstract: 公开了一种存储器模块、计算系统以及计算系统的启动方法。所述计算系统的启动方法，计算系统包括存储器模块，存储器模块包括连接到多个存储器装置的处理装置，所述方法包括：对计算系统上电；在对计算系统上电之后，通过存储器模块中的处理装置对所述多个存储器装置执行第一存储器训练，并且生成指示第一存储器训练的完成的模块就绪信号；在对计算系统上电之后，通过主机装置执行第一启动序列，主机装置执行包括在计算系统中的基本输入/输出系统(BIOS)存储器的BIOS代码；在执行第一启动序列之后，在主机装置中等待将从存储器模块接收模块就绪信号；以及在主机装置中接收模块就绪信号，并且基于模块就绪信号执行第二启动序列。
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公开(公告)号：CN118672940A
公开(公告)日：2024-09-20
申请号：CN202410230857.6
申请日：2024-02-29
IPC: G06F12/0806 , G06F12/0846
Abstract: 提供了用于动态高速缓存分配的处理器、系统和操作方法。所述处理器包括：处理核，所述处理核被配置为通过访问第一存储器和第二存储器中的相应一者来处理多个请求中的每一个请求；延迟监控器，所述延迟监控器被配置为生成第一延迟信息和第二延迟信息，所述第一延迟信息包括对所述第一存储器的第一访问延迟，并且所述第二延迟信息包括对所述第二存储器的第二访问延迟；多个高速缓存线路，所述多个高速缓存线路被划分为第一分区和第二分区；以及决策引擎，所述决策引擎被配置为基于所述第一延迟信息和所述第二延迟信息将所述多个高速缓存线路中的每一个高速缓存线路分配给所述第一分区和所述第二分区之一。
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公开(公告)号：CN118503181A
公开(公告)日：2024-08-16
申请号：CN202311676693.1
申请日：2023-12-08
Applicant: 三星电子株式会社
Abstract: 一种计算系统包括互连装置、电耦接以与所述互连装置通信的多个存储器装置、电耦接以与所述互连装置通信且被配置为产生经由所述互连装置对所述多个存储器装置的访问请求的多个主机装置、以及多个拥塞监视器。这些拥塞监视器被配置为通过实时监视关于多个存储器装置中的至少一个和互连装置的信号传送的拥塞程度来生成拥塞信息。计算系统还被配置为基于所述拥塞信息，控制所述多个主机装置到所述多个存储器装置的存储器区域分配以及所述互连装置内部的信号传送路径中的至少一者。
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公开(公告)号：CN118503160A
公开(公告)日：2024-08-16
申请号：CN202311368293.4
申请日：2023-10-20
Applicant: 三星电子株式会社
Abstract: 公开了存储器扩展器和包括存储器扩展器的计算系统。所述存储器扩展器包括存储器子模块、电源管理集成电路、控制器和电源控制器。存储器子模块存储数据，并且每个存储器子模块包括一个或多个存储器。电源管理集成电路独立地将电力分别供应给存储器子模块。控制器通过接口(例如，计算快速链路(CXL))与外部装置通信，控制存储器子模块的操作，并检查存储器子模块是否异常。电源控制器控制电源管理集成电路的操作。响应于第一存储器子模块变得异常，电源控制器控制第一电源管理集成电路阻断供应给第一存储器子模块的第一电力。
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Patent Agency Ranking
公开(公告)号：CN113806248A
公开(公告)日：2021-12-17
申请号：CN202110575180.6
申请日：2021-05-25
Applicant: 三星电子株式会社
IPC: G06F12/0877 , G06N3/04 , G06N3/08
Abstract: 一种存储器模块，包括：第一存储器器件；第二存储器器件；以及，处理缓存器电路，其被连接到第一存储器器件和第二存储器器件(彼此独立)以及主机。提供了一种处理缓存器电路，其包括处理电路和缓存器。处理电路基于从主机接收的处理命令，处理从主机接收的数据、存储在第一存储器器件中的数据、或存储在第二存储器器件中的数据中的至少一项。缓存器被配置为存储由处理电路处理的数据。处理缓存器电路被配置为，按照DDR SDRAM标准与主机通信。
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公开(公告)号：CN113971139A
公开(公告)日：2022-01-25
申请号：CN202110346383.8
申请日：2021-03-31
Applicant: 三星电子株式会社
Abstract: 提供了存储模块和具有存储模块的存储系统。一种存储模块可以包括命令/地址端子、数据端子、至少一个监测端子、缓冲器和多个半导体存储器件。所述缓冲器可以被配置为接收并缓冲通过所述数据端子施加的数据和通过所述命令/地址端子施加的命令/地址，以生成缓冲的写入数据和缓冲的命令/地址。所述缓冲器可以被配置为对所述缓冲的写入数据和所述缓冲的命令/地址进行缓冲，以生成模块数据和模块命令/地址并进行存储，然后通过所述至少一个监测端子发送所述缓冲的写入数据的所述至少一部分作为监测数据。所述多个半导体存储器件可以被配置为响应于所述模块命令/地址来接收和存储所述模块数据。
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公开(公告)号：CN119556850A
公开(公告)日：2025-03-04
申请号：CN202411024601.6
申请日：2024-07-29
IPC: G06F3/06
Abstract: 本公开提供了存储器系统和运行存储器系统的方法。存储器系统包括：第一存储器；运行速度与第一存储器的运行速度不同的第二存储器；被配置为存储有指令的存储单元；被配置为响应于缓存命中的发生来更新预取器数据的预取器；以及被配置为执行存储在存储单元中的指令的处理器。当执行该指令时，处理器被配置为：通过过滤预取器数据来生成预取器友好数据，基于预取器友好数据，在与第一存储器相对应的第一指针区域和与第二存储器相对应的第二指针区域中设定预取器友好位，并且基于第一指针区域和第二指针区域的引用位和预取器友好位来确定是否迁移第一指针区域和第二指针区域的数据。
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公开(公告)号：CN119496785A
公开(公告)日：2025-02-21
申请号：CN202410449518.7
申请日：2024-04-15
Applicant: 三星电子株式会社
IPC: H04L67/1095 , H04L49/10 , H04L49/90
Abstract: 提供了使数据同步的网络装置、系统和操作CXL交换装置的方法。各种示例实施例可包括用于使数据同步的操作网络装置的方法、包括操作网络装置的计算机可读指令的非暂时性计算机可读介质、包括网络装置的系统和/或计算快速链路(CXL)交换装置。一种基于CXL的系统包括：多个CXL处理装置，其被配置为基于输入矢量数据和子矩阵执行矩阵乘法计算，并且基于矩阵乘法计算的结果输出至少一个中断信号和至少一个数据包，至少一个数据包包括输出矢量数据和与输出矢量数据相关联的特性数据；以及CXL交换装置，其被配置为：使输出矢量数据同步，该同步包括基于中断信号和数据包对输出矢量数据执行计算操作；并且向多个CXL处理装置提供经同步的矢量数据。
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