一种使用快照的可调试性设计追踪方法及装置

    公开(公告)号:CN107066707A

    公开(公告)日:2017-08-18

    申请号:CN201710188024.8

    申请日:2017-03-27

    CPC classification number: G06F17/5081 G06F17/505

    Abstract: 本发明提出一种使用快照的可调试性设计追踪方法及装置,涉及集成电路可调试性设计技术领域,该方法包括步骤1,设置追踪缓存与快照缓存的容量,确定追踪信号的宽度限制与快照信号的宽度限制;步骤2,根据所述追踪信号与所述快照信号的宽度限制,生成寄存器簇并迭代选择寄存器簇,从而确定所述追踪信号与所述快照信号;步骤3,根据所述追踪信号与所述快照信号,设置追踪结构,其中所述追踪结构包括追踪控制器、触发器、追踪总线、追踪缓存、快照缓存。本发明可以显著的提高调试数据的状态恢复率,增加硅后调试的可观测性,缩短硅后调试时间;本发明可以确定性的恢复关键信号;本发明可以减少追踪信号选择方法的运行时间。

    一种芯粒选型方法
    42.
    发明公开

    公开(公告)号:CN119720747A

    公开(公告)日:2025-03-28

    申请号:CN202411746281.5

    申请日:2024-12-02

    Abstract: 本发明提供了一种芯粒选型方法,包括:S1、获取按照指定的芯粒库规范构建的数据形式的芯粒库,其含有多种芯粒及其描述文件;S2、获取待加速的应用,获取应用,利用语义匹配规则将应用转化成任务数据流图,其包括算子及其依赖关系;S3、根据所述芯粒库和任务数据流图,为应用基于多种芯粒组合中的每种芯粒组合分别进行多次分组映射及计算每个任务分组映射方案的性能指标,根据任务分组映射方案的性能指标确定最优的芯粒组合,其中,任务分组映射方案包括多条映射关系,每条映射关系包括应用内的一个算子、该算子的分组序号以及为该算子所分配的运算芯粒。本发明方法可提升芯粒集成系统的选型效率和质量,并且减少人工选型的时间开销以及成本。

    一种芯粒系统的设计方法
    43.
    发明公开

    公开(公告)号:CN118350337A

    公开(公告)日:2024-07-16

    申请号:CN202410460021.5

    申请日:2024-04-17

    Abstract: 本发明实施例提供了一种芯粒系统的设计方法,包括:步骤S1、对一组设计核图进行芯粒化,得到一组芯粒系统和一组芯粒模板,每个芯粒系统包括多个芯粒实例及其之间的通信关系构成的芯粒间通信图,每个芯粒实例采用所述一组芯粒模板中的一种芯粒模板构建;步骤S2、为所述一组芯粒系统中的每个所述芯粒系统的芯粒实例的空间布局进行布局规划,得到一组优化布局;步骤S3、根据所述一组优化布局、一组芯粒模板、一组芯粒间通信图、用户指定的各芯粒模板的设计参数、预设的优化目标和预设的多个约束,确定一组芯粒模板和一组芯粒系统的设计结果。

    一种可重用无源硅中介层的芯片
    44.
    发明公开

    公开(公告)号:CN118099117A

    公开(公告)日:2024-05-28

    申请号:CN202211505068.6

    申请日:2022-11-28

    Abstract: 本发明提出一种基于可重用无源硅中介层的芯片,包括:多个芯粒;基板,用于提供电源、时钟和芯片外部输入输出信号;由多个瓦片构成的可重用无源硅中介层,每个瓦片表面和底面均具有凸块,通过底面的凸块与该基板电气连接,获取电源、时钟、外部输入输出信号;通过表面的凸块与该芯粒电气连接;且每个瓦片内包含竖直方向的硅通孔,在部分瓦片表面的凸块与瓦片底面的凸块之间形成电气连接,为该芯粒传送电源、时钟、芯片外部输入输出信号。本发明相对于已有的可重用无源硅中介层设计方案,所提出的方案数据传输性能更高、模块化能力更好、能够容忍导线故障。

    一种图计算装置
    45.
    发明授权

    公开(公告)号:CN113505825B

    公开(公告)日:2023-07-21

    申请号:CN202110759760.0

    申请日:2021-07-06

    Abstract: 本发明提供一种图计算装置,包括存储层、逻辑层、列控制器,所述存储层用于原始数据以及中间数据的存储;所述逻辑层包括树创建模块、动态构图模块以及图创建模块;以及所述列控制器用于控制数据在存储层和逻辑层之间迁移。本发明是针对动态图构建进行优化的专用硬件加速器架构,针对动态图更新的性能和吞吐量进行了优化,更贴近现实应用的需求。

    一种能对非极大值抑制处理加速的神经网络加速器

    公开(公告)号:CN116090531A

    公开(公告)日:2023-05-09

    申请号:CN202310072085.3

    申请日:2023-01-13

    Abstract: 本发明提供了一种能对非极大值抑制处理加速的神经网络加速器,所述加速器包括非极大值抑制模块,其中,所述非极大值抑制模块包括:候选边框输入单元,其用于在每种预测类别下按类别置信度由高到低的顺序输入需要进行非极大值抑制处理的候选的边框;边框存储单元,其用于存储候选边框单元输入的首个边框以及新目标的边框;边框交并比运算单元,其用于进行交并比运算以得到交并比值;交并比对比单元,其用于将边框交并比运算单元获得的交并比值与预设的交并比阈值进行对比以确定当前输入的边框是否为新目标的边框;边框处理单元,其用于将新目标的边框作为满足预定要求的边框存入边框存储单元,并通知候选边框输入单元输入下一个候选的边框。

    一种基于阻变存储器的神经网络映射方法、加速器

    公开(公告)号:CN112070204B

    公开(公告)日:2023-01-20

    申请号:CN202010722047.4

    申请日:2020-07-24

    Abstract: 本发明提供一种基于阻变存储器的神经网络权重映射方法,其中,所述阻变存储器以存储单元的高阻态和低阻态存储二值数据,所述映射方法包括:S1、获得神经网络以二值形式表示的二进制权重阵列;S2、获得二进制权重值阵列的每一列的第一值和第二值的数量;S3、将二进制权重值阵列的每一列权重值映射存储到所述阻变存储器的每一列存储单元中,其中,对于第一值的数量大于第二值的数量的列,第一值映射为高阻态,第二值映射为低阻态;否则第二值映射为高阻态,第一值映射为低阻态。本发明在硬件上只是改变了原有的权重存储映射方式,有效的降低存储阵列中低电阻状态数量,大幅降低电流及其在阻变存储器计算阵列和模拟‑数字转换装置的功耗。

    一种基于阻变存储器的图神经网络计算方法和装置

    公开(公告)号:CN114186598A

    公开(公告)日:2022-03-15

    申请号:CN202110856642.1

    申请日:2021-07-28

    Abstract: 本发明实施例提供了一种基于阻变存储器的图神经网络计算方法和装置,该方法包括:对于图神经网络的任一层,分析该层中将要在阻变存储器阵列中运算的图数据在权重原位计算模式和混合原位计算模式下的处理时延相对大小,选择时延最小的模式作为该层的计算模式;在权重原位计算模式,对所述图神经网络的所述层将图数据的邻接矩阵和图神经网络的权重参数作为原位数据分别映射到相应的阻变存储器阵列中,以将图神经网络的节点特征作为输入数据与相应的原位数据进行运算;在混合原位计算模式,对所述图神经网络的所述层将图数据的邻接矩阵和节点特征作为原位数据分别映射到相应的阻变存储器阵列中,以将权重参数作为输入数据与相应的原位数据进行运算。

    基于Winograd卷积的运算装置及包含该装置的神经网络处理器

    公开(公告)号:CN109190756B

    公开(公告)日:2022-02-18

    申请号:CN201811048884.2

    申请日:2018-09-10

    Abstract: 本发明提供了一种基于Winograd卷积的卷积运算单元和相应的神经网络处理器。该卷积运算单元包括乘法器、累加器和第一选通器,乘法器用于接收待进行矩阵相乘运算的元素或待进行矩阵点乘运算的元素,第一选通器用于接收来自于乘法器的输出值和待进行累加运算的元素,通过控制第一选通器将待进行累加运算的元素或者将所述乘法器的输出值传递至累加器能够使该卷积运算单元在多个工作模式之间进行切换。将本发明的卷积运算单元应用于神经网络处理器能够提高计算效率并降低运行功耗。

    神经网络的计算装置、处理器和电子设备

    公开(公告)号:CN112132272A

    公开(公告)日:2020-12-25

    申请号:CN202010999082.0

    申请日:2020-09-22

    Abstract: 本发明提供了一种神经网络的计算装置、处理器和电子设备,其中,计算装置包括:逻辑运算电路和通路选择模块;所述通路选择模块,用于根据接收的神经网络中的计算元素所占用的位宽控制所述逻辑运算电路包括的多个计算电路中的一个计算电路导通;所述逻辑运算电路,用于基于所述导通的计算电路对所述计算元素进行运算,获得所述计算元素对应的计算结果。通过根据计算元素占用的位宽不同,控制逻辑运算电路导通不同的计算电路,实现可对不同位宽的计算元素进行计算,应用到神经网络的计算中,可实现对二值神经网络和三值神经网络的计算,实现了对二值神经网络和三值神经网络的运算加速。

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