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公开(公告)号：CN110990220A
公开(公告)日：2020-04-10
申请号：CN201911165952.8
申请日：2019-11-25
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F11/30
Abstract: 本发明是一种针对集成多种通信接口的功耗信号的采集装置,用于信息安全领域中，采集相应接口的芯片运行时的功耗信号。本发明在读写器中集成多种通信主接口，包括I2C、SPI、SWP、UART等，可与相应从接口的目标芯片进行通信，读写器串连电流探头为目标设备供电，通过采集电流探头的信号表征目标芯片的功耗变化。本发明特征在于通过计算机控制读写器的通信接口与目标芯片通信，利用读写器的端口(TRIG OUT)触发示波器，示波器通过信号放大器(可选或者直接)连接串连在读写器和目标芯片间的电流探头采集目标芯片的功耗信号。采集到的信号能够表征目标芯片功耗的变化，可用于进行侧信道攻击测试。计算机与示波器通过网口或者USB接口连接，获取信号数据并以文件方式保存。
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公开(公告)号：CN109582226A
公开(公告)日：2019-04-05
申请号：CN201811351007.2
申请日：2018-11-14
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F3/06
Abstract: 本发明涉及一种高速存储访问逻辑结构及其控制方法，其包括：数据处理单元、CPU、存储控制器和存储器阵列；数据处理单元进行算法运算，CPU进行算法运算的源数据配置和结果数据读取，存储控制器进行数据处理单元和CPU对存储器阵列的访问控制，存储器阵列中存储数据处理单元的源数据和结果数据。在物联网、云计算等云端服务器应用中，此存储访问逻辑结构用于支持高速和高安全性的算法运算，从而实现云端服务器的算法运算服务在底层硬件运算级的加速。
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公开(公告)号：CN107918741A
公开(公告)日：2018-04-17
申请号：CN201711186543.7
申请日：2017-11-24
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F21/71
Abstract: 本发明提供一种实现物理不可克隆功能(PUF)的增强型电路结构，用以实现物理不可克隆功能。利用在芯片划片过程中，划片刀通过划片槽中心线存在偏差的原理，使放置在划片槽不同位置的熔丝(fuse)，被概率性的划断。由于在划片槽中有连接fuse的电路，使被划断和没被划断的fuse中传递的信号呈现不同的信号状态，通过信号处理单元识别这些状态，并输出fuse PUF的数据结果。相对于已有的普通实现物理不可克隆功能的电路结构，安全性更高，不易窃取和克隆PUF数据。
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公开(公告)号：CN117834106A
公开(公告)日：2024-04-05
申请号：CN202410003593.0
申请日：2024-01-02
Applicant: 北京中电华大电子设计有限责任公司
Abstract: 本发明是一种自动化的侧信道SPA攻击方法，本发明通过对原始功耗数据曲线进行自动化处理，首先人工识别到较明确的基础运输单元功耗特征模板，遍历完整曲线分别计算模板在曲线上各个位置的相关性，从而找到基础运算单元在曲线上的大概位置分布，然后通过二值化的操作进一步明确位置，通过对位置以及间距的读取分析，生成要攻击的目标数据。本发明通过对原始功耗数据曲线的模板匹配、二值化等操作，减少了人工手动分析在SPA攻击过程中的占比，提高了分析效率，也减少了人工分析引入的错误。
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公开(公告)号：CN108256319B
公开(公告)日：2024-02-06
申请号：CN201611241403.0
申请日：2016-12-29
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F21/55
Abstract: 本发明提出一种延时锁止芯片的方法。应用在有安全要求的各种安全芯片中，如电子身份证、金融卡、社保卡、公交卡芯片等，本发明可以配合其他芯片异常工作条件检出机制保护芯片不被非法影响或侵入，从而提高对芯片内部资源的安全保护强度。
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Patent Agency Ranking
公开(公告)号：CN117278195A
公开(公告)日：2023-12-22
申请号：CN202311147795.4
申请日：2023-09-06
Applicant: 北京中电华大电子设计有限责任公司
Abstract: 本说明书公开了一种攻击模型的验证方法及装置。首先，获取待攻击设备的设备信息，设备信息包括待攻击设备所采用的密码算法。其次，选取与密码算法对应的仿真模型。而后，将预设密钥以及至少一个样本数据输入到仿真模型中进行仿真处理，得到与至少一个样本数据对应的仿真功耗曲线，并将与预设密钥对应的各猜测密钥以及至少一个样本数据输入到攻击模型中，得到与至少一个样本数据对应的各猜测功耗曲线。最后，根据仿真功耗曲线以及各猜测功耗曲线，对攻击模型还原出预设密钥的有效性进行验证。本方法可以通过仿真模型对待攻击设备的功耗曲线进行仿真，可以在得到待攻击设备之前，验证攻击模型还原出预设密钥的有效性。
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公开(公告)号：CN112434479B
公开(公告)日：2023-09-08
申请号：CN202011317256.7
申请日：2020-11-23
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F30/337
Abstract: 本发明涉及一种高速算法接口电路结构及其控制方法，其包括：输入数据帧解析模块、输入控制流缓冲模块、输入数据流缓冲模块、算法模块和输出缓冲模块；输入数据帧解析模块对信号A进行帧结构解析，脱去数据安全防护，生成控制流信号B和数据流信号D；输入控制流缓冲模块和输入数据流缓冲模块分别暂存控制流信号B和数据流信号D，并根据先入先出原则分别弹出信号C和信号E；算法模块根据信号C和信号E启动运算，得到运算结果信号F；输出缓冲模块暂存信号F，并根据先入先出原则弹出信号G。本发明分别设置控制流和数据流缓冲，可灵活配置控制流与数据流信号，适用于具有高速算法吞吐率和算法运算配置实时改变需求的应用场景。
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公开(公告)号：CN115883062A
公开(公告)日：2023-03-31
申请号：CN202211218521.5
申请日：2022-10-06
Applicant: 北京中电华大电子设计有限责任公司
IPC: H04L9/06
Abstract: 本发明涉及一种格式保留加密模式(FPE)轮运算的电路结构，其中包括：数据准备模块、轮运算控制电路以及轮运算电路，轮运算电路包括数据异或模块、数据拼接模块、字节翻转模块、加解密模块、字节翻转模块以及模加运算模块。异或模块对输入信号进行异或运算；数据拼接模块对输入数据进行拼接；字节翻转模块对输入数据的高低位按字节进行翻转；模加运算模块对数据进行模加运算；加解密模块对输入数据进行基于分组算法的加解密运算。整体轮运算模块对输入数据T(Tweak数据)、i(轮运算的轮数)、A(明文字符串)、B(明文字符串)进行运算，得到的输出数据会作为下一轮运算的输入数据。
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公开(公告)号：CN108256356B
公开(公告)日：2021-05-25
申请号：CN201611241559.9
申请日：2016-12-29
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F21/76
Abstract: 本发明提出一种抵抗芯片寄存器故障注入的方法。应用在有安全要求的各种安全芯片中，如电子身份证、金融卡、社保卡、公交卡芯片等，本发明可以配合其他芯片复位机制保护芯片不被非法影响或侵入，从而提高对芯片内部资源的安全保护强度。
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公开(公告)号：CN107766749A
公开(公告)日：2018-03-06
申请号：CN201711126167.2
申请日：2017-11-15
Applicant: 北京中电华大电子设计有限责任公司
IPC: G06F21/73
CPC classification number: G06F21/73
Abstract: 本发明提出了一种基于物理不可克隆功能(PUF)的电路及其物理实现方式。该PUF电路及其物理实现具有简单可靠，功耗低，易扩展和失效率低等特点，并具有较强的抗老化能力。该PUF电路由PUF基本单元和读取电路组成，其中PUF基本单元由固定电阻与等效可变电阻并联的方式实现。在芯片加工过程中，由于采取特殊结构的等效可变电阻受半导体加工制程的影响，会导致其阻值波动较大，通过与固定电阻并联后得到并联阻值。通过读取电路读取PUF单元并联阻值的变化，可以转换为1bit的PUF数据。通过增加该PUF单元，复用或增加读出电路，可以得到任意位数的PUF数据输出。
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