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公开(公告)号：CN100511405C
公开(公告)日：2009-07-08
申请号：CN200610090328.2
申请日：2006-06-29
Applicant: 精工爱普生株式会社
Abstract: 本发明提供一种能够实现电路面积的缩小的集成电路装置、电子设备。集成电路装置包括多个电路块被宏单元化的驱动器宏单元。驱动器宏单元包括：用于驱动数据线的数据驱动块DB、用于存储图像数据的存储块MB、以及配置有用于电连接数据驱动块DB的输出线和数据线的焊盘的焊盘块PDB。数据驱动块DB和存储块MB沿D1方向配置，焊盘块PDB配置在数据驱动块DB以及存储块MB的D2方向侧。
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公开(公告)号：CN100461239C
公开(公告)日：2009-02-11
申请号：CN200610090319.3
申请日：2006-06-29
Applicant: 精工爱普生株式会社
CPC classification number: G09G3/3688 , G09G3/3696 , G09G5/395 , G09G2300/0408 , G09G2310/027
Abstract: 本发明的目的在于，提供一种灵活地进行电路的配置、并可以进行效率高的布局的集成电路装置以及搭载其的电子设备。集成电路装置包括显示存储器，该显示存储器对显示在具有多条扫描线和多条数据线的显示面板上的数据中的至少相当于1像素的数据进行储存。显示存储器包括多条字线WL、多条位线BL、多个存储器单元MC、以及数据读出控制电路(150、152)。数据读出控制电路(150、152)在水平扫描驱动显示面板的一个水平扫描期间1H，将对应于多条数据线的像素的数据分成N(N为大于等于2的整数)次读出并控制。
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公开(公告)号：CN1892791A
公开(公告)日：2007-01-10
申请号：CN200610090329.7
申请日：2006-06-29
Applicant: 精工爱普生株式会社
Abstract: 本发明提供能够实现电路面积缩小化的集成电路装置及电子设备。集成电路装置包括用于驱动数据线的数据驱动块，数据驱动块包括多个子像素驱动单元，各个子像素驱动单元输出与一个子像素的图像数据对应的数据信号。在将沿着子像素驱动单元长边的方向设为D1方向、将与D1方向正交的方向设为D2方向的时候，在数据驱动块中，沿着D1方向配置多个子像素驱动单元，同时，沿着D2方向配置多个子像素驱动单元。在数据驱动块的D2方向一侧配置有焊盘。而且，排列替换配线区用于排列替换子像素驱动单元的引出线的排列顺序，设置在子像素驱动单元的配置区上。
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公开(公告)号：CN1892789A
公开(公告)日：2007-01-10
申请号：CN200610090320.6
申请日：2006-06-29
Applicant: 精工爱普生株式会社
Abstract: 本发明提供一种能够实现电路面积缩小的集成电路装置和电子设备。集成电路装置包括：用于驱动数据线的数据驱动块；多个控制晶体管TC1、TC2，各控制晶体管与数据驱动块的各个输出线对应地设置，各控制晶体管由公共控制信号控制；以及焊盘配置区域，配置有用于电气连接数据线和数据驱动块的输出线QL1、QL2的数据驱动器用焊盘P1、P2的。而且，控制晶体管TC1、TC2被配置在焊盘配置区域。
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公开(公告)号：CN1124612C
公开(公告)日：2003-10-15
申请号：CN96190754.1
申请日：1996-07-19
Applicant: 精工爱普生株式会社
IPC: G11C11/413
Abstract: 一种半导体存储器装置，在每个把存储单元阵列块分割成多个的块中，对留在块内的长度的字线进行升压。在多列的一对位线(BL，/BL)和多行的字线(WL)的各个交叉部上，具有连接在一对位线和字线上的多个存储单元(10)。具有把该存储单元的配置区域进行块分割而形成的多个存储单元阵列块(120)。为了使多个存储单元阵列块内的全部字线(WL)升压，具有所共用的第一被升压线(VLINE1)。由连接在第一被升压线上的升压用电容器(C1)和对该升压用电容器进行预充电的开关晶体管(T7)构成升压电路(30)。具有升压控制电路(40)，给升压电路输出导通驱动晶体管(T7)而对升压用电容器进行预充电的预充电控制信号(Φ2)和使升压用电容器的负极端的电位变化的升压驱动信号(Φ1)。在各个存储单元阵列块上设有第二被升压线(VLINE2)。由块选择电路(90)选择一个存储单元阵列块使由行选择电路(60，100)所选择的一条字线经过第二被升压线进行升压。
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Patent Agency Ranking
公开(公告)号：CN100557680C
公开(公告)日：2009-11-04
申请号：CN200610091121.7
申请日：2006-06-30
Applicant: 精工爱普生株式会社
CPC classification number: G09G3/20 , G09G2300/0426 , H01L27/12
Abstract: 本发明提供一种可以缩小电路面积、提高设计效率的集成电路装置、电子设备。集成电路装置包括第一～第N电路块CB1～CBN，其在以从集成电路装置的短边即第一边朝向对面的第三边的方向为第一方向D1、以从集成电路装置的长边即第二边朝向面对的第四边的方向为第二方向D2时，沿D1方向配置。电路块CB1～CBN包括扫描驱动块SB、电源电路块PB、以及数据驱动块DB和存储块MB。数据驱动块DB和存储块MB沿D1方向邻接配置，电源电路块PB配置在扫描驱动块SB、数据驱动块DB及存储块MB之间。
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公开(公告)号：CN100557679C
公开(公告)日：2009-11-04
申请号：CN200610091113.2
申请日：2006-06-30
Applicant: 精工爱普生株式会社
CPC classification number: G11C5/025 , G09G3/3688 , G09G2300/0426 , G09G2310/027
Abstract: 本发明提供一种可以实现电路面积的缩小或设计的效率化的集成电路装置以及电子设备。该集成电路装置包括，第一至第N电路块CB1至CBN，当从集成电路装置的短边第一边向相对的第三边去的第一方向设为D1，将从集成电路装置的长边第二边向相对的第四边去的第二方向设为D2时，所述第一至第N电路块CB1至CBN沿D1方向配置。第一至第N电路块CB1至CBN包括，至少一个存储块MB，用于存储图像数据；以及，至少一个数据驱动块DB，用于驱动数据线。存储块MB包括存储单元阵列，行地址译码器RD以及读出放大器块SB。行地址译码器RD配置成其长边方向沿D1方向，读出放大器块SAB配置成其长边方向沿D2方向。
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公开(公告)号：CN100530642C
公开(公告)日：2009-08-19
申请号：CN200610091115.1
申请日：2006-06-30
Applicant: 精工爱普生株式会社
Abstract: 本发明提供一种细长的集成电路装置及包括该集成电路装置的电子设备，该集成电路装置(10)包括：焊盘PDx；以及形成为长方形区域，并和上述焊盘电连接的静电保护元件。以焊盘的排列方向与静电保护元件ESDx所形成区域的长边方向平行，并与静电保护元件ESDx的一部分或者全部重叠的方式，在该静电保护元件的上层配置焊盘PDx。
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公开(公告)号：CN100527217C
公开(公告)日：2009-08-12
申请号：CN200610091116.6
申请日：2006-06-30
Applicant: 精工爱普生株式会社
CPC classification number: G09G3/3688 , G09G3/3696 , G09G2300/0408 , G09G2310/027
Abstract: 本发明提供一种可灵活地进行电路配置、高效地进行布局的集成电路装置及安装有该集成电路装置的电子设备。集成电路装置包括用于存储在显示面板上显示的至少一个画面的数据的显示存储器，其中，显示面板具有多条扫描线及多条数据线。显示存储器各自包括多个RAM块(200)，各个RAM块(200)分别包含多条字线WL、多条位线BL、多个存储器单元MC和数据读出控制电路(240)、(250)。多个RAM块(200)的各个RAM块沿着多条位线BL延伸的第一方向X配置。数据读出控制电路(240)、(250)在水平扫描驱动显示面板的一水平扫描期间1H内，分成N(N为大于等于2的整数)次地对对应于多条信号线的像素的数据进行读出控制。
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公开(公告)号：CN100466036C
公开(公告)日：2009-03-04
申请号：CN200610091114.7
申请日：2006-06-30
Applicant: 精工爱普生株式会社
Abstract: 本发明提供一种显示装置以及安装有该显示装置的电子设备，其中，该显示装置具有可灵活地进行电路配置、高效地进行布局的集成电路装置。显示装置包括集成电路装置(20)，集成电路装置(20)包括：包含多条扫描线和多条数据线的显示面板(10)、以及用于存储在显示面板上显示的至少一个画面的数据的显示存储器。显示存储器(RAM块(200))包括多条字线WL、多条位线BL和多个存储器单元MC。集成电路装置(20)具有与显示面板(10)的多条扫描线平行的一边IL，显示存储器的多条位线BL在与所述一边IL平行的第一方向上延伸。
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