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公开(公告)号：CN103824005A
公开(公告)日：2014-05-28
申请号：CN201410087187.3
申请日：2014-03-11
Applicant: 东南大学
Abstract: 本发明公开一种内嵌可配置IP核的防复制系统及防复制方法，该系统包括被保护的嵌入式芯片以及与之连接的防复制电路。本发明在防复制电路中增加了可配置IP核并将嵌入式芯片中部分程序存储在其中，使得防复制电路能够协助嵌入式芯片完成部分运算工作，二者协同组成完整的防复制系统，解决了嵌入式芯片本身防护能力弱，易被不法者破解嵌入式芯片中的完整代码这一难题。本发明通过从AD模块读数的方法产生真随机数，采用完全随机的定时中断，使嵌入式芯片在运行过程中，能够随机地和防复制电路间进行多次加密验证，以防止复制者模拟启动信号，驱动嵌入式芯片正常运行。本发明的防复制系统及方法具有设计灵活、不易被破解的优点。
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公开(公告)号：CN102520754B
公开(公告)日：2013-10-23
申请号：CN201110446350.7
申请日：2011-12-28
Applicant: 东南大学
Abstract: 本发明公开了一种面向动态电压调节系统的片上监测电路，其特征在于，包括主寄存器电路(1)，从寄存器电路(2)，影子寄存器电路(3)，错误信号产生电路(4)，原地错误纠正选择器(5)，亚稳态监测电路(6)，错误信号整合电路(7)，恢复方式选择电路(8)，原地错误恢复控制信号产生电路(9)。本发明可以有效地将工艺、电压、温度噪声等因素对主电路的影响都归结为关键单元和特殊路径延时特性的变化，反映芯片内部各部分的实际情况，大大改善了动态电压调节的效果。
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公开(公告)号：CN102520754A
公开(公告)日：2012-06-27
申请号：CN201110446350.7
申请日：2011-12-28
Applicant: 东南大学
IPC: G05F1/569
Abstract: 本发明公开了一种面向动态电压调节系统的片上监测电路，其特征在于，包括主寄存器电路(1)，从寄存器电路(2)，影子寄存器电路(3)，错误信号产生电路(4)，原地错误纠正选择器(5)，亚稳态监测电路(6)，错误信号整合电路(7)，恢复方式选择电路(8)，原地错误恢复控制信号产生电路(9)。本发明可以有效地将工艺、电压、温度噪声等因素对主电路的影响都归结为关键单元和特殊路径延时特性的变化，反映芯片内部各部分的实际情况，大大改善了动态电压调节的效果。
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公开(公告)号：CN102497200A
公开(公告)日：2012-06-13
申请号：CN201110415833.0
申请日：2011-12-13
Applicant: 东南大学
IPC: H03K21/40
Abstract: 本发明公开了一种时钟信号丢失检测电路及方法，电路包括分频模块、计数模块、移位模块、比较模块和检测模块。方法用低频时钟检测高频时钟，实现过程分为五个部分：分频部分、计数部分、移位部分、比较部分、检测部分。本发明提供的时钟信号丢失检测电路及方法通过检测时钟信号是否丢失，以保证集成电路系统能够正常操作，节省逻辑资源，提高集成电路系统的整体性能。并且在IP模块复用的专用集成电路设计中提供一种通用的解决方法，缩短产品研制时间，同时降低设计成本。
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公开(公告)号：CN102043761B
公开(公告)日：2012-06-13
申请号：CN201110000634.3
申请日：2011-01-04
Applicant: 东南大学
IPC: G06F17/14
Abstract: 本发明涉及一种基于可重构技术的傅立叶变换的实现方法，该方法针对常用的基于点的离散傅立叶变换按时间抽取算法，基于点的快速傅立叶变换运算可分解为M阶运算过程，每一阶运算由N/2个蝶形运算构成，每个蝶形运算都使用到一个旋转因子；其中M为任一正整数；N为需要进行傅立叶变换的序列的长度，即为对应的值；该方法应用于包括总线、嵌入式微处理器、存储器、可重构阵列和直接存储器访问控制器的嵌入式系统，其中，嵌入式微处理器、存储器、可重构阵列和直接存储器访问控制器分别与总线通信。该方法提高了运算效率。
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Patent Agency Ranking
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公开(公告)号：CN102043761A
公开(公告)日：2011-05-04
申请号：CN201110000634.3
申请日：2011-01-04
Applicant: 东南大学
IPC: G06F17/14
Abstract: 本发明涉及一种基于可重构技术的傅立叶变换的实现方法，该方法针对常用的基于点的离散傅立叶变换按时间抽取算法，基于点的快速傅立叶变换运算可分解为M阶运算过程，每一阶运算由N/2个蝶形运算构成，每个蝶形运算都使用到一个旋转因子；其中M为任一正整数；N为需要进行傅立叶变换的序列的长度，即为对应的值；该方法应用于包括总线、嵌入式微处理器、存储器、可重构阵列和直接存储器访问控制器的嵌入式系统，其中，嵌入式微处理器、存储器、可重构阵列和直接存储器访问控制器分别与总线通信。该方法提高了运算效率。
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公开(公告)号：CN101957741A
公开(公告)日：2011-01-26
申请号：CN201010510097.2
申请日：2010-10-18
Applicant: 东南大学
IPC: G06F7/58
CPC classification number: G06F7/588 , H04L9/0866
Abstract: 本发明公开了一种基于亚阈值特性的真随机数发生器，包括快速振荡器、慢速振荡器、电平转换电路、采样触发器和信号后处理电路，快速振荡器的输出端通过电平转换电路与采样触发器的数据端相连接，慢速振荡器的输出端与采样触发器的时钟端相连接，采样触发器的输出端与信号后处理电路的输入端相连接，信号后处理电路的输出端作为发生器的输出端，信号后处理电路对采样触发器的输出信号进行一系列的杂化和噪声化处理过程，以改善输出序列的随机特性。本发明提供的发生器，随机源电路的结构简单，只需要一串奇数级的反相器链级联即可；随机特性好，亚阈值区频率抖动的加强和随机化能力强的信号后处理电路增强了输出序列的随机特性，使得输出效果更好。
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公开(公告)号：CN202364199U
公开(公告)日：2012-08-01
申请号：CN201120520617.8
申请日：2011-12-13
Applicant: 东南大学
IPC: H03K21/40
Abstract: 本实用新型公开了一种时钟信号丢失检测电路及方法，电路包括分频模块、计数模块、移位模块、比较模块和检测模块。方法用低频时钟检测高频时钟，实现过程分为五个部分：分频部分、计数部分、移位部分、比较部分、检测部分。本实用新型提供的时钟信号丢失检测电路及方法通过检测时钟信号是否丢失，以保证集成电路系统能够正常操作，节省逻辑资源，提高集成电路系统的整体性能。并且在IP模块复用的专用集成电路设计中提供一种通用的解决方法，缩短产品研制时间，同时降低设计成本。
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