亚稳态检测电路
    91.
    发明公开

    公开(公告)号:CN111262562A

    公开(公告)日:2020-06-09

    申请号:CN202010136969.7

    申请日:2020-03-02

    Abstract: 本发明提供了一种亚稳态检测电路,包括:时钟振荡器产生第一时钟信号;窗口产生电路延迟第一时钟信号,以及产生第二时钟信号;第一同步器接收输入信号并对输入信号进行同步,以及检测输入信号是否在第二时钟信号的检测窗口内翻转并输出第一输出信号;第二同步器接收输入信号并对输入信号进行同步,以及检测输入信号是否在第一时钟信号的检测窗口内翻转,并输出第二输出信号;异或门装置的输入端接收第一输出信号和第二输出信号并输出第三输出信号,通过第三输出信号判断输入信号是否将导致所述第一同步器或者所述第二同步器发生亚稳态。该方法能够在亚稳态发生前检测出输入信号可能导致同步器发生亚稳态的情形。

    高线性度的相位插值器
    92.
    发明授权

    公开(公告)号:CN106656116B

    公开(公告)日:2020-02-11

    申请号:CN201611226731.3

    申请日:2016-12-27

    Abstract: 本发明提供一种高线性度的相位插值器,包括:一负载电路,所述负载电路连接一等电位端;一差分对组,所述差分对组连接所述负载电路、一第一信号输入端、一第二信号输入端、一第三信号输入端和一第四信号输入端;一主电流源偏置阵列,所述主电流源偏置阵列连接所述差分对组、一象限控制信号输入端、一第一相位控制信号输入端和一第一偏置电压输入端;和两副电流源偏置阵列,两副电流源偏置阵列分别连接所述主电流源偏置阵列、一第二相位控制信号输入端和一第二偏置电压输入端。本发明的一种高线性度的相位插值器,可以获得高线性度的相位输出。

    差分时钟树电路
    93.
    发明公开

    公开(公告)号:CN110365327A

    公开(公告)日:2019-10-22

    申请号:CN201910646634.7

    申请日:2019-07-17

    Abstract: 本发明提供一种差分时钟树电路,包括级联的第N-1个高速缓冲器和第N个高速缓冲器,以及时序调节单元,所述时序调节单元用于调节所述第N-1个高速缓冲器的时序,所述第N个高速缓冲器用于将调节时序后的第N-1个高速缓冲器输出的衰减时钟信号恢复为正常的时钟信号,其中N为大于1的整数。本发明能够保证时钟同步、降低误码率,提高集成电路芯片之间的互联速率。

    一种基于卷积神经网络的遥感图像多目标检测方法

    公开(公告)号:CN108596101A

    公开(公告)日:2018-09-28

    申请号:CN201810380509.1

    申请日:2018-04-25

    Abstract: 一种基于卷积神经网络的遥感图像多目标检测方法,该方法利用卷积神经网络为核心,建立一种端到端的检测框架,先利用选框产生网络产生物体的选框,再通过检测子网络确定最终的目标分类及位置,为了提升多种尺度目标的检测准确率,提出了以双层选框产生网络和融合特征为核心的尺度自适应目标检测方法。该方法在公开遥感数据集中完成了训练和测试,识别精度较高,能够高效地检测遥感图像中的多种目标。

    基于多层次异构结构的可重构架构的并行扩展方法

    公开(公告)号:CN104615496B

    公开(公告)日:2018-08-24

    申请号:CN201510052052.8

    申请日:2015-01-30

    Abstract: 本发明提供一种基于多层次异构结构的可重构架构的并行扩展方法,其中所述基于多层次异构结构的可重构架构包括用于可重构计算的处理单元阵列、用于控制所述处理单元阵列的协控制器,以及用于调度、启动与运行所述协控制器的主控制器,面向上述可重构架构,本发明的扩展方法在ANSI C基础上扩展并定义三类函数:普通函数、任务函数与子任务函数,相互之间能实现灵活调用,因此能充分实现复杂的并行模式,有效挖掘多层次异构结构可重构架构的并行计算能力。

    一种用于粗粒度可重构阵列的系统级功耗建模方法

    公开(公告)号:CN106326084A

    公开(公告)日:2017-01-11

    申请号:CN201610675832.2

    申请日:2016-08-17

    CPC classification number: Y02D10/34 G06F11/3447

    Abstract: 本发明提供了一种用于粗粒度可重构阵列的系统级功耗建模方法包括:建立指令查找表;根据所述指令查找表确定单一指令的功耗;将所述单一指令的功耗累加获得系统级功耗。先前技术并没有对系统级的面向粗粒度可重构系统的功耗建模方法,而本发明为粗粒度可重构系统的架构提出了一种用于粗粒度可重构阵列的系统级功耗建模方法,从而能在模型的基础上指导系统进行优化,具有现实意义,在系统级层面提出了功耗模型,流程简单,能在系统级进行功耗的模拟,极大的提高了生产效率。

    一种适用于HEVC标准的扩展可变块运动估计电路

    公开(公告)号:CN102932643B

    公开(公告)日:2016-02-10

    申请号:CN201210457226.5

    申请日:2012-11-14

    Abstract: 本发明涉及一种适用于HEVC标准的扩展可变块运动估计电路,用于对系统内存中的图像数据进行压缩,所述的电路包括数据流控制模块、缓存阵列、PE阵列、加法树模块和扩展计算模块,所述的数据流控制模块的输入端与系统内存的图像数据端口连接,输出端依次连接缓存阵列、PE阵列、加法树模块和扩展计算模块。与现有技术相比,本发明具有硬件资源消耗少、计算量小等优点。

    用于亚阈值电路的D触发器电路结构

    公开(公告)号:CN102545837B

    公开(公告)日:2015-10-21

    申请号:CN201210024756.0

    申请日:2012-02-03

    Abstract: 本发明提供一种用于亚阈值电路的D触发器电路结构,在传统的mC2MOS结构上进行了调整,主级反相器和从级反相器分别移到主级反馈环路单元和从级反馈环路单元的输入到输出的数据通路上,从而将主级反馈环路单元和从级反馈环路单元输出端均与时钟信号分开,从而使主级第一类钟控互补单元和从级第一类钟控互补单元中的时钟信号不再直接影响其输出端从而消除了输出结果的毛刺,使电路输出更加稳定;同时,通过增大了NMOS管和PMOS管的宽长比,增大上拉电路的工作电流,避免了工艺偏差和温度的影响的缺点。

    适用于数字视频编解码的一维离散余弦逆变换模块电路

    公开(公告)号:CN103067718B

    公开(公告)日:2015-10-14

    申请号:CN201310036229.6

    申请日:2013-01-30

    Abstract: 本发明涉及一种适用于数字视频编解码的一维离散余弦逆变换模块电路,包括输入输出接口、模块控制器和多个IDCT单元处理器,所述的输入输出接口包括数据输入接口、数据输出接口、指示信号输入接口和模式信号输入接口,所述的数据输入接口、数据输出接口分别与IDCT单元处理器连接,所述的指示信号输入接口和模式信号输入接口分别与模块控制器连接,所述的模块控制器分别与多个IDCT单元处理器控制连接,所述的多个IDCT单元处理器之间两两连接。与现有技术相比,本发明具有可适用在HEVC视频编解码标准中定义的四种尺寸图像数据块4×4,8×8,16×16,32×32的IDCT运算等优点。

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