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公开(公告)号：CN112564703B
公开(公告)日：2023-08-29
申请号：CN202011529532.6
申请日：2020-12-22
Applicant: 北京时代民芯科技有限公司 , 北京微电子技术研究所
IPC: H03M1/10
Abstract: 本发明公开了一种多路时域交织数据转换器的前台时间误差校正电路，降采样通道数据抽取电路可将信号传输数据降低至通道采样速率，抽取数据通过过零点检测电路判断每相邻通道转换数据之间是否存在过零点，预归一电路可去掉通道间的非差异部分，留下通道间差异信息作为通道间时间误差信息。误差信息经累加器和步长调节电路收敛至通道时间误差值后经泰勒一阶展开校正电路对含有通道时间误差的原始转换信号进行校正。且本结构增加了均方差检测电路，以判断电路是否收敛到可靠精度。本发明采用过零点统计技术，且可根据实际情况调节步长参数，平衡收敛时间和收敛精度，增加校正系统灵活性，实现了多通道时域交织转换器通道时间误差校正。
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公开(公告)号：CN108199699B
公开(公告)日：2022-01-11
申请号：CN201711346925.1
申请日：2017-12-15
Applicant: 北京时代民芯科技有限公司 , 北京微电子技术研究所
Abstract: 本发明公开了一种占空比稳定和低抖动时钟电路。整个时钟电路由时钟驱动放大器模块、电荷泵模块、输出时钟下降沿触发电路模块、输出时钟上升沿触发电路模块、输出时钟波形稳定电路模块和电荷泵锁相环模块组成。时钟波形稳定电路根据上升沿与下降沿控制电路产生的沿控制脉冲产生完整的输出时钟；下降沿触发电路使输出时钟的下降沿与输入时钟下降沿保持一致；上升沿触发电路可以根据输入时钟的占空比检测结果，以输出时钟下降沿为基准，调节输出时钟上升沿位置，使输出时钟的占空比最终稳定到50％；电荷泵锁相环接收输出时钟波形稳定电路模块的输出时钟，产生高速低抖动时钟信号。该时钟电路可以满足在高频应用中对时钟信号的苛刻要求。
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公开(公告)号：CN108199699A
公开(公告)日：2018-06-22
申请号：CN201711346925.1
申请日：2017-12-15
Applicant: 北京时代民芯科技有限公司 , 北京微电子技术研究所
Abstract: 本发明公开了一种占空比稳定和低抖动时钟电路。整个时钟电路由时钟驱动放大器模块、电荷泵模块、输出时钟下降沿触发电路模块、输出时钟上升沿触发电路模块、输出时钟波形稳定电路模块和电荷泵锁相环模块组成。时钟波形稳定电路根据上升沿与下降沿控制电路产生的沿控制脉冲产生完整的输出时钟；下降沿触发电路使输出时钟的下降沿与输入时钟下降沿保持一致；上升沿触发电路可以根据输入时钟的占空比检测结果，以输出时钟下降沿为基准，调节输出时钟上升沿位置，使输出时钟的占空比最终稳定到50％；电荷泵锁相环接收输出时钟波形稳定电路模块的输出时钟，产生高速低抖动时钟信号。该时钟电路可以满足在高频应用中对时钟信号的苛刻要求。
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公开(公告)号：CN110995215B
公开(公告)日：2023-08-29
申请号：CN201911295939.4
申请日：2019-12-16
Applicant: 北京时代民芯科技有限公司 , 北京微电子技术研究所
IPC: H03K5/24
Abstract: 本发明公开了一种可调增益的高速高精度比较器电路，包括偏置电路、前置预放大器、两级再放大器、Latch锁存器、FUSE电路、偏置电路和时钟电路。前置放大器将差分模拟微小信号识别并放大，得到初次放大的模拟电压信号输出给两级再放大器进行放大；Latch锁存器将两级再放大器的输出信号锁存；时钟电路为Latch锁存器提供时钟信号；FUSE电路可调整偏置电路的静态工作状态，改变输出电流，调整偏置电路的输出电压，进而调整前置放大器和两级再放大器的增益、带宽。本发明采用FUSE修调技术，可以根据实际情况，调整高速高精度比较器的性能指标，提高比较器电路的灵活性，实现了自适应带宽和增益调整。
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公开(公告)号：CN111158280A
公开(公告)日：2020-05-15
申请号：CN201911371005.4
申请日：2019-12-26
Applicant: 北京时代民芯科技有限公司 , 北京微电子技术研究所
IPC: G05B19/042
Abstract: 一种高精度模数转换器熔丝自动烧录系统及方法，属于数模转换器技术领域。本发明FPGA模块接收上位机通过USB转SPI控制器发送的烧录控制信号及按预设顺序排列的熔丝阵列中每一位熔丝的烧录码流数据，生成控制指令并发送至烧录模块；所述控制指令包括烧录控制信号和熔丝阵列的烧录码流数据，以及工作控制信号；烧录模块包括修调码烧录电路和待烧录ADC芯片；修调码烧录电路接收控制指令，并转发至待烧录ADC芯片；待烧录ADC芯片根据控制指令中的烧录控制信号，进入烧录状态，并将控制指令中的熔丝阵列的烧录码流数据按位发送到待烧录ADC芯片的接收管脚上，待烧录ADC芯片按位烧录每根熔丝，实现整个待烧录ADC芯片熔丝阵列的烧录。
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Patent Agency Ranking
公开(公告)号：CN118605677A
公开(公告)日：2024-09-06
申请号：CN202410699731.3
申请日：2024-05-31
Applicant: 北京微电子技术研究所 , 北京时代民芯科技有限公司
IPC: G05F1/567
Abstract: 一种带有分段补偿的高精度带隙基准电路，包括场效应管M1～M13、双极性晶体管Q1～Q3、电阻R1～R2、可修调电阻R3、R4、运算放大器。场效应管M1～M4、运算放大器、电阻R1、双极性晶体管Q1、Q2构成了PTAT电流产生电路；场效应管M5～M13、电阻R2～R4、双极性晶体管Q3构成了分段式补偿CTAT产生电路，其中可修调电阻R3和场效应管M11工作在低温段，可修调电阻R4和场效应管M12～M13工作在高温段，通过对双极性晶体管Q3发射极补充或抽取电流，实现在低温和高温段对基准电压的补偿。本发明通过在高低温段分段补偿的方式，较大程度地提升了基准源的精度，具有结构简单、精度高的特点，适用于高精度的模数转换器设计中。
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公开(公告)号：CN111697934B
公开(公告)日：2023-08-08
申请号：CN202010560479.X
申请日：2020-06-18
Applicant: 北京时代民芯科技有限公司 , 北京微电子技术研究所
IPC: H03F3/45
Abstract: 一种具有低失调特点的抗辐照加固比较器电路，包括两级比较器、失调校准电路、抗辐照版图加固电路。失调校准电路将Latch锁存器输出的失调码进行提取、转换，与两级比较器形成负反馈不断进行校准调节，消除总剂量效应引起的输入对管阈值电压匹配误差和流片过程中产生的随机失调，同时采用新型工形栅加固技术解决因总剂量辐照环境而导致MOS管阈值电压漂移和开关漏电问题，保证电路的抗总剂量能力同时抵消辐照总剂量效应的影响能力。
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公开(公告)号：CN116625534A
公开(公告)日：2023-08-22
申请号：CN202310417073.X
申请日：2023-04-18
Applicant: 北京时代民芯科技有限公司 , 北京微电子技术研究所
Abstract: 一种具有失调调节功能的温度传感器电路，包括感温核电路、10位SAR ADC、一级转换寄存器、二级输出寄存器、上下限寄存器、失调校准寄存器、加法器、比较器。感温核电路用于感知温度对应的电压值，经10位SAR ADC进行数字化转换，所得10位二进制数字码储存在一级转换寄存器中；10位二进制数字码与失调校准寄存器中存储的8位数字码通过加法器修正温度转换值，校准后的10位数字码储存在二级输出寄存器中并向外输出，通过比较器将二级输出寄存器中的数据和上下限寄存器中的数据进行比较，得到温度指示端INT的输出信号，防止芯片过热烧毁或低温损坏。本发明解决当前温度传感器温度失调调节困难、工作范围窄、体积大、功耗高等难题。
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公开(公告)号：CN117749188A
公开(公告)日：2024-03-22
申请号：CN202311744402.8
申请日：2023-12-18
Applicant: 北京微电子技术研究所 , 北京时代民芯科技有限公司
Abstract: 本发明公开了一种带电容电压系数消除和电容复用的SARADC电容阵列，包括：两组高段P端拆分采样电容CPH1,1～CPH1,j、CPH2,1～CPH2,j、两组高段N端拆分采样电容CNH1,1～CNH1,j、CNH2,1～CNH2,j、低段P端比特位电容CPL,1～CPL,i、低段N端比特位电容CNL,1～CNL,i、P端符号位电容CSP1～CSP2、N端符号位电容CSN1～CSN2、N端桥接电容CNB1～CNB2、P端桥接电容CPB1～CPB2、N端连接开关SN1～SN4和P端连接开关SP1～SP4。本发明将高段采样电容阵列被拆分成相同的两端，两端的电容分别使用顶板和底板进行采样，抵消了电容的一阶电压系数；采样的过程基于VDD和GND进行，无需额外的VCM电压；独立的符号位电容通过开关切换参与到后续的量化过程，进一步减小了所需要的电容数量。
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公开(公告)号：CN111158280B
公开(公告)日：2021-09-21
申请号：CN201911371005.4
申请日：2019-12-26
Applicant: 北京时代民芯科技有限公司 , 北京微电子技术研究所
IPC: G05B19/042
Abstract: 一种高精度模数转换器熔丝自动烧录系统及方法，属于数模转换器技术领域。本发明FPGA模块接收上位机通过USB转SPI控制器发送的烧录控制信号及按预设顺序排列的熔丝阵列中每一位熔丝的烧录码流数据，生成控制指令并发送至烧录模块；所述控制指令包括烧录控制信号和熔丝阵列的烧录码流数据，以及工作控制信号；烧录模块包括修调码烧录电路和待烧录ADC芯片；修调码烧录电路接收控制指令，并转发至待烧录ADC芯片；待烧录ADC芯片根据控制指令中的烧录控制信号，进入烧录状态，并将控制指令中的熔丝阵列的烧录码流数据按位发送到待烧录ADC芯片的接收管脚上，待烧录ADC芯片按位烧录每根熔丝，实现整个待烧录ADC芯片熔丝阵列的烧录。
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