数据处理方法、装置、存储介质及电子设备

    公开(公告)号:CN117217262A

    公开(公告)日:2023-12-12

    申请号:CN202210623224.2

    申请日:2022-06-01

    Inventor: 祝叶华 孙炜

    Abstract: 本申请实施例公开了一种数据处理方法、装置、存储介质及电子设备,其中,本申请实施例根据乘加阵列的容量信息,从目标卷积层的权重数据中确定待运算的第一权重向量;获取所述第一权重向量的第一零值标记序列,根据所述第一零值标记序列从所述第一权重向量中读取非零值权重,并将所述非零值权重分配至所述乘加阵列;根据所述第一零值标记序列,从所述目标卷积层的输入特征数据中读取与所述非零值权重匹配的特征值,并将所述特征值分配至所述乘加阵列进行运算。采用本申请实施例的方案,减小了乘加阵列在进行一次运算中参与计算的乘法单元的数量,节约了计算资源和数据传输带宽。

    人工智能加速器、芯片、数据处理方法及电子设备

    公开(公告)号:CN117172295A

    公开(公告)日:2023-12-05

    申请号:CN202210565284.3

    申请日:2022-05-23

    Inventor: 孙炜 祝叶华

    Abstract: 本公开提供了一种人工智能加速器、人工智能加速芯片、数据处理方法及电子设备,涉及人工智能技术领域。该人工智能加速器包括运算引擎集合、电源管理模块和运算调度模块,其中运算引擎集合包括两种以上运算引擎,用于对数据处理网络中各算子进行运算;电源管理模块用于对运算引擎集合中的运算引擎进行供电;运算调度模块用于获取数据处理网络中各算子的属性信息,利用各算子的属性信息,对各算子的运算时间进行调整,以使数据处理过程中电源管理模块输出的电流一致。本公开可以使人工智能加速器在进行数据处理过程中保持电流平稳,从而提高系统稳定性以及降低电源模块设计成本。

    数据传输方法、装置、电子设备及可读存储介质及产品

    公开(公告)号:CN116743523A

    公开(公告)日:2023-09-12

    申请号:CN202210194469.8

    申请日:2022-03-01

    Inventor: 孙炜 祝叶华

    Abstract: 本申请公开了数据传输方法、装置、电子设备及计算机可读介质及产品,应用于电子设备的数据预处理模块,电子设备还包括处理器和存储器以及总线,处理器通过数据预处理模块与总线连接,总线与存储器连接,包括:获取到处理器发送的对应目标数据的数据处理请求,数据处理请求对应的接收端为处理器或存储器;响应数据处理请求,对目标数据执行预处理操作,并将执行预处理操作后的目标数据发送至数据处理请求对应的接收端。若处理器、数据预处理模块以及存储器分别连接至总线,数据传输需要通过存储器进行中转。本申请使处理器通过数据预处理模块与总线连接,使处理器可以直接获取数据预处理模块处理后的数据,优化了数据传输流程,提高了系统工作效率。

    神经网络的处理装置及处理数据的方法

    公开(公告)号:CN116629329A

    公开(公告)日:2023-08-22

    申请号:CN202210133148.7

    申请日:2022-02-11

    Inventor: 孙炜 祝叶华

    Abstract: 提供了一种神经网络的处理装置及方法。该神经网络处理装置包括:计算引擎,用于执行神经网络对应的计算;缓存器;调度器,用于执行以下操作:将输入的特征图数据中的第一批数据输入计算引擎,使得计算引擎执行神经网络的第一算子层对应的计算,得到第一中间结果;在第一中间结果存入缓存器之后,判断第一中间结果是否满足第二算子层的启动条件,其中第二算子层为第一算子层的下一级算子层;如果第一中间结果满足第二算子层的启动条件,将第一中间结果输入计算引擎,使得计算引擎执行第二算子层对应的计算。本申请提出的神经网络的处理装置,能够减小对缓存器空间大小的要求,提高整体运行效率。

    任务数据处理方法、装置以及电子设备

    公开(公告)号:CN116361040A

    公开(公告)日:2023-06-30

    申请号:CN202111618939.0

    申请日:2021-12-27

    Inventor: 祝叶华 孙炜

    Abstract: 本申请实施例公开了一种任务数据处理方法、装置以及电子设备。所述方法包括:第二数据处理模块响应于接收到的中断信号,获取所接收到的中断信号的内容;若中断信号的内容表征终止当前任务并开始执行下一任务,清理第一数据缓冲模块、第二数据处理模块以及第二数据缓冲模块中的与当前任务对应的任务数据;若中断信号的内容表征暂停当前任务并开始执行下一任务,存储当前任务对应的任务状态数据;执行中断信号对应的下一任务。通过上述方式使得,可以基于中断信号对当前任务数据进行清理或者存储当前任务对应的任务状态数据,避免了电子设备在执行与中断信号对应的下一任务时出现数据处理异常的问题。

    计算方法及相关装置
    6.
    发明公开

    公开(公告)号:CN114063979A

    公开(公告)日:2022-02-18

    申请号:CN202111436343.9

    申请日:2021-11-29

    Inventor: 祝叶华 孙炜

    Abstract: 本申请公开了一种计算方法及相关装置,所述方法包括:获取M位的第一数据,以及获取N位的第二数据,M、N均为大于1的整数,且M、N之间的公约数大于1;根据所述公约数对所述第一数据进行分割,得到P个字段,P为正整数;根据所述公约数对所述第二数据进行分割,得到Q个字段,Q为正整数;根据所述P个字段和所述Q个字段进行乘法运算,得到P*Q个第一中间结果;根据所述P*Q个第一中间结果确定所述第一数据与所述第二数据的乘积结果。采用本申请实施例能够支持多种精度计算需求。

    神经网络加速器、数据处理装置及神经网络加速方法

    公开(公告)号:CN113780541A

    公开(公告)日:2021-12-10

    申请号:CN202111020115.3

    申请日:2021-09-01

    Inventor: 祝叶华 孙炜

    Abstract: 本申请提供一种神经网络加速器,包括第一处理单元和第二处理单元;所述第一处理单元中的第一数据中转模块与所述第二处理单元中的第二数据中转模块连接;所述第一处理单元通过所述第一数据中转模块,向所述第二数据中转模块发送第一目标数据,和/或,所述第一处理单元通过所述第一数据中转模块接收所述第二数据中转模块发送的第二目标数据。本申请还提供一种数据处理装置和神经网络加速方法。

    对象处理方法及装置、电子设备、存储介质

    公开(公告)号:CN114090262B

    公开(公告)日:2024-12-03

    申请号:CN202111434793.4

    申请日:2021-11-29

    Inventor: 祝叶华 孙炜

    Abstract: 本公开实施例是关于一种对象处理方法及装置、电子设备、存储介质,涉及计算机技术领域,该对象处理方法包括:获取对待处理对象进行处理操作包含的多个类型的处理算法;通过所述多个类型的处理算法的属性信息,从待选计算引擎中为每个类型的处理算法分配目标计算引擎;所述待选计算引擎包括引擎资源池中的多个计算引擎以及专用计算引擎;基于所述目标计算引擎对所述待处理对象进行对应的处理算法以执行处理操作,获取所述待处理对象对应的操作结果。本公开的技术方案能够准确分配计算资源,提高资源分配的均衡性。

    神经网络加速器、数据处理方法、电子设备及存储介质

    公开(公告)号:CN117494771A

    公开(公告)日:2024-02-02

    申请号:CN202210867431.2

    申请日:2022-07-22

    Abstract: 本申请实施例公开了一种神经网络加速器、数据处理方法、电子设备及存储介质,神经网络加速器包括:卷积处理阵列、地址生成器、数据传输器和数据存储器;数据传输器,与卷积处理阵列、地址生成器,以及数据存储器分别耦合;卷积处理阵列,用于对媒体数据进行卷积处理,生成特征图数据;地址生成器,用于针对特征图数据中待上采样的第一数据,生成多个存储地址,并将多个存储地址传输至数据传输器;多个存储地址对应于数据存储器的多个存储单元;数据传输器,用于向数据存储器中多个存储地址的相应各存储单元,分别传输第一数据进行存储,以实现针对第一数据的上采样处理。

    运算处理器、数据处理方法及装置、可读介质和电子设备

    公开(公告)号:CN117055841A

    公开(公告)日:2023-11-14

    申请号:CN202210482177.4

    申请日:2022-05-05

    Inventor: 祝叶华 孙炜

    Abstract: 本公开提供一种运算处理器、数据处理方法及装置、可读介质和电子设备,涉及计算机技术领域。该运算处理器包括:两个或者两个以上结构相同的处理器核心,用于处理运算任务;通信线路,用于连接各所述处理器核心,并传输所述处理器核心之间在协作处理所述运算任务时共享的运算数据;其中,所述处理器核心的分布呈镜像布局以使所述处理器核心之间所述通信线路的路径最短。本公开提出的运算处理器,采用镜像对称的多核心硬件架构,提升运算处理器架构的可扩展性和灵活性,并且通过镜面对称的方式进行后端布局,节省了处理器核心之间的数据传输功耗,较短的数据传输路径减少了数据传输间的延时,提高运算性能。

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