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发明授权
一种降低大规模集成电路漏电功耗的设计方法有权转让质押

公开(公告)号：CN100481092C

公开(公告)日：2009-04-22

申请号：CN200710078337.4

申请日：2007-03-27

Applicant: 重庆重邮信科通信技术有限公司

Inventor： 陈晓冬 , 杨小勇

IPC: G06F17/50 , G06F1/32

Abstract: 本发明提出一种采用双阈值法对大规模集成电路进行网表逻辑综合，以降低大规模集成电路漏电功耗的设计方法。本发明设计方法在对大规模集成电路进行网表逻辑综合时，先定义集合Q并用Hvt库和时序要求比较宽松的时序约束进行综合，得到一个最初的Hvt库网表并进行时序分析，将发生时序偏移的路径信息保存在集合Q中，计算集合Q中每一条路径的每一个逻辑块xi的延迟时间tph(xi)和消耗的静态功耗Ph(xi)；将发生时序偏移路径上的逻辑块全部换成Lvt库，得到校正网表；将集合Q中电路的时序要求换成比较严格的时序约束，并在此时序约束下，对集合Q中替换成Lvt库的路径反复执行优先使用Hvt库的处理直到无定时误差且电路漏电功耗达到最小为止。

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