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公开(公告)号：CN108734272A
公开(公告)日：2018-11-02
申请号：CN201810337318.7
申请日：2018-04-16
Applicant: 英特尔公司
Inventor： 马立伟 , E.奥尔德-艾哈迈德-瓦尔 , B.拉克什马南 , B.J.阿什鲍格 , J.金 , J.博特莱森 , M.B.麦克弗森 , K.尼利斯 , D.斯利瓦斯塔瓦 , J.雷 , P.T.唐 , M.S.斯特里克兰 , X.陈 , 姚安邦 , T.斯派斯曼 , A.科克 , A.R.阿普
CPC classification number: G06N3/04 , G06N3/0445 , G06N3/0454 , G06N3/063 , G06N3/082 , G06T1/20 , G06F9/3851 , G06F9/3887 , G06N3/084
Abstract: 本发明涉及卷积神经网络优化机构。公开了一种促进卷积神经网络（CNN）的优化的装置。所述装置包括优化逻辑，所述优化逻辑要接收具有指令列表的CNN模型，并且所述优化逻辑包括通过消除所述指令列表中包括权重值0的分支对所述指令列表进行优化的修剪逻辑。
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公开(公告)号：CN113672197A
公开(公告)日：2021-11-19
申请号：CN202110906984.X
申请日：2018-04-27
Applicant: 英特尔公司
Inventor： H.考尔 , M.A.安德斯 , S.K.马修 , 姚安邦 , J.雷 , P.T.唐 , M.S.斯特里克兰德 , X.陈 , T.斯派斯曼 , A.R.阿普 , A.科克 , K.辛哈 , B.温布 , N.C.G.冯博里斯 , E.努尔维塔迪 , R.巴里克 , T-H.林 , V.兰加纳坦 , S.雅哈吉达尔
IPC: G06F7/57
Abstract: 一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
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公开(公告)号：CN112947894B
公开(公告)日：2024-07-26
申请号：CN202110256528.5
申请日：2018-04-27
Applicant: 英特尔公司
Inventor： H.考尔 , M.A.安德斯 , S.K.马修 , 姚安邦 , J.雷 , P.T.唐 , M.S.斯特里克兰德 , X.陈 , T.斯派斯曼 , A.R.阿普 , A.科克 , K.辛哈 , B.温布 , N.C.G.冯博里斯 , E.努尔维塔迪 , R.巴里克 , T-H.林 , V.兰加纳坦 , S.雅哈吉达尔
IPC: G06F7/57
Abstract: 一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
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公开(公告)号：CN115826916A
公开(公告)日：2023-03-21
申请号：CN202211446828.0
申请日：2018-04-27
Applicant: 英特尔公司
Inventor： H.考尔 , M.A.安德斯 , S.K.马修 , 姚安邦 , J.雷 , P.T.唐 , M.S.斯特里克兰德 , X.陈 , T.斯派斯曼 , A.R.阿普 , A.科克 , K.辛哈 , B.温布 , N.C.G.冯博里斯 , E.努尔维塔迪 , R.巴里克 , T-H.林 , V.兰加纳坦 , S.雅哈吉达尔
IPC: G06F7/57
Abstract: 一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
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公开(公告)号：CN111666066B
公开(公告)日：2021-11-09
申请号：CN202010498935.2
申请日：2018-04-27
Applicant: 英特尔公司
Inventor： H.考尔 , M.A.安德斯 , S.K.马修 , 姚安邦 , J.雷 , P.T.唐 , M.S.斯特里克兰德 , X.陈 , T.斯派斯曼 , A.R.阿普 , A.科克 , K.辛哈 , B.温布 , N.C.G.冯博里斯 , E.努尔维塔迪 , R.巴里克 , T-H.林 , V.兰加纳坦 , S.雅哈吉达尔
IPC: G06F7/57
Abstract: 一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
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Patent Agency Ranking
公开(公告)号：CN112947894A
公开(公告)日：2021-06-11
申请号：CN202110256528.5
申请日：2018-04-27
Applicant: 英特尔公司
Inventor： H.考尔 , M.A.安德斯 , S.K.马修 , 姚安邦 , J.雷 , P.T.唐 , M.S.斯特里克兰德 , X.陈 , T.斯派斯曼 , A.R.阿普 , A.科克 , K.辛哈 , B.温布 , N.C.G.冯博里斯 , E.努尔维塔迪 , R.巴里克 , T-H.林 , V.兰加纳坦 , S.雅哈吉达尔
IPC: G06F7/57
Abstract: 一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
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公开(公告)号：CN112947893B
公开(公告)日：2024-09-10
申请号：CN202110250102.9
申请日：2018-04-27
Applicant: 英特尔公司
Inventor： H.考尔 , M.A.安德斯 , S.K.马修 , 姚安邦 , J.雷 , P.T.唐 , M.S.斯特里克兰德 , X.陈 , T.斯派斯曼 , A.R.阿普 , A.科克 , K.辛哈 , B.温布 , N.C.G.冯博里斯 , E.努尔维塔迪 , R.巴里克 , T-H.林 , V.兰加纳坦 , S.雅哈吉达尔
IPC: G06F7/57
Abstract: 一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
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公开(公告)号：CN112527243B
公开(公告)日：2024-09-10
申请号：CN202011533036.8
申请日：2018-04-27
Applicant: 英特尔公司
Inventor： H.考尔 , M.A.安德斯 , S.K.马修 , 姚安邦 , J.雷 , P.T.唐 , M.S.斯特里克兰德 , X.陈 , T.斯派斯曼 , A.R.阿普 , A.科克 , K.辛哈 , B.温布 , N.C.G.冯博里斯 , E.努尔维塔迪 , R.巴里克 , T-H.林 , V.兰加纳坦 , S.雅哈吉达尔
IPC: G06F7/57
Abstract: 一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
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公开(公告)号：CN113672197B
公开(公告)日：2024-07-02
申请号：CN202110906984.X
申请日：2018-04-27
Applicant: 英特尔公司
Inventor： H.考尔 , M.A.安德斯 , S.K.马修 , 姚安邦 , J.雷 , P.T.唐 , M.S.斯特里克兰德 , X.陈 , T.斯派斯曼 , A.R.阿普 , A.科克 , K.辛哈 , B.温布 , N.C.G.冯博里斯 , E.努尔维塔迪 , R.巴里克 , T-H.林 , V.兰加纳坦 , S.雅哈吉达尔
IPC: G06F7/57
Abstract: 一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
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公开(公告)号：CN116755656A
公开(公告)日：2023-09-15
申请号：CN202310795238.7
申请日：2018-04-27
Applicant: 英特尔公司
Inventor： H.考尔 , M.A.安德斯 , S.K.马修 , 姚安邦 , J.雷 , P.T.唐 , M.S.斯特里克兰德 , X.陈 , T.斯派斯曼 , A.R.阿普 , A.科克 , K.辛哈 , B.温布 , N.C.G.冯博里斯 , E.努尔维塔迪 , R.巴里克 , T-H.林 , V.兰加纳坦 , S.雅哈吉达尔
IPC: G06F7/57
Abstract: 一个实施例提供了包括具有在整数数据路径和浮点数据路径之间共享的加法器和乘法器的计算单元的机器学习硬件加速器，到乘法器的输入操作数的高位要在浮点操作期间被门控。
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