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公开(公告)号：CN110430462B
公开(公告)日：2021-08-31
申请号：CN201910712380.4
申请日：2019-08-02
Applicant: 福州大学
IPC: H04N21/434 , H04N21/4402 , H04N21/458
Abstract: 本发明涉及一种基于UHD解码器的快速自动设置方法，包括以下步骤：步骤S1：在编码器端，将输入数据打包复用，形成传送码流；步骤S2:对传送码流的PMT进行修改调整，并在video循环中添加私有描述子enc_params；步骤S3:编码器输出传送码流至传输模块，通过无线信道进入解码器端的传输模块；步骤S4:解码器端接受编码器端输出的传送码流，启动解码；步骤S5:解码器在系统层过滤解码节目PMT表，分析是否存在enc_params描述子，若存在enc_params描述子，分析enc_params描述子，完成设置解码器参数；若不存在，则分别从系统层和编码层提取参数，根据数据的时序特性计算出非显性参数，并设置解码器。本发明根据不同的结果采取不同的分析提取方法，保证解码器可以正常处理和解码不同编码器输出的码流。
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公开(公告)号：CN119341690A
公开(公告)日：2025-01-21
申请号：CN202411444418.1
申请日：2024-10-16
Applicant: 福州大学
IPC: H04L1/00
Abstract: 本发明涉及一种面向实时可靠控制的网络编码通信方法，该方法包括以下步骤：步骤S1、初始化编码器参数，建立数据包传输的端到端的模拟信道，针对上层传来的数据包进行基于有限域的随机系数编码，并封装相应的数据包头，通过UDP协议发送给相应的接收端。步骤S2、初始化解码器参数，通过监听UDP端口，获取传来的编码数据，将数据包解封装，并根据包头信息进行相应的解码操作，以恢复出在传输过程中遭遇丢失的数据包。该方法能够在不依赖反馈重传的情况下，在工业物联网通信环境恶劣时，实现低于1ms按序时延（数据包在解码器中阻塞的时间）的高实时性，以及实现小于10‑5错误率的高可靠数据传输。
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Patent Agency Ranking
公开(公告)号：CN110475142B
公开(公告)日：2021-11-02
申请号：CN201910760186.3
申请日：2019-08-16
Applicant: 福州大学
IPC: H04N21/433 , H04N21/439 , H04N21/4402
Abstract: 本发明涉及一种基于FPGA的3G‑SDI数据流转换方法，采集level B‑DL中的4个音视频数据流；对4个level B‑DL音视频数据流进行数据处理，形成新的低占存符合Level A标准的四种数据流，分别为数据流1至数据流4；将四个数据流分为两组，分别输入到两个独立的FIFO存储器中进行存储；控制两个FIFO存储器交替行输出，形成新的Level A数据流。本发明解决了某些设备无法对Level B‑DL进行处理的问题，为后端编解码提供方便。
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公开(公告)号：CN110475142A
公开(公告)日：2019-11-19
申请号：CN201910760186.3
申请日：2019-08-16
Applicant: 福州大学
IPC: H04N21/433 , H04N21/439 , H04N21/4402
Abstract: 本发明涉及一种基于FPGA的3G-SDI数据流转换方法，采集level B-DL中的4个音视频数据流；对4个level B-DL音视频数据流进行数据处理，形成新的低占存符合Level A标准的四种数据流，分别为数据流1至数据流4；将四个数据流分为两组，分别输入到两个独立的FIFO存储器中进行存储；控制两个FIFO存储器交替行输出，形成新的Level A数据流。本发明解决了某些设备无法对Level B-DL进行处理的问题，为后端编解码提供方便。
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公开(公告)号：CN110430462A
公开(公告)日：2019-11-08
申请号：CN201910712380.4
申请日：2019-08-02
Applicant: 福州大学
IPC: H04N21/434 , H04N21/4402 , H04N21/458
Abstract: 本发明涉及一种基于UHD解码器的快速自动设置方法，包括以下步骤：步骤S1：在编码器端，将输入数据打包复用，形成传送码流；步骤S2:对传送码流的PMT进行修改调整，并在video循环中添加私有描述子enc_params；步骤S3:编码器输出传送码流至传输模块，通过无线信道进入解码器端的传输模块；步骤S4:解码器端接受编码器端输出的传送码流，启动解码；步骤S5:解码器在系统层过滤解码节目PMT表，分析是否存在enc_params描述子，若存在enc_params描述子，分析enc_params描述子，完成设置解码器参数；若不存在，则分别从系统层和编码层提取参数，根据数据的时序特性计算出非显性参数，并设置解码器。本发明根据不同的结果采取不同的分析提取方法，保证解码器可以正常处理和解码不同编码器输出的码流。
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公开(公告)号：CN119945625A
公开(公告)日：2025-05-06
申请号：CN202510199121.1
申请日：2025-02-22
Applicant: 福州大学
Abstract: 本发明提供一种解决高突发的应用层编解码方法，在应用层，通过第一缓存队列接收上层传递的数据，编码器从第一缓存队列中取出源数据包进行包头封装和进行的编码操作后，将源数据包和编码包通过发送端socket发送；通过第二缓存队列从接收端socket获取数据包，解码器从第二缓存队列取出数据包，并根据数据包头信息进行译码恢复操作，将恢复获得的数据包排序后按序传至上层。该方案能够在高突发信道环境下，具有比里德‑所罗门码（Reed‑Solomon,RS）和滑动RLNC（Caterpillar RLNC,CRLNC）更低的译码失败概率。
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公开(公告)号：CN110475144A
公开(公告)日：2019-11-19
申请号：CN201910759460.5
申请日：2019-08-16
Applicant: 福州大学
IPC: H04N21/439
Abstract: 本发明涉及一种基于FPGA的12G-SDI数据流中16声道音频的提取方法，接收通过12G-SDI接口传输的音视频数据流；对接收到的音频数据流进行CS差错检验；若数据流检验结果正确，则进行音频控制包的提取步骤，并进行音频数据包的提取步骤；若数据检验结果错误，则执行复位步骤；从音频数据包中提取音频数据，并将其传递到FIFO存储器进行缓存，之后进行I2S输出。本发明可以对12G-SDI接口所产生的数据流进行更加快速、稳定的音频提取，从而提升音频在提取的快速、高校、准确性。
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