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公开(公告)号：CN111737069A
公开(公告)日：2020-10-02
申请号：CN202010567746.6
申请日：2020-06-19
Applicant: 浪潮(北京)电子信息产业有限公司
IPC: G06F11/22 , G06F11/273
Abstract: 本申请公开了一种调试电路，包括FPGA芯片、电平转换芯片、开关芯片以及CPU芯片；所述FPGA芯片与所述CPU芯片均分别连接所述电平转换芯片与所述开关芯片，且所述FPGA芯片还连接所述CPU芯片；所述FPGA芯片，用于输出第一控制信号至所述电平转换芯片与所述开关芯片，以择一的使所述电平转换芯片或所述开关芯片工作；输出第二控制信号至所述CPU芯片，以使所述CPU芯片根据所述第二控制信号调整复用接口的功能。该调试电路能够节省调试时间，提高电路稳定性，降低开发板失效风险。本申请还公开了一种开发板、调试方法、设备及计算机可读存储介质，均具有上述技术效果。
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公开(公告)号：CN111736678A
公开(公告)日：2020-10-02
申请号：CN202010537351.1
申请日：2020-06-12
Applicant: 浪潮(北京)电子信息产业有限公司
Abstract: 本申请公开了一种芯片复位电路，包括第一逻辑电路，第二逻辑电路、延时芯片以及或门；第一逻辑电路与第二逻辑电路均分别连接复位按键与基板管理控制器，且二者对复位按键输出的电平与基板管理控制器的复位管脚输出的电平进行相反的逻辑运算，分别输出第一电平与第二电平。第一电平经延时芯片延迟后输出至或门，第二电平无延迟直接输出至或门。或门对延时芯片输出的电平与第二电平进行或逻辑运算得到第三电平，并输出第三电平至目标芯片。该电路可在实现两个复位信号任意一个均可复位芯片的同时，解决两个复位信号中任意一个信号拉低后无法恢复为高电平而导致芯片挂死的问题。本申请还公开了一种芯片复位方法及设备，均具有上述技术效果。
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公开(公告)号：CN111736678B
公开(公告)日：2022-06-10
申请号：CN202010537351.1
申请日：2020-06-12
Applicant: 浪潮(北京)电子信息产业有限公司
Abstract: 本申请公开了一种芯片复位电路，包括第一逻辑电路，第二逻辑电路、延时芯片以及或门；第一逻辑电路与第二逻辑电路均分别连接复位按键与基板管理控制器，且二者对复位按键输出的电平与基板管理控制器的复位管脚输出的电平进行相反的逻辑运算，分别输出第一电平与第二电平。第一电平经延时芯片延迟后输出至或门，第二电平无延迟直接输出至或门。或门对延时芯片输出的电平与第二电平进行或逻辑运算得到第三电平，并输出第三电平至目标芯片。该电路可在实现两个复位信号任意一个均可复位芯片的同时，解决两个复位信号中任意一个信号拉低后无法恢复为高电平而导致芯片挂死的问题。本申请还公开了一种芯片复位方法及设备，均具有上述技术效果。
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