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公开(公告)号:CN109417090B
公开(公告)日:2023-01-20
申请号:CN201780041600.4
申请日:2017-06-29
IPC: H01L29/06 , H01L29/12 , H01L29/47 , H01L29/78 , H01L29/861 , H01L29/868 , H01L29/872
Abstract: 在p型连接层(30)的前端连结p型扩张区域(40)。通过形成这样的p型扩张区域(40),能够消除在p型连接层(30)与p型保护环(21)之间间隔变大的区域。因此,在台面部中,能够抑制等电位线过度隆起,能够确保耐压。
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公开(公告)号:CN104380471B
公开(公告)日:2017-10-27
申请号:CN201380031045.9
申请日:2013-06-06
IPC: H01L29/78 , H01L21/28 , H01L21/336 , H01L27/04 , H01L29/06 , H01L29/12 , H01L29/47 , H01L29/861 , H01L29/868 , H01L29/872
CPC classification number: H01L29/7811 , H01L21/046 , H01L21/0475 , H01L21/30604 , H01L21/308 , H01L21/761 , H01L21/8213 , H01L29/0615 , H01L29/063 , H01L29/0634 , H01L29/0661 , H01L29/0696 , H01L29/0878 , H01L29/1095 , H01L29/157 , H01L29/158 , H01L29/1608 , H01L29/41766 , H01L29/4236 , H01L29/66068 , H01L29/66727 , H01L29/66734 , H01L29/7806 , H01L29/7813 , H01L29/861 , H01L29/872
Abstract: SiC半导体装置具备以埋入沟槽(5a)内的方式具有低浓度区域(5b)和高浓度区域(5c)的p型区域(5),该沟槽(5a)形成在单元区域中,由低浓度区域(5b)构成p型柱,并且由高浓度区域(5c)构成p+型深层。由此,能够由基于低浓度区域(5b)的p型柱和基于n型漂移层(2)的n型柱构成SJ构造,所以实现了导通电阻的降低。此外,通过基于高浓度区域(5c)的p+型深层在截止时阻断漏极电位,所以能够缓和对栅极绝缘膜(8)施加的电场,能够防止栅极绝缘膜(8)被破坏。因此,SiC半导体装置能够实现降低导通电阻和防止栅极绝缘膜(8)破坏这双方。
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公开(公告)号:CN104969348A
公开(公告)日:2015-10-07
申请号:CN201380071969.1
申请日:2013-12-19
CPC classification number: H01L29/1608 , H01L21/761 , H01L27/088 , H01L29/0615 , H01L29/0642 , H01L29/1095 , H01L29/66068 , H01L29/7813 , H01L29/7815
Abstract: 碳化硅半导体装置具备元件分离层(14)和电场缓和层(15)。元件分离层在主单元区域(Rm)与感测单元区域(Rs)之间,从基极区域(3)的表面形成至比所述基极区域更深,分离为所述主单元区域侧和所述感测单元区域侧。电场缓和层从所述基极区域的底部形成至比所述元件分离层更深的位置。所述电场缓和层被分离为所述主单元区域侧和所述感测单元区域侧,在所述电场缓和层的分离部分的内侧配置有所述元件分离层的至少一部分。
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公开(公告)号:CN110050349B
公开(公告)日:2022-05-10
申请号:CN201780075779.5
申请日:2017-12-12
Abstract: 在保护环部中,通过在n‑型漂移层(2)的表层部形成电场缓和用的电场缓和层(40),从而抑制电场进入p型保护环(21)之间。由此,电场集中得到缓和,由电场集中引起的层间绝缘膜(10)的击穿得到抑制,能够抑制耐压下降。因此,能够制成可得到所期望的耐压的SiC半导体装置。
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公开(公告)号:CN109417087B
公开(公告)日:2021-07-23
申请号:CN201780041004.6
申请日:2017-06-29
IPC: H01L29/06 , H01L29/12 , H01L29/47 , H01L29/78 , H01L29/861 , H01L29/868 , H01L29/872
Abstract: 使相邻的p型保护环(21)彼此的间隔全部达到p型深层(5)彼此的间隔以下。由此,p型保护环(21)的间隔增大、即沟槽(21a)变稀疏,由此能够抑制在使外延生长p型层(50)时在保护环部形成得较厚。因此,如果在回蚀时将单元部的p型层(50)去除,则能够在保护环部不留残渣地去除p型层(50)。因此,在对p型层(50)进行回蚀来形成p型深层(5)或p型保护环(21)及p型连接层(30)时,能够抑制p型层(50)的残渣残留在保护环部。
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公开(公告)号:CN110226235A
公开(公告)日:2019-09-10
申请号:CN201880008427.2
申请日:2018-01-17
IPC: H01L29/78 , H01L21/336 , H01L21/76 , H01L29/06 , H01L29/12
Abstract: 具备元件分离层(14)以将主单元区域(Rm)与感测单元区域(Rs)之间电分离,在元件分离层(14)的底部具备电场缓和层(15)以缓和电场集中。此外,将电场缓和层(15)以直线状构成,将相邻的电场缓和层(15)以与相邻的p型深层(5)的间隔(Wd)相同的间隔形成,抑制电场的进入。进而,在从主单元区域(Rm)侧突出的电场缓和层(15)与从感测单元区域(Rs)侧突出的电场缓和层(15)之间,也使两者的间隔(Wp)为相邻的p型深层(5)的间隔(Wd)以下,抑制电场的进入。
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公开(公告)号:CN109417090A
公开(公告)日:2019-03-01
申请号:CN201780041600.4
申请日:2017-06-29
IPC: H01L29/06 , H01L29/12 , H01L29/47 , H01L29/78 , H01L29/861 , H01L29/868 , H01L29/872
Abstract: 在p型连接层(30)的前端连结p型扩张区域(40)。通过形成这样的p型扩张区域(40),能够消除在p型连接层(30)与p型保护环(21)之间间隔变大的区域。因此,在台面部中,能够抑制等电位线过度隆起,能够确保耐压。
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公开(公告)号:CN107615492A
公开(公告)日:2018-01-19
申请号:CN201680030119.0
申请日:2016-04-05
IPC: H01L29/78 , H01L21/20 , H01L21/265 , H01L21/336 , H01L29/06 , H01L29/12
Abstract: 半导体装置具有:基板(1),其包括外周区域和具有半导体元件的单元区域;以及所述基板上的漂移层(2)。半导体元件具备基极区域(3)、源极区域(4)、沟槽栅构造、比栅极沟槽深的深层(5)、源极电极(11)、以及漏极电极(12)。外周区域具有使所述漂移层露出的凹部(20)、以及保护环层(21),保护环层具有在露出了的所述漂移层的表面包围所述单元区域的多个框形状的保护环沟槽(21c)、以及配置于保护环沟槽内的第1保护环(21a)。所述深沟槽的宽度和所述保护环沟槽的宽度。
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公开(公告)号:CN109417088B
公开(公告)日:2021-09-14
申请号:CN201780041566.0
申请日:2017-06-29
IPC: H01L29/06 , H01L29/12 , H01L29/47 , H01L29/78 , H01L29/861 , H01L29/868 , H01L29/872
Abstract: 关于框状部(32)及p型保护环(21)中的单元部侧与其他部分相比间隔窄,将使间隔变窄的部分设为点线部(211、322)。这样,使框状部(32)及p型保护环(21)中的单元部侧的间隔变窄,从而将单元部侧的电场集中缓和,使得等电位线更朝向外周侧。此外,通过设置点线部(211、322),在单元部、连接部及保护环部,减少每单位面积的沟槽的形成面积的差,使形成在单元部、连接部及保护环部之上的p型层的厚度均匀化。由此,当将p型层进行回蚀时,能够抑制p型层作为残渣残留在保护环部。
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公开(公告)号:CN107615492B
公开(公告)日:2020-09-29
申请号:CN201680030119.0
申请日:2016-04-05
IPC: H01L29/78 , H01L21/20 , H01L21/265 , H01L21/336 , H01L29/06 , H01L29/12
Abstract: 半导体装置具有:基板(1),其包括外周区域和具有半导体元件的单元区域;以及所述基板上的漂移层(2)。半导体元件具备基极区域(3)、源极区域(4)、沟槽栅构造、比栅极沟槽深的深层(5)、源极电极(11)、以及漏极电极(12)。外周区域具有使所述漂移层露出的凹部(20)、以及保护环层(21),保护环层具有在露出了的所述漂移层的表面包围所述单元区域的多个框形状的保护环沟槽(21c)、以及配置于保护环沟槽内的第1保护环(21a)。所述深沟槽的宽度和所述保护环沟槽的宽度。
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