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公开(公告)号：CN1841504A
公开(公告)日：2006-10-04
申请号：CN200610073336.6
申请日：2006-03-31
Applicant: 富士通株式会社
IPC: G11B5/09
CPC classification number: G11B20/10009 , G11B20/10194 , G11B20/1426 , G11B2020/1457
Abstract: 编码器和解码器。编码位串生成单元生成通过对输入位串进行加扰而进行了编码的位串。直流分量评估单元在逐位地移动多个位的同时，在由编码位串生成单元生成的位串中选择具有预定宽度的位串，并对所选择的位串中的直流分量进行评估。位串提取单元根据直流分量评估单元的评估结果，提取抑制了直流分量的位串。
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公开(公告)号：CN1684182A
公开(公告)日：2005-10-19
申请号：CN200410098210.5
申请日：2004-11-30
Applicant: 富士通株式会社
CPC classification number: H03M5/145 , G11B20/1426
Abstract: 一种记录再生装置，包括：RLL编码器，其将信息比特串编码为代码比特串；以及RLL解码器，将代码比特串解码为信息比特串。该RLL编码器将信息比特串编码为满足关于连续0串的多个约束条件的高编码率的游程长度受限码的代码比特串。该RLL解码器将该RLL编码器编码的代码比特串解码为信息比特串。
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Patent Agency Ranking
公开(公告)号：CN1684182B
公开(公告)日：2010-08-11
申请号：CN200410098210.5
申请日：2004-11-30
Applicant: 富士通株式会社
CPC classification number: H03M5/145 , G11B20/1426
Abstract: 一种记录再生装置，包括：RLL编码器，其将信息比特串编码为代码比特串；以及RLL解码器，将代码比特串解码为信息比特串。该RLL编码器将信息比特串编码为满足关于连续0串的多个约束条件的高编码率的游程长度受限码的代码比特串。该RLL解码器将该RLL编码器编码的代码比特串解码为信息比特串。
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公开(公告)号：CN1841548A
公开(公告)日：2006-10-04
申请号：CN200510104008.3
申请日：2005-09-12
Applicant: 富士通株式会社
CPC classification number: G11B20/10009 , G11B20/10194 , G11B20/1426 , G11B2020/1457
Abstract: 编码器和解码器。编码器包括：编码比特串生成单元，通过对输入比特串进行扰码而生成多个编码比特串；直流分量估计单元，在逐一或每m位地移位的同时在编码比特串生成单元生成的比特串中选择具有预定宽度的比特串，其中m为正整数，并估计所选择的各个比特串中的直流分量；以及比特串提取单元，根据直流分量估计单元的估计结果，从编码比特串中提取直流分量被抑制的比特串。
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公开(公告)号：CN101316100A
公开(公告)日：2008-12-03
申请号：CN200810098365.7
申请日：2008-05-30
Applicant: 富士通株式会社
IPC: H03H11/12
CPC classification number: H03H11/1291 , H03H7/12 , H03H2007/0192 , H03H2011/0494
Abstract: 本发明公开了滤波电路和半导体装置。滤波电路包括低通滤波器和校准该低通滤波器的频率特性的校准电路。该校准电路包括负反馈电路和控制电路。当滤波电路处于校准模式时，负反馈电路向低通滤波器提供负反馈以形成环路，并且将该环路的增益设为大于一以使该环路振荡。当滤波电路处于校准模式时，控制电路控制低通滤波器的频率特性，以使得环路的振荡频率属于预定范围内。
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公开(公告)号：CN100382143C
公开(公告)日：2008-04-16
申请号：CN200610073336.6
申请日：2006-03-31
Applicant: 富士通株式会社
IPC: G11B5/09
CPC classification number: G11B20/10009 , G11B20/10194 , G11B20/1426 , G11B2020/1457
Abstract: 编码器和解码器。编码位串生成单元生成通过对输入位串进行加扰而进行了编码的位串。直流分量评估单元在逐位地移动多个位的同时，在由编码位串生成单元生成的位串中选择具有预定宽度的位串，并对所选择的位串中的直流分量进行评估。位串提取单元根据直流分量评估单元的评估结果，提取抑制了直流分量的位串。
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公开(公告)号：CN1841939A
公开(公告)日：2006-10-04
申请号：CN200510085097.1
申请日：2005-07-20
Applicant: 富士通株式会社
CPC classification number: H03M5/145
Abstract: 使用游程有限码的编码器和解码器。当从存储在第一输入寄存器(1111)和第二输入寄存器(1112)中的数据中检测到违背游程有限(RLL)码的G约束条件的零游程时，经由零游程消除用总线(1130)将零游程之前和之后的数据位传送到临时寄存器(1150)，以将它们彼此组合起来。这样，通过有效地利用总线传输的机制，电路能够得到简化，从而实现了小电路。
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