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公开(公告)号：CN119652565A
公开(公告)日：2025-03-18
申请号：CN202411647216.7
申请日：2024-11-18
Applicant: 南京理工大学 , 中国科学院信息工程研究所
Abstract: 本发明公开一种Dilithium快速侧信道攻击分析方法，属于信息安全技术领域，采用高斯混合差值法检测泄漏，完成特征点的检测与选择；利用签名信息对私钥参与的实际泄漏进行分类，并利用分布上的差异来恢复正常域私钥。本发明解决了已有非模板类攻击小样本泄漏下时间开销大的问题。使用少量签名产生的侧信息泄漏，在高噪声水平下数分钟内即可恢复完整私钥。高斯混合差值法相较于已有泄漏检测方法，无需获取敏感中间值就可以完成特征点的检测与选择。本发明可用于检测该密码设备、密码芯片是否安全可靠，例如金融经济的银行卡、数字货币实体卡、移动通信的手机芯片等领域，以检测设备是否存在安全风险。
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公开(公告)号：CN118551233A
公开(公告)日：2024-08-27
申请号：CN202410584209.0
申请日：2024-05-11
Applicant: 南京理工大学 , 中国科学院信息工程研究所
IPC: G06F18/22 , G06F18/23 , G06F18/15 , G06F21/60 , G06F123/02
Abstract: 本发明公开了一种基于时间模板匹配的特征点提取方法，属于信息安全技术领域。本发明包括对采集的电磁迹进行分块方差处理；对分块方差处理后的电磁迹进行数模转换处理、去抖动处理；对去抖动处理后的电磁迹进行高斯模糊处理，高斯模糊完成后再次进行数模转换处理和去抖动处理；从电磁迹中截取采样点进行POIs标注；利用标注结果对POIs聚类，进行取极值点处理；依据POI时间模板、类别数目进行时间模板匹配处理。本发明基于时间模板匹配的特征点提取方法，能够对双界面商用智能芯片卡运行过程中采集的电磁迹进行预处理，能够在保留POIs的前提下显著减少电磁迹中采样点个数。
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公开(公告)号：CN115964497A
公开(公告)日：2023-04-14
申请号：CN202310154608.9
申请日：2023-02-23
Applicant: 南京理工大学 , 中国科学院信息工程研究所
IPC: G06F16/35 , G06F40/289 , G06F40/30 , G06N3/08 , G06N3/047 , G06N3/0442 , G06N3/0464
Abstract: 本发明公开了一种融合注意力机制与卷积神经网络的事件抽取方法，其步骤包括：1)利用文本编码器对待提取文本内容进行特征表示，得到该待提取文本的分布式特征；2)利用特征提取器从所述分布式特征中提取该待提取文本的语境特征及词汇之间的关联信息；3)将该待提取文本的语境特征及词汇之间的关联信息输入事件触发词分类器，输出该待提取文本的事件触发词，然后基于该待提取文本的事件触发词确定该待提取文本的事件类型；4)事件元素分类器根据该待提取文本的事件类型、语境特征，对该待提取文本中每个分词依次进行判断是否为事件元素；5)使用元素角色分类器识别每一所述事件元素的角色类别。本发明大大提升了事件抽取的准确率且效率高。
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公开(公告)号：CN109617667A
公开(公告)日：2019-04-12
申请号：CN201811300731.2
申请日：2018-11-02
Applicant: 中国科学院信息工程研究所
Abstract: 本发明公开了一种针对AES算法线性部分的高效掩码防护方法。本方法为：1)生成掩码矩阵M′、M；然后利用M对待保护的中间值矩阵Q进行保护，即Q⊕M；2)对Q⊕M进行非线性运算，结果记为S；利用M’对S进行保护，即S⊕M′；3)对S⊕M′进行行移位变换，得到矩阵S'；4)利用S'对AES加密算法进行列混淆运算，得到矩阵T；5)更新M，进行正常的轮密钥加，更新前后的掩码矩阵M均为斜线上的掩码相同；6)重复步骤2)～5)多轮；当执行到最后一轮的线性运算时，只进行行移位变换和正常的轮密钥加，然后将变换后的S'与M’异或后作为AES的运算结果输出。
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公开(公告)号：CN107070630A
公开(公告)日：2017-08-18
申请号：CN201710035186.8
申请日：2017-01-17
Applicant: 中国科学院信息工程研究所
Abstract: 本发明公开了一种AES算法的快速安全硬件结构。本发明包括密钥扩展模块和加密模块；加密模块中的初始密钥加模块生成初始输入发送给四选二选择器；掩码字节替换模块对共享因子进行掩码字节替换后分别输出给行移位模块；行移位模块将移位处理结果输入列混淆模块；行移位模块及与其连接的列混淆模块将处理结果发送给一二选一选择器；其中一二选一选择器的输出端与轮密钥加模块输入端连接,轮密钥加模块的另一输入端与密钥扩展模块的轮密钥输出端连接，轮输出端与四选二选择器的轮输入端连接；另一二选一选择器的轮输出端与该四选二选择器的轮输入端连接；两二选一选择器的密文输出端分别与密文生成单元的输入端连接。本发明可保证敏感数据的安全。
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Patent Agency Ranking
公开(公告)号：CN106877999A
公开(公告)日：2017-06-20
申请号：CN201710035180.0
申请日：2017-01-17
Applicant: 中国科学院信息工程研究所
Abstract: 本发明公开了一种DES加解密密钥生成器及密钥生成方法。本发明包括控制单元、计算单元和输出寄存器单元；其中，控制单元，用于控制DES加解密密钥生成器内的状态机的状态跳转；加密过程中，计算单元根据当前的状态信息及其对应的密钥值、循环左移相对值计算每一周期的轮密钥和循环左移绝对值存入到输出寄存器单元，以及根据输出寄存器单元的值计算当前生成的轮密钥并输出；解密过程中，计算单元根据当前的状态信息及其对应的循环左移绝对值计算每一周期的循环右移相对值存入到输出寄存器单元，并根据输出寄存器单元的值计算对应周期的解密密钥值并输出。本发明不需要额外的存储单元存储密钥，同时将需要的逻辑单元化简到更少。
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公开(公告)号：CN118473645B
公开(公告)日：2025-04-15
申请号：CN202410527678.9
申请日：2024-04-29
Applicant: 南京理工大学 , 中国科学院信息工程研究所
Abstract: 本发明公开一种基于多项式基的共享加解密AES硬件实现方法，属于信息安全技术领域。本发明包括初始数据通路、1‑9轮函数数据通路、10轮函数数据通路以及4:1MUX四个部分；所述初始数据通路：实现了AES加密和解密的初始轮函数功能；所述1‑9轮函数数据通路：实现了AES加密和解密第1‑9轮的轮函数功能；所述10轮函数数据通路：实现了AES加密和解密第10轮的轮函数功能；所述4:1MUX：从初始轮函数的2个输出和第1‑9轮轮函数的2个输出中4选1，作为下一轮的轮函数输入。本发明相对基于正规基上的共享加解密AES硬件实现，具有面积小、单位面积吞吐率高的技术优势，可与多种掩码方案直接组合。
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公开(公告)号：CN106877999B
公开(公告)日：2020-05-22
申请号：CN201710035180.0
申请日：2017-01-17
Applicant: 中国科学院信息工程研究所
Abstract: 本发明公开了一种DES加解密密钥生成器及密钥生成方法。本发明包括控制单元、计算单元和输出寄存器单元；其中，控制单元，用于控制DES加解密密钥生成器内的状态机的状态跳转；加密过程中，计算单元根据当前的状态信息及其对应的密钥值、循环左移相对值计算每一周期的轮密钥和循环左移绝对值存入到输出寄存器单元，以及根据输出寄存器单元的值计算当前生成的轮密钥并输出；解密过程中，计算单元根据当前的状态信息及其对应的循环左移绝对值计算每一周期的循环右移相对值存入到输出寄存器单元，并根据输出寄存器单元的值计算对应周期的解密密钥值并输出。本发明不需要额外的存储单元存储密钥，同时将需要的逻辑单元化简到更少。
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公开(公告)号：CN104836639B
公开(公告)日：2018-04-27
申请号：CN201510153464.0
申请日：2015-04-02
Applicant: 中国科学院信息工程研究所
Abstract: 一种可传输多种算法参数的数据传输方法。本方法为：1)分别创建算法映射表、请求映射表、操作映射表、数据类型映射表和数据产生方式映射表，并保存到上位机和下位机中；2)设置一用于算法参数传输的数据帧结构；对于每一所选算法，上位机每次获取该算法的一待传输的参数，然后根据算法映射表、请求映射表、操作映射表、数据类型映射表和数据产生方式映射表，将该算法的标识码，该参数对应的请求、操作、数据类型、数据对应的标识码填充到数据帧结构对应字段中打包发送给下位机；3)下位机根据映射表对收到数据包中的该数据帧结构进行解析，并根据解析出的请求信息返回相应的结果给上位机。本发明大大节约了开发时间和成本，提高了传输效率。
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公开(公告)号：CN115021893B
公开(公告)日：2024-10-22
申请号：CN202210697673.1
申请日：2022-06-20
Applicant: 南京理工大学 , 中国科学院信息工程研究所
IPC: H04L9/06
Abstract: 本发明公开了一种共享核心函数的高效安全密码硬件。本发明的高效安全密码硬件在对加解密运算进行了形式一致化设计并构建融合T表后，进行了硬宏存储器块实现；其中形式一致化能够为共享核心函数提供形式上的基础；融合T表构建是共享核心函数设计的重要步骤，解决了SPN结构密码算法加解密不对称带来的额外资源消耗问题；硬宏存储器块实现是共享核心函数硬件实现的侧信道安全性提升的关键步骤。本发明大幅度降低了资源消耗，减少了密码实现所需要的面积，而且能够抵抗侧信道攻击，提升密码硬件实现的侧信道安全性。
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