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公开(公告)号：CN1892789A
公开(公告)日：2007-01-10
申请号：CN200610090320.6
申请日：2006-06-29
Applicant: 精工爱普生株式会社
Abstract: 本发明提供一种能够实现电路面积缩小的集成电路装置和电子设备。集成电路装置包括：用于驱动数据线的数据驱动块；多个控制晶体管TC1、TC2，各控制晶体管与数据驱动块的各个输出线对应地设置，各控制晶体管由公共控制信号控制；以及焊盘配置区域，配置有用于电气连接数据线和数据驱动块的输出线QL1、QL2的数据驱动器用焊盘P1、P2的。而且，控制晶体管TC1、TC2被配置在焊盘配置区域。
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公开(公告)号：CN1183405C
公开(公告)日：2005-01-05
申请号：CN02122257.6
申请日：2002-06-04
Applicant: 精工爱普生株式会社
Inventor： 石山久展
IPC: G02F1/133
CPC classification number: G09G3/2011 , G09G3/3614 , G09G3/3655 , G09G3/3688 , G09G2330/021 , H03K5/086 , H03K5/2481
Abstract: 在切换对置电极VCOM为VC1的期间T1(正极)和VCOM为VC2的期间T2(负极)时，将运算放大电路的输出设定为高阻抗状态。在期间T1中用具有P型驱动晶体管的P型运算放大器OP1来驱动数据线，而在期间T2中，用具有N型驱动晶体管的N型运算放大器OP2来驱动数据线。积极利用对置电极·数据线间的寄生电容在驱动前使数据线的电压电平变化。将运算放大电路的输出箝位在范围与电源VDD、VSS相同或更宽的电压范围内，将剩余电荷返回到电源侧。使箝位电路的电源VDD’、VSS’采用电压范围比运算放大电路的电源VDD、VSS窄的电源。
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公开(公告)号：CN1389847A
公开(公告)日：2003-01-08
申请号：CN02122263.0
申请日：2002-06-04
Applicant: 精工爱普生株式会社
Inventor： 石山久展
IPC: G09G3/36
CPC classification number: G09G3/2011 , G09G3/3614 , G09G3/3655 , G09G3/3688 , G09G2330/021 , H03F3/3011 , H03K5/086 , H03K5/2481
Abstract: 在对置电极VCOM为VC1的期间T1(正极),由含有P型驱动晶体管的P型运算放大器OP1驱动数据线;在VCOM为VC2的期间T2(负极),由含有N型驱动晶体管的N型运算放大器OP2驱动数据线。在VCOM转换时,将运算放大器OP1、OP2的选择电路的输出设定为高阻抗状态。在运算放大器OP1驱动时,使运算放大器OP2电流源的电流断开;在OP2驱动时,使OP1电流源的电流断开。在运算放大器OP1、OP2驱动前的期间,使OP1、OP2的驱动晶体管断开。积极利用对置电极、数据线间的寄生电容,在驱动前使数据线的电压电平变化。
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公开(公告)号：CN1290002A
公开(公告)日：2001-04-04
申请号：CN00128863.6
申请日：2000-09-26
Applicant: 精工爱普生株式会社
Inventor： 石山久展
IPC: G09G3/36
CPC classification number: G09G3/3685 , G09G3/2014 , G09G3/3614 , G09G3/3666 , G09G3/3692 , G09G2310/0221 , G09G2320/0233
Abstract: 液晶显示装置具有包括多个X电极和多个Y电极的显示部;驱动多个X电极的主导装置侧的X集成电路,从动装置侧X驱动器集成电路;驱动多个Y电极的Y驱动器集成电路。主导装置集成电路具有根据来自外部MPU的信号产生显示控制信号的显示控制信号发生部;将其输出的输出端子(或输入输出端子)。主导装置集成电路和从动装置集成电路具有通过外部布线分别输入从主导装置集成电路输出的显示控制信号的输入端子。因此,能消除由主导装置以及从动装置集成电路分别驱动的显示画面内的浓淡差。
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公开(公告)号：CN1183571A
公开(公告)日：1998-06-03
申请号：CN97120471.3
申请日：1994-07-21
Applicant: 精工爱普生株式会社
CPC classification number: G09G3/3674 , G05F3/24 , G09G3/3696 , G09G2320/041 , G09G2320/0606 , G09G2320/066
Abstract: 本发明的目的是提供一种电源装置,一个液晶显示装置和一种供电方法,具有低功耗,和高显示质量。第一电压Vx作为一恒定电压由电压调节器中的第一电压发生器产生。第二电压Vy由第二电压发生器产生,并且它的值与第一电压Vx无关,通过加法器将Vx和Vy相加,以产生一个调节好的电压Vreg、一个控制器对Vy在一个包括Vx的调压范围内实现可变化的控制,调好后的电压Vreg由一个分压器进行分压,该分压器装在多值电压发生器内。
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Patent Agency Ranking
公开(公告)号：CN100557680C
公开(公告)日：2009-11-04
申请号：CN200610091121.7
申请日：2006-06-30
Applicant: 精工爱普生株式会社
CPC classification number: G09G3/20 , G09G2300/0426 , H01L27/12
Abstract: 本发明提供一种可以缩小电路面积、提高设计效率的集成电路装置、电子设备。集成电路装置包括第一～第N电路块CB1～CBN，其在以从集成电路装置的短边即第一边朝向对面的第三边的方向为第一方向D1、以从集成电路装置的长边即第二边朝向面对的第四边的方向为第二方向D2时，沿D1方向配置。电路块CB1～CBN包括扫描驱动块SB、电源电路块PB、以及数据驱动块DB和存储块MB。数据驱动块DB和存储块MB沿D1方向邻接配置，电源电路块PB配置在扫描驱动块SB、数据驱动块DB及存储块MB之间。
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公开(公告)号：CN100557679C
公开(公告)日：2009-11-04
申请号：CN200610091113.2
申请日：2006-06-30
Applicant: 精工爱普生株式会社
CPC classification number: G11C5/025 , G09G3/3688 , G09G2300/0426 , G09G2310/027
Abstract: 本发明提供一种可以实现电路面积的缩小或设计的效率化的集成电路装置以及电子设备。该集成电路装置包括，第一至第N电路块CB1至CBN，当从集成电路装置的短边第一边向相对的第三边去的第一方向设为D1，将从集成电路装置的长边第二边向相对的第四边去的第二方向设为D2时，所述第一至第N电路块CB1至CBN沿D1方向配置。第一至第N电路块CB1至CBN包括，至少一个存储块MB，用于存储图像数据；以及，至少一个数据驱动块DB，用于驱动数据线。存储块MB包括存储单元阵列，行地址译码器RD以及读出放大器块SB。行地址译码器RD配置成其长边方向沿D1方向，读出放大器块SAB配置成其长边方向沿D2方向。
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公开(公告)号：CN100530642C
公开(公告)日：2009-08-19
申请号：CN200610091115.1
申请日：2006-06-30
Applicant: 精工爱普生株式会社
Abstract: 本发明提供一种细长的集成电路装置及包括该集成电路装置的电子设备，该集成电路装置(10)包括：焊盘PDx；以及形成为长方形区域，并和上述焊盘电连接的静电保护元件。以焊盘的排列方向与静电保护元件ESDx所形成区域的长边方向平行，并与静电保护元件ESDx的一部分或者全部重叠的方式，在该静电保护元件的上层配置焊盘PDx。
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公开(公告)号：CN100458878C
公开(公告)日：2009-02-04
申请号：CN200410089834.0
申请日：2002-06-04
Applicant: 精工爱普生株式会社
Inventor： 石山久展
IPC: G09G3/20
CPC classification number: G09G3/2011 , G09G3/3614 , G09G3/3655 , G09G3/3688 , G09G2330/021 , H03F3/3011 , H03K5/086 , H03K5/2481
Abstract: 在对置电极VCOM为VC1的期间T1(正极)，由含有P型驱动晶体管的P型运算放大器OP1驱动数据线；在VCOM为VC2的期间T2(负极)，由含有N型驱动晶体管的N型运算放大器OP2驱动数据线。在VCOM转换时，将运算放大器OP1、OP2的选择电路的输出设定为高阻抗状态。在运算放大器OP1驱动时，使运算放大器OP2电流源的电流断开；在OP2驱动时，使OP1电流源的电流断开。在运算放大器OP1、OP2驱动前的期间，使OP1、OP2的驱动晶体管断开。积极利用对置电极、数据线间的寄生电容，在驱动前使数据线的电压电平变化。
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公开(公告)号：CN1893066A
公开(公告)日：2007-01-10
申请号：CN200610091115.1
申请日：2006-06-30
Applicant: 精工爱普生株式会社
Abstract: 本发明提供一种细长的集成电路装置及包括该集成电路装置的电子设备，该集成电路装置(10)包括：焊盘PDx；以及形成为长方形区域，并和上述焊盘电连接的静电保护元件。以焊盘的排列方向与静电保护元件ESDx所形成区域的长边方向平行，并与静电保护元件ESDx的一部分或者全部重叠的方式，在该静电保护元件的上层配置焊盘PDx。
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