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公开(公告)号：CN118336662A
公开(公告)日：2024-07-12
申请号：CN202410628741.8
申请日：2024-05-21
Applicant: 北京航空航天大学
Abstract: 本发明公开了一种欠压防浪涌电路及其设计方法，其中欠压防浪涌电路，包括：PMOS场效应晶体管、第一电阻、第二电阻以及电容；所述第一电阻与第二电阻相互串联连接后作为整体并联在输入电源的两端，所述输入电源包括直流电源和与之串接的电源内阻；所述电容并联在所述第一电阻的两端；所述PMOS场效应晶体管的栅极和源极分别与所述第一电阻的两端连接，且所述PMOS场效应晶体管的源极与所述输入电源的正向输入端相连；所述PMOS场效应晶体管的漏极与正向输出端相连，所述第二电阻远离第一电阻的一端与负向输出端相连。本发明结构简单，能够实现欠压情况下的后级电路保护。
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公开(公告)号：CN102540062B
公开(公告)日：2014-07-02
申请号：CN201110451966.3
申请日：2011-12-29
Applicant: 北京航空航天大学
IPC: G06F11/00
Abstract: 本发明公开了一种针对SRAM型FPGA的随机翻转故障注入方法，针对采用SRAM型FPGA实现的电路，利用其动态重配置的优点，通过翻转比特位即可人为的在FPGA中引入与单粒子翻转同等效力的故障，一方面对设计电路配置存储单元执行多位随机故障注入，替代辐射模拟，从而对电路设计防护手段的有效性进行评测；另一方面通过单位随机故障注入，累积翻转直到出现功能性错误，从而得到配置存储单元的刷新周期。
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公开(公告)号：CN101109638B
公开(公告)日：2010-06-30
申请号：CN200710120509.X
申请日：2007-08-20
Applicant: 北京航空航天大学
Abstract: 本发明公开了一种具有调零功能的光纤陀螺模拟量角速度输出电路，由FPGA逻辑处理器、基准电压源、以及信号调理电路组成，所述信号调理电路包括有第一串行D/A转换器、第二串行D/A转换器、串行A/D转换器、第一运算放大器、第二运算放大器、第三运算放大器、电压跟随器；所述光纤陀螺模拟量角速度输出电路在运行时有调零阶段和角速度输出阶段；本发明光纤陀螺模拟量角速度输出电路中第一串行D/A转换器的输出电压V1-1＝V0×V1-2/2N，FPGA逻辑处理器输出调零数据的十进制数值V2-2＝V2-1/V0×2N。本发明光纤陀螺的角速度以具有极性的电压量形式输出，其极性与陀螺旋转方向对应；在运行状态任意时刻均可以调零，调零时间和次数不受限制。
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公开(公告)号：CN1904554B
公开(公告)日：2010-05-12
申请号：CN200610088975.X
申请日：2006-07-28
Applicant: 北京航空航天大学
IPC: G01C19/72
Abstract: 空间应用的低功耗光纤陀螺组合设计方法，具体如下：(1)将单表光纤陀螺信号处理系统进行降功耗设计，选用低功耗芯片，降低了单表光纤陀螺内部数字处理芯片的工作频率，大大降低了陀螺内部信号处理系统的功耗；(2)将单表光纤陀螺光源温控电路降功耗设计，使光源安装在光纤陀螺的底板上即安装面内侧，从而光源的热量能够迅速通过热传导传至安装基座上，减少了陀螺高温工作时温控电路的热功耗，从而降低了光纤陀螺的功耗；(3)将光纤陀螺组合体的降功耗设计，具体方案为最大限度的增加陀螺安装面与本体安装面、本体安装面与基座安装面的接触面积，从而减少光纤陀螺组合体的热功耗。本发明提高了光纤陀螺的可靠性，保证了光纤陀螺空间应用时的使用寿命。
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公开(公告)号：CN1888822A
公开(公告)日：2007-01-03
申请号：CN200610088976.4
申请日：2006-07-28
Applicant: 北京航空航天大学
IPC: G01C19/72
Abstract: 一种适用于空间应用的光纤陀螺组合测试平台，包括陀螺组件、供电部分、采集部分、数据处理，稳压电源通过电源盒为陀螺组件供电，同时对陀螺组件工作电流进行监测；采集部分和数据处理与陀螺组件接口采用总线方式连接，三只陀螺的接收数据线挂在一条总线上与系统发送数据线相连，事先约定三只陀螺标识码，系统同时向三只陀螺发送一个标识码，标识码相符的陀螺占据总线，并向系统发送数据，发送数据结束后释放总线；陀螺发送还数据经采集线至数据采集卡后送入数据处理部分中的计算机，由计算机通过程序对数据进行处理，输出各轴陀螺的零偏、零偏稳定性的值。本发明具有结构简单，操作方便，实用性好等优点，配合各种环境测试设备时，可完成陀螺组合的各种性能测试，实现对空间应用陀螺组合性能的综合评价。
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Patent Agency Ranking
公开(公告)号：CN105688280A
公开(公告)日：2016-06-22
申请号：CN201610128542.6
申请日：2016-03-08
Applicant: 北京航空航天大学
CPC classification number: A61L27/3808 , A61L27/025 , A61L27/18 , A61L27/20 , A61L27/222 , A61L27/3804 , A61L27/3817 , A61L27/3821 , A61L27/3826 , A61L27/3839 , A61L27/3847 , A61L27/3852 , A61L27/3886 , A61L27/58 , A61L2430/02 , A61L2430/06 , A61L2430/20 , A61L2430/28 , C08L89/06 , C08L79/04 , C08L65/00 , C08L67/04 , C08L5/08 , C08L5/04
Abstract: 本发明公开一种基于介电泳吸附原理的细胞三维组装方法，属于组织和器官的人工制造技术领域。该方法首先配制导电可降解生物材料作为细胞组装的支架主体导电层，不导电生物相容性好的材料作为支架绝缘层，用计算机建立具有标定上述材料区域的类组织层片信息模型，由此信息模型直接驱动多喷头快速成形设备制造可导电三维组织工程支架并冷冻干燥，将灭菌的三维支架安装电极对并浸入选定的细胞悬浮液，接通一定幅值的交流电，持续一段时间以实现细胞三维组装。本发明基于导电可降解生物材料支架及介电泳吸附原理，能够实现含有一种或多种细胞的三维组装。
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公开(公告)号：CN102521467B
公开(公告)日：2013-04-24
申请号：CN201110449296.1
申请日：2011-12-29
Applicant: 北京航空航天大学
IPC: G06F17/50
Abstract: 本发明公开了一种针对SRAM型FPGA的逐位翻转故障注入方法，通过检测电路设计配置存储单元中的单粒子翻转敏感位位置，得到动态翻转截面和失效率，绘出可靠度变化曲线，从而可以对电路设计空间应用的可靠度进行评测。方法包括，步骤一：初始配置；步骤二：翻转比特位；步骤三：判断是否产生错误；步骤四：判断是否完成测试；步骤五：获取FPGA的动态翻转截面和可靠度变化曲线。
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公开(公告)号：CN102540062A
公开(公告)日：2012-07-04
申请号：CN201110451966.3
申请日：2011-12-29
Applicant: 北京航空航天大学
IPC: G01R31/3185
Abstract: 本发明公开了一种针对SRAM型FPGA的随机翻转故障注入方法，针对采用SRAM型FPGA实现的电路，利用其动态重配置的优点，通过翻转比特位即可人为的在FPGA中引入与单粒子翻转同等效力的故障，一方面对设计电路配置存储单元执行多位随机故障注入，替代辐射模拟，从而对电路设计防护手段的有效性进行评测；另一方面通过单位随机故障注入，累积翻转直到出现功能性错误，从而得到配置存储单元的刷新周期。
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公开(公告)号：CN101592526A
公开(公告)日：2009-12-02
申请号：CN200910085890.X
申请日：2009-06-03
Applicant: 北京航空航天大学
Abstract: 一种光平均波长的测量方法及装置，以解决在现有测量平均波长的技术中，存在不能测量宽谱光的波长、测量精度较低、测量误差较大以及稳定工作点较难调的问题。本发明包括将输入的光信号通过相位调制得到两路光，并使经过光纤环传输的两路光产生干涉；接收干涉的光信号并将所述光信号转换成电信号，通过对电信号解调获得所述输入的光信号的平均波长。本发明通过将接收的干涉光信号转化为电信号，并通过对电信号的解调得到输入的光信号的平均波长，具有测量精度较高、测量误差较小以及容易测量的特点，可以用于测量光纤传感和光纤通讯领域宽谱光信号的平均波长，也可以用于测量窄谱光信号的平均波长，特别适用于高精度宽谱光平均波长的测量。
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公开(公告)号：CN100495352C
公开(公告)日：2009-06-03
申请号：CN200710064536.X
申请日：2007-03-19
Applicant: 北京航空航天大学
IPC: G06F11/00
Abstract: 本发明公开了一种适用于卫星微处理器闩锁故障检测电路，由DSP处理器U1、电压比较器U2、电源开关U3构成；所述电源开关U3提供卫星微处理器所需电源；DSP处理器U1输出控制电源开关U3的开/关指令信息f1，所述开/关指令信息f1用于卫星微处理器在发生“闩锁”故障时，断开其电源，防止卫星微处理器因通过的大电流发生短路；当电源开关U3给卫星微处理器供电时，其输出的电流采样信号经采样电阻R5后输出采样电压f2给电压比较器U2；电压比较器U2对接收的所述采样电压f2、参考电压f0进行差值比较后输出数字逻辑信号f3给DSP处理器U1。
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