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公开(公告)号：CN114914237A
公开(公告)日：2022-08-16
申请号：CN202210845626.7
申请日：2022-07-19
Applicant: 北京智芯微电子科技有限公司 , 国网江苏省电力有限公司 , 国家电网有限公司
IPC: H01L27/02 , G06F30/392 , G06F30/394
Abstract: 本申请涉及集成电路芯片设计领域，提供一种ROMKEY单元的版图结构、芯片版图布局方法及芯片。所述ROMKEY单元的版图结构，包括第一逻辑版图区和第二逻辑版图区，第一逻辑版图区和第二逻辑版图区设置有各自的逻辑输出端，第一逻辑版图区的逻辑输出端和第二逻辑版图区的逻辑输出端的上方均覆盖金属带；第一逻辑版图区的逻辑输出端通过连接孔与金属带连接，以实现第一逻辑功能；或者，第二逻辑版图区的逻辑输出端通过连接孔与金属带连接，以实现第二逻辑功能。本申请结构简单灵活、适配性强，可适用于各类工艺制程领域；在对芯片改版设计时如需更新ROMKEY密钥或ROMCODE，仅修改一层光罩掩模版即可实现不同的逻辑输出。
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公开(公告)号：CN114047956B
公开(公告)日：2022-04-19
申请号：CN202210046744.1
申请日：2022-01-17
Applicant: 北京智芯微电子科技有限公司
IPC: G06F9/38
Abstract: 本发明涉及处理器领域，提供一种处理器指令多发射方法、双发射方法、装置及处理器。所述处理器指令多发射方法包括：判断待处理的连续N条指令执行时需要的资源是否冲突，其中N为大于等于3的整数；在确定待处理的N条指令执行时需要的资源不冲突的情况下，在同一个时钟周期内发射待处理的第一条指令至第N条指令。本发明通过判断待处理的多条指令执行所需要的资源是否冲突来确定是否多发射指令，在资源不冲突的情况下多发射指令，处理器只需要一套执行单元，在不增加额外的执行单元的情况下实现指令多发射，提升处理器执行效率。
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公开(公告)号：CN114047956A
公开(公告)日：2022-02-15
申请号：CN202210046744.1
申请日：2022-01-17
Applicant: 北京智芯微电子科技有限公司
IPC: G06F9/38
Abstract: 本发明涉及处理器领域，提供一种处理器指令多发射方法、双发射方法、装置及处理器。所述处理器指令多发射方法包括：判断待处理的连续N条指令执行时需要的资源是否冲突，其中N为大于等于3的整数；在确定待处理的N条指令执行时需要的资源不冲突的情况下，在同一个时钟周期内发射待处理的第一条指令至第N条指令。本发明通过判断待处理的多条指令执行所需要的资源是否冲突来确定是否多发射指令，在资源不冲突的情况下多发射指令，处理器只需要一套执行单元，在不增加额外的执行单元的情况下实现指令多发射，提升处理器执行效率。
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公开(公告)号：CN113986348A
公开(公告)日：2022-01-28
申请号：CN202111080668.8
申请日：2021-09-15
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网宁夏电力有限公司营销服务中心(国网宁夏电力有限公司计量中心) , 国家电网有限公司
IPC: G06F9/30
Abstract: 本发明公开了一种数据压栈方法、装置、芯片及存储介质。其中，数据压栈方法包括：在压栈动作发生时，若存在未完成更新的上下文数据，则跳过未完成更新的上下文数据，并在其它上下文数据全部或部分压栈完成后再压栈未完成更新的上下文数据；若未存在未完成更新的上下文数据，则按序压栈所有上下文数据。由此，在存在未完成更新的上下文数据时，能够使得数据压栈和数据更新并行，减小或消除等待数据更新的时间，从而提高中断响应的实时性。
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公开(公告)号：CN113505016A
公开(公告)日：2021-10-15
申请号：CN202110771728.4
申请日：2021-07-08
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网江西省电力有限公司 , 国家电网有限公司
Abstract: 本发明涉及芯片技术领域，提供一种总线传输故障检测方法、总线系统及芯片。所述总线传输故障检测方法包括：对接收到的地址信号和数据信号中的校验值进行验证；根据校验值验证结果确定地址信号和数据信号的传输故障，所述地址信号和所述数据信号通过基于AHB‑Lite协议的总线传输；对AHB‑Lite协议定义的控制信号进行传输校验，根据传输校验结果确定控制信号的传输故障。本发明的方案能够保证AHB‑Lite总线传输的正确性。
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Patent Agency Ranking
公开(公告)号：CN113176983B
公开(公告)日：2021-09-28
申请号：CN202110720483.2
申请日：2021-06-28
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网宁夏电力有限公司营销服务中心(国网宁夏电力有限公司计量中心) , 国家电网有限公司
Abstract: 本发明涉及CPU技术领域，提供一种程序流监控方法及程序流监控系统、CPU、芯片。所述程序流监控方法包括：通过在程序中设置的监控点对所述程序的程序流的执行信息进行记录，确定所述程序流的执行轨迹；根据记录的所述程序流的执行信息确定所述程序流的预期执行时间；统计所述程序流的实际执行时间；根据所述程序流的实际执行时间与所述程序流的预期执行时间的对比结果确定所述程序流是否按照预期执行。本发明从时间和空间相结合的维度来判断程序流是否按照预期执行，提高程序流监控的准确性，可同时实现对程序流的执行时间和执行轨迹进行监控，增强程序流执行的可靠性。
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公开(公告)号：CN113254083A
公开(公告)日：2021-08-13
申请号：CN202110717773.1
申请日：2021-06-28
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司 , 国网宁夏电力有限公司营销服务中心(国网宁夏电力有限公司计量中心) , 国家电网有限公司
IPC: G06F9/38
Abstract: 本发明涉及处理器领域，提供一种指令处理方法、指令处理系统及处理器、芯片。所述指令处理方法包括：取指级取回指令并缓存；译码级读取取指级缓存的指令并对读取的指令进行译码处理，判断译码后的指令中是否存在IT指令，在确定存在IT指令时对所述IT指令的后续相关联的IT区块指令进行处理；执行级执行译码后的指令，将当前执行结果状态信息反馈到所述译码级。本发明在一时钟周期可以读取多条指令，至少节约一个时钟周期，提高流水线执行效率，从而提高处理器的效率。
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公开(公告)号：CN112231695B
公开(公告)日：2021-03-05
申请号：CN202011484779.0
申请日：2020-12-16
Applicant: 北京智芯微电子科技有限公司 , 北京芯可鉴科技有限公司 , 武汉大学 , 国网信息通信产业集团有限公司
IPC: G06F21/52
Abstract: 本发明涉及信息安全技术领域，提供一种基于分支预测机制的攻击方法及系统、存储介质。所述方法包括：基于分支预测机制构建针对目标程序的分支预测信息矩阵；对符合所述目标程序的输入数据规则的明文数据进行选择；将选择后的明文数据作为所述目标程序的输入数据或部分输入数据，采集所述目标程序运行的时间样本数据；根据所述分支预测信息矩阵确定与所述时间样本数据相对应的秘密信息。本发明在攻击过程中利用了目标程序运行的整体时间数据，对采集时间点位要求低，能够对泄露信息（秘密信息）进行整体刻画，减少对目标程序的控制要求，并且通过统计分析的方式进行攻击，对泄露的刻画更精确，提升时间攻击检测的精准性。
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公开(公告)号：CN112000584B
公开(公告)日：2021-01-29
申请号：CN202011160052.7
申请日：2020-10-27
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司
IPC: G06F11/36
Abstract: 本发明涉及程序调试技术领域，提供一种基于IDE调试框架的用于CPU程序的调试方法、调试系统以及存储介质。所述调试方法包括：根据CPU程序的调试状态创建与所述调试状态相对应的启动程序；判断所述启动程序的类型，根据所述启动程序的类型确定是否创建调试程序。本发明基于IDE调试框架改进用于CPU程序的调试方法，对调试的启动程序进行分类，根据启动程序的类型确定是否创建调试程序。在CPU程序处于调试状态时，在用户错误操作或多次点击Debug按钮情况下能够对已创建的调试程序进行保护，使IDE开发环境容错性更好，保证IDE开发环境处于健康状态，大大提升研发效率。
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公开(公告)号：CN112000584A
公开(公告)日：2020-11-27
申请号：CN202011160052.7
申请日：2020-10-27
Applicant: 北京智芯微电子科技有限公司 , 国网信息通信产业集团有限公司
IPC: G06F11/36
Abstract: 本发明涉及程序调试技术领域，提供一种基于IDE调试框架的用于CPU程序的调试方法、调试系统以及存储介质。所述调试方法包括：根据CPU程序的调试状态创建与所述调试状态相对应的启动程序；判断所述启动程序的类型，根据所述启动程序的类型确定是否创建调试程序。本发明基于IDE调试框架改进用于CPU程序的调试方法，对调试的启动程序进行分类，根据启动程序的类型确定是否创建调试程序。在CPU程序处于调试状态时，在用户错误操作或多次点击Debug按钮情况下能够对已创建的调试程序进行保护，使IDE开发环境容错性更好，保证IDE开发环境处于健康状态，大大提升研发效率。
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