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公开(公告)号：CN110335323B
公开(公告)日：2021-04-20
申请号：CN201910551465.9
申请日：2019-06-24
Applicant: 浙江大学
Abstract: 本发明公开了一种现场可编程逻辑门阵列器件的比特流图像化方法，包括图像化与自动标注；图像化：1.1)、对无关信息的去除：将数据锁定在FPGA可编程逻辑的逻辑部分中的CLB部分，其余信息在比特流图像化过程中舍去不予考虑；1.2)、采用对单个CLB进行图像恢复，并按照Device图中的二维阵列排列行数对这些单个CLB恢复图进行拼接，形成整幅比特流恢复图；自动标注：指定实现过程所利用的资源区域范围以及比特流输出文件名。本发明提供了一种全新的结合FPGA逻辑资源二维物理分布，将比特流中用于描述可配置资源的信息转化为映射关系较强的二维图像的算法，并实现模块功能的自动标注。
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公开(公告)号：CN109359735B
公开(公告)日：2020-12-04
申请号：CN201811403040.5
申请日：2018-11-23
Applicant: 浙江大学
Abstract: 本发明提供了一种深度神经网络硬件加速的数据输入装置，包括PE阵列组、三重输入缓冲、权重缓冲、输出缓冲和控制器；三重输入缓冲与PE阵列组一一对应的相连，且PE阵列组和输出缓冲一一对应的相连；每个三重输入缓冲通过总线与输入特征图存储区相连；控制器分别与输入特征图存储区以及每个三重输入缓冲相连；权重缓冲通过总线与权重存储区相连，且权重缓冲与每个PE阵列组相连；每个输出缓冲通过总线与输出特征图存储区相连。本发明还提供一种利用上述装置进行的深度神经网络硬件加速的数据输入方法，通过对三重输入缓冲的设计，实现数据传输时时延隐藏的目的的同时使数据重叠的部分可以直接复用，提高数据的复用率。
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公开(公告)号：CN109359735A
公开(公告)日：2019-02-19
申请号：CN201811403040.5
申请日：2018-11-23
Applicant: 浙江大学
CPC classification number: G06N3/063 , G06N3/0454
Abstract: 本发明提供了一种深度神经网络硬件加速的数据输入装置，包括PE阵列组、三重输入缓冲、权重缓冲、输出缓冲和控制器；三重输入缓冲与PE阵列组一一对应的相连，且PE阵列组和输出缓冲一一对应的相连；每个三重输入缓冲通过总线与输入特征图存储区相连；控制器分别与输入特征图存储区以及每个三重输入缓冲相连；权重缓冲通过总线与权重存储区相连，且权重缓冲与每个PE阵列组相连；每个输出缓冲通过总线与输出特征图存储区相连。本发明还提供一种利用上述装置进行的深度神经网络硬件加速的数据输入方法，通过对三重输入缓冲的设计，实现数据传输时时延隐藏的目的的同时使数据重叠的部分可以直接复用，提高数据的复用率。
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公开(公告)号：CN105955709B
公开(公告)日：2018-02-27
申请号：CN201610236148.4
申请日：2016-04-16
Applicant: 浙江大学
Abstract: 本发明公开了一种基于机器学习的预取能效优化自适应装置及方法，本发明的结合机器学习的动态调整预取配置的方法，能够根据应用的特征最大化预取能效。具体如下：a、提取程序特征：通过硬件计数器提取应用程序在运行时的存储访问行为及预取相关行为信息，作为程序特征观测量；b、构建训练数据集：根据程序特征提取的结果，选择与预取能效最相关的特征及达到最大能效时预取的配置，作为一个有效数据；c、训练学习模型：给定程序的特征观测量及对应的最优预取配置作为模型的输入，采用机器学习的算法训练学习模型；d、动态预测预取配置：学习模型根据新的应用程序运行时收集程序特征观测量对程序进行分类，预测预取的配置最大化能效。
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公开(公告)号：CN103926471B
公开(公告)日：2017-01-25
申请号：CN201410169430.6
申请日：2014-04-25
Applicant: 浙江大学
IPC: G01R29/00
Abstract: 本发明提供的眼开监视器装置在实现信号眼图测试时，使用两个与信号频率相同的眼开测量时钟对所设置的相位点上的眼图打开大小进行测试；设置阈值大小以及在半个周期内对测量时钟相位进行设置；判断所设置的阈值大小在测量时钟处是否在眼图内部，满足在眼图内部的最大阈值便是该时钟相位点处的眼图打开大小；将每个相位点上的眼图打开大小结果保存到寄存器中，在测试完所有相位点后将寄存器的值依序排列，得到了信号眼图的水平与垂直打开大小值。与现有技术相比，本发明提出的眼开监视器电路装置具有无需进行初始时钟与数据的同步操作，测试过程设置与测试结果记录由数字控制
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Patent Agency Ranking
公开(公告)号：CN103592702B
公开(公告)日：2015-05-20
申请号：CN201310526342.2
申请日：2013-10-30
Applicant: 浙江大学
Abstract: 本发明公开了一种用于激光光束整形的双自由曲面透镜的设计方法，属于非成像光学和激光光束整形技术领域，本发明根据设计要求设置双自由曲面透镜的初始结构，根据能量守恒、折射定律和光程关系，在计算机的辅助下，设计出满足预定照明要求的双自由曲面透镜，使入射激光光束经过该透镜偏折后产生预定的强度分布和相位分布。双自由曲面透镜包含前表面和后表面两个自由曲面，且前后两个自由曲面均通过曲面拟合离散数据点得到。本发明还公开了一种基于上述方法的用于激光光束整形的双自由曲面透镜。本发明获得了连续的自由曲面面型，实现了曲面的可加工；能同时实现对激光光束的强度与相位分布的调控，控制能力强，设计效率高。
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公开(公告)号：CN103984520A
公开(公告)日：2014-08-13
申请号：CN201410161889.1
申请日：2014-04-22
Applicant: 浙江大学
IPC: G06F7/52
Abstract: 本发明公开了一种面向无损音频解码算法的自调乘累加装置，其特征在于：包括操作数预处理单元（1）、乘法器单元（2）、乘法器结果处理单元（3）和乘累加器输出单元（4）；所述操作数预处理单元（1）用于对操作数进行判决和分解；乘法器单元（2）用于对操作数预处理单元（1）输入的操作数进行乘法运算；乘法器结果处理单元（3）对乘法单元的输出结果进行拼接和符号扩展操作；乘累加器输出单元（4）对乘法器结果处理单元（3）的输入进行加法运算从而得到最终的乘累加结果。该装置用于实现多种模式的乘累加运算，它能够根据乘累加操作数的数据特性实现32×32位和16×16位两种不同模式下的乘累加运算。
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公开(公告)号：CN102629913A
公开(公告)日：2012-08-08
申请号：CN201210104961.8
申请日：2012-04-11
Applicant: 浙江大学
IPC: H04L12/56
Abstract: 本发明公开了一种适用于全局异步局部同步片上互连网络的路由器装置，具有3个流水级，在BW/RC级对微片进行缓存和时钟域的转换，并利用时钟域转换的延迟对数据包进行路由计算和对计算结果的同步；在VA/SA级以投机的方式同时对虚通道和交叉开关的使用权进行申请，虚通道分配器对虚通道请求做出仲裁，交叉开关分配器只对非投机微片的交叉开关请求进行仲裁，并直接将虚通道请求的仲裁结果直接做为微片投机申请交叉开关的仲裁结果，交叉开关分配器优先选择非投机交叉开关请求的仲裁结果做为最终的交叉开关分配结果；在ST级，交叉开关选择器根据交叉开关的仲裁结果，连通相应虚通道的输入端口至输出端口，微片离开异步缓存通过路由器。
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公开(公告)号：CN101860752B
公开(公告)日：2012-02-01
申请号：CN201010166248.7
申请日：2010-05-07
Applicant: 浙江大学
Abstract: 本发明提出了一种针对嵌入式多核系统的视频编码程序流水化并行方法，该方法基于视频编码原程序对基本数据单元处理的数据流图表示，对目标视频编码原程序进行模拟仿真，提取数据流图中各个节点运算量，分析数据流图中各个节点的依赖关系及流水化并行后处理基本数据单元时的数据依赖关系，根据得到的节点运算量及节点间依赖关系选择处理器负载均衡、核间通信量少的流水并行划分方案。得到划分方案后对任务节点按照指示器的接口标准进行对象化封装，将封装后的对象静态地映射到相应的处理器核上，配合各个处理器核上的指示器实现多核系统对视频编码原程序的流水化并行执行。本发明适用于各种数据流处理类型的程序的并行化。
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公开(公告)号：CN101872299A
公开(公告)日：2010-10-27
申请号：CN201010219504.4
申请日：2010-07-06
Applicant: 浙江大学
Abstract: 本发明公开了一种事务存储器的冲突预测处理装置，包括处理器、硬件事务存储器和内部总线；硬件事务存储器内设有投机型高速缓存(201)、写地址缓冲单元(202)、预测恢复高速缓存(203)、冲突预测地址单元(204)和冲突预测寄存器保存单元(205)；写地址缓冲单元(202)分别与处理器和内部总线相连，投机型高速缓存(201)分别与预测恢复高速缓存(203)、冲突预测地址单元(204)和处理器相连，冲突预测寄存器保存单元(205)与内部总线相连。本发明还同时公开了一种事务冲突预测实现方法。采用本发明的事务冲突预测实现方法，能减少事务处理中的冲突损耗。
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