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公开(公告)号：CN103678155B
公开(公告)日：2016-12-21
申请号：CN201210349302.0
申请日：2012-09-19
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F12/06
Abstract: 本发明实施例提供一种内存地址映射处理方法及多核处理器，方法包括：多核处理器交替访问内存系统的物理地址中各组第一地址和第二地址，获取与每组第一地址和第二地址对应的第一平均访问延迟，第一地址与第二地址只在相同的两个地址位上对应的取值不同且两个地址位为物理地址各地址位中除行地址位和列地址位之外的地址位；多核处理器根据各第一平均访问延迟，确定物理地址的存储体地址位。本发明实施例提供的内存地址映射处理方法及多核处理器可以方便的获取物理地址到内存系统的存储体bank的地址映射关系，进而可以使用获取的bank地址的映射关系将bank partition应用于实体计算机内存系统，以避免多核处理器共享bank干扰。
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公开(公告)号：CN105335308A
公开(公告)日：2016-02-17
申请号：CN201410239181.3
申请日：2014-05-30
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F13/28
CPC classification number: G06F13/10
Abstract: 本发明公开一种对存储设备的访问信息处理方法和装置、系统，其中，访问设备的处理器根据进程发起的访问请求中包括的虚拟地址，确定与所述虚拟地址对应的存储设备标识；生成访问请求消息，所述访问请求消息中包括访问地址；根据所述存储设备标识，向所述存储设备标识指向的存储设备的处理器发送所述访问请求消息，以使所述存储设备的处理器根据所述访问请求消息中包括的访问地址，在所述访问地址指向的存储介质中执行访问请求操作。提高了一体化存储设备的访问性能。
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公开(公告)号：CN105282056A
公开(公告)日：2016-01-27
申请号：CN201510760415.3
申请日：2015-11-09
Applicant: 中国科学院计算技术研究所
IPC: H04L12/935 , H04L12/733 , H04L12/04
Abstract: 本发明涉及数据中心网络架构技术领域，特别涉及一种新型光电混合交换数据中心网络架构，包括服务器、数据交换设备其特征在于，所述数据交换设备至少存在两个高速电交换端口，所述高速电交换端口用于所述数据交换设备之间进行连接；所述数据交换设备包括多个低速电交换端口，所述低速电交换端口用于连接所述服务器，及所述数据交换设备包括至少由一个波长光发射器构成的光端口，所述光端口用于所述数据交换设备之间进行快速动态带宽调整。本发明具有较低的建设成本和运营成本优势，具有较为稳定的性能，即随着规模扩大性能可以得到较好的保持。
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公开(公告)号：CN102609254B
公开(公告)日：2015-04-22
申请号：CN201210017962.9
申请日：2012-01-19
Applicant: 中国科学院计算技术研究所
Abstract: 本发明提供一种软硬件结合方式来获取对象级访存行为的方法。该方法通过硬件侦听的方式获取每个访存请求中关于物理地址、读/写、到达时间的信息；获取进程页表信息，实时监控并记录内核更新页表的操作；实时监控进程的动态分配和释放内存的操作，获取对象的虚拟地址空间信息。并通过整合上述信息得到了精确的对象级访存行为，为程序调试和性能调优提供丰富的访存信息。而且该方法不会对程序的执行造成干扰，不会引入额外开销。
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公开(公告)号：CN104216837A
公开(公告)日：2014-12-17
申请号：CN201310213533.3
申请日：2013-05-31
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
CPC classification number: G06F9/4856 , G06F12/0215 , G06F12/0638 , G06F12/08 , G06F2212/1016 , G06F2212/205 , G06F2212/6024 , G06F2212/654
Abstract: 本发明实施例公开了一种内存系统、内存访问请求的处理方法和计算机系统。内存系统包括：类型不同的第一类内存和第二类内存，分别用于存储处理器的运行数据；内存指示表，存储有位于第一类内存的数据单元块的访存地址；缓冲调度器，用于接收内存控制器的内存访问请求；确定所访存地址对应的数据单元块存储于第一类内存中还是第二类内存中，并从确定内存中完成内存访问请求的访存操作；迁移调度器，用于更新所述数据单元块的访问信息；根据所述数据单元块的访问信息，确定是否将第二类内存中的数据单元块迁移到第一类内存中，并在迁移后更新内存指示表。
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Patent Agency Ranking
公开(公告)号：CN104166632A
公开(公告)日：2014-11-26
申请号：CN201310186233.0
申请日：2013-05-17
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F12/10
Abstract: 本发明提供一种页面内容共享的方法及装置，其中，所述方法包括：对于第一物理页面和第二物理页面，读取所述第一物理页面的第一E-hash值、第二物理页面的第二E-hash值；判断所述第一E-hash值和所述第二E-hash值是否相同；如果所述第一E-hash值和所述第二E-hash值相同，则判断所述第一物理页面和第二物理页面的页面内容是否相同；若所述第一物理页面和第二物理页面的页面内容相同，则将所述第一物理页面和所述第二物理页面的页面内容共享。上述方法解决了现有技术中后台线程计算Hash值的过程中干扰其他应用和虚拟机运行，导致服务器性能下降的问题。
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公开(公告)号：CN102541772B
公开(公告)日：2014-11-26
申请号：CN201110451208.1
申请日：2011-12-29
Applicant: 中国科学院计算技术研究所
Abstract: 本发明提供一种内存总线的信号采集装置，包括：探测缓冲单元，适于采集内存控制器与内存颗粒之间的命令/地址总线和/或数据总线的信号并缓冲输出；和采集单元，适于将所述缓冲输出的信号转化为数据；其中，选择所述探测缓冲单元的输入阻抗，使得当对内存总线进行信号采集时，所述内存总线的信号基本不受影响。所述探测缓冲单元为内存缓冲器或DDRx寄存器；所述采集单元为FPGA、高速示波器或逻辑分析仪。解决了FPGA对内存总线进行信号采集时出现的信号完整性问题，能在不干扰原有内存系统正常运行的前提下，进行有效的内存信号采集的方法。解决了高速示波器和逻辑分析仪其缓存只能存储较短时间间隔内的数据的问题，能够持续捕获并输出。
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公开(公告)号：CN104079508A
公开(公告)日：2014-10-01
申请号：CN201310102374.X
申请日：2013-03-27
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: H04L12/947 , H04L12/927
CPC classification number: H04L12/6418
Abstract: 本发明实施例提供一种消息处理方法及装置，该消息处理方法包括：接收发送端设备发给接收端设备的消息，其中，消息包括与发送端设备对应的源介质访问控制MAC地址和根据源MAC地址进行传送的数据载荷，源MAC地址的空闲字段中包括有用于指示如何处理消息的处理指示信息；根据处理指示信息，对消息进行处理。本发明实施例提供的消息处理方法及装置，充分利用了MAC地址，实现了基于MAC地址的网络管理，提高了网络管理效果。
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公开(公告)号：CN104022928A
公开(公告)日：2014-09-03
申请号：CN201410215126.0
申请日：2014-05-21
Applicant: 中国科学院计算技术研究所
CPC classification number: Y02D50/10
Abstract: 本发明提供一种高密度服务器的拓扑构建方法及系统。所述方法包括：根据对网络规模的需求创建用于高密度服务器的拓扑结构的Kautz有向图，并且将该Kautz有向图划分为多个同构子图；根据同构子图在子服务器上布置交换芯片，并且根据Kautz有向图在高密度服务器内布置多个子服务器，使得该多个子服务器上的交换芯片与所述Kautz有向图中的节点一一对应并且交换芯片之间的连接方式与所述Kautz有向图中的对应节点之间的连接方式一致。本发明基于Kautz有向图、使用拓扑结构相同的子服务器构成高密度服务器，使得该高密度服务器具有高效、容错性好并且可扩展的特点；此外，可以批量生产子服务器，从而节省了制造成本以及时间成本。
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公开(公告)号：CN103902467A
公开(公告)日：2014-07-02
申请号：CN201210575114.X
申请日：2012-12-26
Applicant: 华为技术有限公司 , 中国科学院计算技术研究所
IPC: G06F12/06
CPC classification number: G06F12/0292 , G06F2212/401
Abstract: 本发明实施例提供一种压缩内存访问控制方法、装置及系统。该方法包括接收内存控制器发送的读请求消息，读请求消息包括待读数据的实际地址；根据待读数据的实际地址，从内存映射关系表中查询得到实际地址对应的物理地址段，内存映射关系表中记录有实际地址与内存芯片的物理地址段的对应关系；从内存芯片中读取物理地址段存储的数据，获得与实际地址对应的待读数据；将待读数据返回至内存控制器。本发明实施例可对压缩内存进行处理，可减少现有压缩内存访问中所带来的带宽资源浪费问题；同时，在内存访问过程中，可使得处理器与内存芯片之间的数据传输以压缩数据形式进行传输，从而可进一步减少内存访问的带宽资源占用。
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