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公开(公告)号：CN101076963A
公开(公告)日：2007-11-21
申请号：CN200480044591.7
申请日：2004-12-13
Applicant: 飞思卡尔半导体公司
IPC: H04L1/00
CPC classification number: H04L1/0054 , H04L1/0051 , H04L1/0061
Abstract: 一种用于定位接收帧的末端的设备(100)，该设备包括：至少一个用于存储路径度量的存储单元(120)；至少一个处理器，适于：提供在不同的可能端点结束的假设的网格路径；为每个假设的网格路径执行前向检测校验；为经过前向校验的假设网格路径计算错误检测变量；并响应于该计算，确定接收的帧的端点。其中前向检测校验的计算远快于错误检测变量的计算。一种用于定位接收的帧的末端的方法(300)，该方法包括：提供(310)在不同的可能端点结束的假设的网格路径；为每个假设的网格路径执行(320)CRC校验；为经过CRC校验的假设网格路径计算(330)错误检测变量；并响应于该计算，确定(340)接收的帧的端点。
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公开(公告)号：CN103080912B
公开(公告)日：2015-11-25
申请号：CN201080068795.X
申请日：2010-08-26
Applicant: 飞思卡尔半导体公司
Inventor： 多夫·莱翁利克
CPC classification number: G06F12/145 , G06F12/1009 , G06F12/1036 , G06F12/1072 , G06F12/109 , G06F12/1491 , G06F2212/1016 , G06F2212/1052 , G06F2212/151 , G06F2212/657
Abstract: 本发明涉及用于微处理器系统（10）的存储器管理单元（20），存储器管理单元（20）被连接或可连接到微处理器系统（10）的至少一个处理器核心（12）并且被连接或可连接到微处理器系统（10）的物理存储器（14）。存储器管理单元（20）适合于在管理程序模式中或在监督模式中选择地操作，所述管理程序模式和监督模式有访问硬件的不同特权级别。存储器管理单元（20）包括表示用于彼此映射至少一个逻辑物理地址和至少一个实际物理地址的物理地址信息的第一寄存器表（22）；表示可访问在监督模式内或在监督模式下运行的过程的物理地址的允许的地址范围的第二寄存器表（24）；其中存储器管理单元（20）适合于防止通过不在管理程序模式中的过程而写访问第二寄存器表（24）。存储器管理单元（20）还适合于，如果至少一个物理地址在允许的地址范围内，允许写访问在监督模式内或在监督模式下运行的过程的第一寄存器表（22），从而以涉及至少一个物理地址的存储器映射信息重新配置在第一寄存器表（22）中被表示的物理地址信息，而如果至少一个物理地址不在允许的地址范围内，防止写访问在监督模式内或在监督模式下运行的过程的第一寄存器表（22）。本发明还涉及微处理器系统（12）和用于管理存储器的方法。
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公开(公告)号：CN103080912A
公开(公告)日：2013-05-01
申请号：CN201080068795.X
申请日：2010-08-26
Applicant: 飞思卡尔半导体公司
Inventor： 多夫·莱翁利克
CPC classification number: G06F12/145 , G06F12/1009 , G06F12/1036 , G06F12/1072 , G06F12/109 , G06F12/1491 , G06F2212/1016 , G06F2212/1052 , G06F2212/151 , G06F2212/657
Abstract: 本发明涉及用于微处理器系统（10）的存储器管理单元（20），存储器管理单元（20）被连接或可连接到微处理器系统（10）的至少一个处理器核心（12）并且被连接或可连接到微处理器系统（10）的物理存储器（14）。存储器管理单元（20）适合于在管理程序模式中或在监督模式中选择地操作，所述管理程序模式和监督模式有访问硬件的不同特权级别。存储器管理单元（20）包括表示用于彼此映射至少一个逻辑物理地址和至少一个实际物理地址的物理地址信息的第一寄存器表（22）；表示可访问在监督模式内或在监督模式下运行的过程的物理地址的允许的地址范围的第二寄存器表（24）；其中存储器管理单元（20）适合于防止通过不在管理程序模式中的过程而写访问第二寄存器表（24）。存储器管理单元（20）还适合于，如果至少一个物理地址在允许的地址范围内，允许写访问在监督模式内或在监督模式下运行的过程的第一寄存器表（22），从而以涉及至少一个物理地址的存储器映射信息重新配置在第一寄存器表（22）中被表示的物理地址信息，而如果至少一个物理地址不在允许的地址范围内，防止写访问在监督模式内或在监督模式下运行的过程的第一寄存器表（22）。本发明还涉及微处理器系统（12）和用于管理存储器的方法。
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公开(公告)号：CN101076963B
公开(公告)日：2012-06-20
申请号：CN200480044591.7
申请日：2004-12-13
Applicant: 飞思卡尔半导体公司
IPC: H04L1/00
CPC classification number: H04L1/0054 , H04L1/0051 , H04L1/0061
Abstract: 一种用于定位接收帧的末端的设备(100)，该设备包括：至少一个用于存储路径度量的存储单元(120)；至少一个处理器，适于：提供在不同的可能端点结束的假设的网格路径；为每个假设的网格路径执行前向检测校验；为经过前向校验的假设网格路径计算错误检测变量；并响应于该计算，确定接收的帧的端点。其中前向检测校验的计算远快于错误检测变量的计算。一种用于定位接收的帧的末端的方法(300)，该方法包括：提供(310)在不同的可能端点结束的假设的网格路径；为每个假设的网格路径执行(320)CRC校验；为经过CRC校验的假设网格路径计算(330)错误检测变量；并响应于该计算，确定(340)接收的帧的端点。
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